[發明專利]一種Turbo譯碼器及譯碼方法有效
| 申請號: | 201611259880.X | 申請日: | 2016-12-30 |
| 公開(公告)號: | CN108270452B | 公開(公告)日: | 2021-07-20 |
| 發明(設計)人: | 蔣祥順;曾毅 | 申請(專利權)人: | 芯原微電子(成都)有限公司;芯原微電子(上海)股份有限公司;芯原微電子(北京)有限公司 |
| 主分類號: | H03M13/27 | 分類號: | H03M13/27;H03M13/00 |
| 代理公司: | 上海光華專利事務所(普通合伙) 31219 | 代理人: | 余明偉 |
| 地址: | 610041 四川省成都高新區天華二*** | 國省代碼: | 四川;51 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 turbo 譯碼器 譯碼 方法 | ||
1.一種Turbo譯碼器,適于WCDMA系統,其特征在于,所述Turbo譯碼器至少包括:
輸入緩沖電路、第一多路復用電路、N個軟輸入緩沖電路、第二多路復用電路、N個軟輸入軟輸出譯碼電路、第三多路復用電路、N個數據緩存電路、N個外信息緩沖電路、N個硬判決電路、N個軟輸出緩沖電路及控制電路;
所述輸入緩沖電路用于接收地址信息及軟信息;
所述第一多路復用電路連接于所述輸入緩沖電路的輸出端,用于將軟信息根據輸入的地址信息并行送入多個所述軟輸入緩沖電路中;
各軟輸入緩沖電路連接于所述第一多路復用電路的輸出端,用于對輸入的多路軟信息進行緩存;
所述第二多路復用電路連接于多個所述軟輸入緩沖電路的輸出端,用于將多路軟信息并行送入多個所述軟輸入軟輸出譯碼電路中;
各軟輸入軟輸出譯碼電路連接于所述第二多路復用電路的輸出端,用于對輸入的軟信息進行譯碼轉換為外信息,經過多次迭代實現譯碼;所述軟輸入軟輸出譯碼電路包括正向迭代單元和反向迭代單元;所述正向迭代單元包括第一分支度量模塊、第一狀態度量模塊、第一外信息度量模塊及第一加法模塊;所述反向迭代單元包括第二分支度量模塊、第二狀態度量模塊、第二外信息度量模塊及第二加法模塊;所述第一分支度量模塊接收并對正向軟信息及正向外信息進行分支度量計算;所述第一狀態度量模塊連接所述第一分支度量模塊的輸出端,其輸出信號連接至存儲器中,用于進行狀態度量計算;所述第一外信息度量模塊連接所述第一狀態度量模塊、所述第二分支度量模塊及所述存儲器的輸出端,用于進行外信息度量計算;所述第一加法模塊連接所述第一外信息度量模塊的輸出端,實現所述第一外信息度量模塊輸出的外信息與正向外信息的加法操作;所述第二分支度量模塊接收并對反向軟信息及反向外信息進行分支度量計算;所述第二狀態度量模塊連接所述第二分支度量模塊的輸出端,其輸出信號連接至存儲器中,用于進行狀態度量計算;所述第二外信息度量模塊連接所述第二狀態度量模塊、所述第一分支度量模塊及所述存儲器的輸出端,用于進行外信息度量計算;所述第二加法模塊連接所述第二外信息度量模塊的輸出端,實現所述第二外信息度量模塊輸出的外信息與反向外信息的加法操作;
所述第三多路復用電路連接于各軟輸入軟輸出譯碼電路及各數據緩存電路之間,用于實現各軟輸入軟輸出譯碼電路與各數據緩存電路之間的數據傳輸;
所述數據緩存電路連接于各軟輸入軟輸出譯碼電路與各外信息緩沖電路,用于對各軟輸入軟輸出譯碼電路與各外信息緩沖電路之間傳輸的數據進行并行寫入和讀??;
所述外信息緩沖電路用于緩存各軟輸入軟輸出譯碼電路輸出的外信息,并回傳給各軟輸入軟輸出譯碼電路,以實現多次迭代;
所述硬判決電路連接于所述第三多路復用電路的輸出端,對所述第三多路復用電路的輸出信號電平進行檢測;
所述軟輸出緩沖電路連接于各硬判決電路的輸出端,用于輸出譯碼結果;
所述控制電路為各電路提供控制信號。
2.根據權利要求1所述的Turbo譯碼器,其特征在于:所述控制電路包括交織器、并行控制單元、控制和狀態寄存單元;所述交織器連接于所述控制和狀態寄存單元的輸出端,通過地址變化控制所述第一多路復用電路、所述第二多路復用電路及所述第三多路復用電路協同工作;所述并行控制單元連接于所述控制和狀態寄存單元的輸出端,用于為各軟輸入軟輸出譯碼電路提供控制信號。
3.根據權利要求1所述的Turbo譯碼器,其特征在于:所述數據緩存電路為先進先出隊列緩存器。
4.根據權利要求1或3所述的Turbo譯碼器,其特征在于:所述數據緩存電路包括N個子數據緩存器,各子數據緩存器包括3個緩存單元,其中,第一緩存單元用于緩存所述軟輸入軟輸出譯碼電路寫入所述外信息緩沖電路中的地址信息及外信息;第二緩存單元用于緩存所述軟輸入軟輸出譯碼電路讀取所述外信息緩沖電路的地址信息;第三緩存單元用于緩存所述軟輸入軟輸出譯碼電路從所述外信息緩沖電路中讀出的外信息。
5.根據權利要求1所述的Turbo譯碼器,其特征在于:所述Turbo譯碼器還包括連接于所述軟輸出緩沖電路輸出端的循環冗余校驗電路,通過冗余校驗對譯碼結果進行檢查。
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