[發(fā)明專利]一種提升系統(tǒng)互連接受端SI性能的方法在審
| 申請?zhí)枺?/td> | 201611007060.1 | 申請日： | 2016-11-16 |
| 公開（公告）號： | CN106777470A | 公開（公告）日： | 2017-05-31 |
| 發(fā)明（設(shè)計(jì)）人： | 武寧;李永翠 | 申請（專利權(quán)）人： | 鄭州云海信息技術(shù)有限公司 |
| 主分類號： | G06F17/50 | 分類號： | G06F17/50 |
| 代理公司： | 濟(jì)南信達(dá)專利事務(wù)所有限公司37100 | 代理人： | 韓月娥 |
| 地址： | 450000 河南省鄭州市*** | 國省代碼： | 河南;41 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 提升 系統(tǒng) 互連 接受 si 性能 方法 | ||
【權(quán)利要求書】：
1.一種提升系統(tǒng)互連接受端SI性能的方法，其特征在于, 在PCB板高速走線互連設(shè)計(jì)中，參考整互連路徑上的不連續(xù)點(diǎn)阻抗值,去調(diào)整PCB板上傳輸鏈路trace阻抗值，以此匹配傳輸路徑上因connector與PCB板結(jié)合處，差分換層過孔及芯片package部位引起的阻抗突變點(diǎn)，更好地平衡整傳輸鏈路上的阻抗幅值變化。
2.根據(jù)權(quán)利要求1所述一種提升系統(tǒng)互連接受端SI性能的方法，其特征在于,通過適當(dāng)降低PCB板上傳輸線阻抗值，即將PCB板trace阻抗設(shè)計(jì)目標(biāo)值比工業(yè)規(guī)范阻抗值偏低些。
3.根據(jù)權(quán)利要求2所述一種提升系統(tǒng)互連接受端SI性能的方法，其特征在于，將PCB trace阻抗由100ohm調(diào)整到85ohm阻抗值去平衡各不連續(xù)點(diǎn)的阻抗值。
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G06F17-00 特別適用于特定功能的數(shù)字計(jì)算設(shè)備或數(shù)據(jù)處理設(shè)備或數(shù)據(jù)處理方法
G06F17-10 .復(fù)雜數(shù)學(xué)運(yùn)算的
G06F17-20 .處理自然語言數(shù)據(jù)的
G06F17-30 .信息檢索；及其數(shù)據(jù)庫結(jié)構(gòu)
G06F17-40 .數(shù)據(jù)的獲取和記錄
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