[發明專利]存儲器數組裝置有效
| 申請號: | 201610595298.4 | 申請日: | 2016-07-26 |
| 公開(公告)號: | CN107240410B | 公開(公告)日: | 2020-04-03 |
| 發明(設計)人: | 亞當沙爾·艾爾曼蘇里;亞卓安杰·崔斯勒;萊恩馬丁·霍夫斯特 | 申請(專利權)人: | 南亞科技股份有限公司 |
| 主分類號: | G11C5/06 | 分類號: | G11C5/06;G11C7/10 |
| 代理公司: | 深圳新創友知識產權代理有限公司 44223 | 代理人: | 江耀純 |
| 地址: | 中國臺*** | 國省代碼: | 臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 存儲器 數組 裝置 | ||
本發明公開了一種存儲器數組裝置包括多個數組區段及多個間隔單元,每一間隔單元是設置于所述數組區段中的兩個數組區段之間,且包括:本地寫入裝置,以根據接收到的寫入啟用信號及寫入數據信號來提供數據信號,所述數據信號用于對所述數組區段中的數組區段的特定存儲器組件進行寫入操作;本地傳感器,以于接收到啟動命令及讀取啟用信號時輸出數據信號;及控制邏輯,以提供所述寫入啟用信號及所述讀取啟用信號、提供所述寫入數據信號至所述本地寫入裝置、自所述本地傳感器接收所述數據信號,及對接收到的所述數據信號進行放大,以提供讀取數據信號至連接至輸出數據線。
技術領域
本發明涉及一種存儲器數組感測放大器(array sense amplifier),尤其是涉及其中的數組連接(array interconnection)以及存儲器數組裝置,所述存儲器數組感測放大器于多個數組區段(array section)之間設置有間隔單元(mini-gap),所述間隔單元是使用作為本地(local)傳感器,以于一數字線(digit line)進行偵測并且傳遞電荷,并且將電荷傳給一主要感測放大器或組件。
背景技術
感測放大器是集成電路(integrated circuits,IC)中不可或缺的組件,標準的存儲器數組裝置包括多個互相連接的字線以及數字線。儲存裝置(諸如電容器)是用來將電荷寫入存儲器數組的存儲器組件中,而存取裝置(諸如晶體管)是用來進行寫入操作以將電荷存入電容器中,并且進行讀取操作以讀取電容器中的電荷。
為了對一存儲器組件寫入數據,會先通過一存取裝置來啟動位于所述存儲器組件所在位置的一字線以及數字線,以對所述存儲器組件進行隔離。存取裝置會開啟足夠的時間以將特定準位的電荷(例如代表邏輯0或1的電荷)寫入儲存裝置。之后,為了讀取儲存裝置內的數據,存取裝置將被再度啟動,使得儲存裝置的電荷能夠傳送至數字線。由于數字線具有高電容值,儲存裝置內的電荷將導致數字線中的電壓只會有微幅的增加。接著,一感測放大器會用來感測兩條數字線之間的電位差,并且通過將其中一條數字線的電壓拉高至Vcc以及將另外一條數字線的電壓拉低至接地端電壓的方式來提供增大的輸出。
如上所述,存儲器數組需要一給定的區域以使感測放大器操作在規范的噪聲以及感測容許值內。本發明的目的在于公開一存儲器數組裝置,以于降低數字線對數字線噪聲(digit-line-to-digit-line noise)的同時提供精確的感測,并且降低感測放大器的整體面積。
發明內容
本發明的一實施例公開了一種存儲器數組裝置,包括有多個數組區段(arraysection)、多個間隔單元(mini-gap)以及至少一第一主要感測放大器。所述數組區段中每一數組區段包括多個存儲器組件,且所述間隔單元中每一間隔單元是設置于所述數組區段中的兩個數組區段之間且包括有一本地寫入裝置、一本地傳感器以及一控制邏輯。所述本地寫入裝置是用于根據接收到的一寫入啟用信號以及一寫入數據信號來提供一數據信號,其中所述數據信號用于對所述數組區段中的一數組區段的一特定存儲器組件進行寫入操作;所述本地傳感器是用于于接收到一啟動命令以及一讀取啟用信號時輸出一數據信號;所述控制邏輯是用于提供所述寫入啟用信號以及所述讀取啟用信號;所述至少一第一主要感測放大器是用于提供所述寫入數據信號至所述本地寫入裝置、自所述本地傳感器接收所述數據信號,以及對接收到的所述數據信號進行放大,以提供一讀取數據信號至連接至一外部存儲器的輸出數據路徑。
每一數組區段包括至少兩條數字線,以及與所述至少兩條數字線相交的多條字線。通過利用形成于所述相交的字線以及數字線的頂部的連接層,可減少用于連接所述間隔單元架構的布局(layout)區域。所述存儲器數組裝置還包括一第二主要感測放大器,所述第二主要感測放大器連接至所述第一主要感測放大器所連接的相同數字線。所述多任務器于所述至少兩條數字線之間進行選取,使得所述第一主要感測放大器以及所述第二主要感測放大器各自耦接至所述兩條數字線中不同的數字線。上述多任務連接方式使得所述第一主要感測放大器、第二主要感測放大器以及所述儲存單元之間的數字在線的一部分形成并聯的電阻路徑。
附圖說明
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