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[發明專利]一種陣列雷達回波模擬器及其模擬方法有效

專利信息
申請號: 201610190678.X 申請日: 2016-03-30
公開(公告)號: CN105676197B 公開(公告)日: 2018-03-06
發明(設計)人: 宋萬杰;梁雪妮;王強;李娜 申請(專利權)人: 西安電子科技大學
主分類號: G01S7/40 分類號: G01S7/40
代理公司: 西安睿通知識產權代理事務所(特殊普通合伙)61218 代理人: 惠文軒
地址: 710071*** 國省代碼: 陜西;61
權利要求書: 查看更多 說明書: 查看更多
摘要:
搜索關鍵詞: 一種 陣列 雷達 回波 模擬器 及其 模擬 方法
【說明書】:

技術領域

發明屬于雷達回波模擬技術領域,特別涉及一種陣列雷達回波模擬器及其模擬方法,適用于實際工程應用。

背景技術

隨著科學技術的快速發展,對雷達探測的要求也在不斷提高,現代雷達需要有更高的搜索速度、分辨率和抗干擾能力。傳統的雷達都采用機械掃描方式,不但成本高而且掃描時間久,為解決該弊端,開始研制電子掃描方式雷達,陣列雷達就是一種電子掃描方式雷達。它可以形成不同特性的波束,并且可以改變波束指向,通過控制天線的各個陣元的相位和幅度來完成的。其掃描時間短且易控制,并且如果使用陣面天線,其中的天線可以分組分別實現不同的功能,也就是一個雷達具有幾個雷達的功能。

研制雷達系統的過程中,信號處理機需要在不同的環境下,即在不同的干擾和噪聲等雜波下對回波信號進行處理,所以信號處理機性能的測試和驗證十分重要。以往該測試主要是在外場進行現場測試,由于天氣環境和所花費的人力和物力資源比較多,并且外界的環境對信號處理機的性能的測試也會產生很大的影響,容易造成誤差,導致真實環境中的測試存在不可避免的隱患,所以雷達回波模擬器的研制十分重要。使用模擬器模擬雷達在不同工作環境下的目標信號,該方法簡單,容易操作,得到廣泛推廣。隨著近年來陣列雷達的廣泛發展,對陣列雷達回波模擬器的需求也越來越高。

發明內容

針對上述現有技術存在的不足,本發明的目的在于提出一種陣列雷達回波模擬器及其模擬方法,該種陣列雷達回波模擬器及其模擬方法不僅能夠實時對陣列雷達回波信號進行接收和存儲,而且還能夠按需要實時回放陣列雷達回波信號,實現本發明目的。

為達到上述技術目的,本發明采用以下技術方案予以實現。

技術方案一:

一種陣列雷達回波模擬器,包括:主機板、接口板和存儲板;所述主機板與所述接口板連接;所述接口板與所述存儲板連接;

所述主機板用于獲取擦FLASH指令、寫FLASH指令和讀FLASH指令,并依次發送至接口板,同時實時接收并存儲接口板發送過來的陣列雷達回波信號;

所述接口板用于依次接收所述擦FLASH指令、寫FLASH指令和讀FLASH指令,并實時獲取陣列雷達回波信號;當所述接口板獲取陣列雷達回波信號后,所述接口板將所述擦FLASH指令、寫FLASH指令和讀FLASH指令操作各自對應的高電平分別轉換為低電平選通信號,獲得低電平擦FLASH選通信號、低電平寫FLASH選通信號和低電平讀FLASH選通信號,然后將所述陣列雷達回波信號轉化為N路緩存陣列雷達回波信號,并將所述N路緩存陣列雷達回波信號、低電平擦FLASH選通信號、低電平寫FLASH選通信號和低電平讀FLASH選通信號依次發送至所述存儲板;

所述存儲板用于實時接收并存儲所述N路緩存陣列雷達回波信號、低電平擦FLASH選通信號、低電平寫FLASH選通信號和低電平讀FLASH選通信號,然后根據所述低電平擦FLASH選通信號、低電平寫FLASH選通信號和低電平讀FLASH選通信號依次對所述N路緩存陣列雷達回波信號進行擦FLASH、寫FLASH和讀FLASH操作,依次獲得擦FLASH完成指令、寫FLASH完成指令和N路緩存FLASH陣列雷達回波信號,再將所述擦FLASH完成指令、寫FLASH完成指令和所述N路緩存FLASH陣列雷達回波信號發送至接口板,所述接口板實時接收所述擦FLASH完成指令、寫FLASH完成指令和所述N路緩存FLASH陣列雷達回波信號,且所述接口板實時接收并存儲N路緩存陣列雷達回波信號;其中,N為大于1的自然數;

所述接口板還用于實時接收所述擦FLASH完成指令、寫FLASH完成指令和N路緩存FLASH陣列雷達回波信號,并將所述N路緩存FLASH陣列雷達回波信號轉化為一路緩存陣列雷達回波信號,然后將所述一路緩存陣列雷達回波信號發送至主機板;所述接口板還將對所述一路緩存陣列雷達回波信號進行緩存和提速,獲得提速后的緩存陣列雷達回波信號,然后對所述提速后的緩存陣列雷達回波信號分別添加目標信號,并將添加目標信號的提速陣列雷達回波信號發送至外接設備進行陣列雷達回波信號的性能檢測。

技術方案一的特點和進一步改進在于:

(一)所述主機板包括:CPU處理器、第一通信模塊、固態存儲器;所述CPU處理器分別與所述固態存儲器和所述第一通信模塊連接;所述固態存儲器與所述第一通信模塊連接;

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