[發明專利]像素驅動電路有效
| 申請號: | 201610061785.2 | 申請日: | 2016-01-28 |
| 公開(公告)號: | CN105609077B | 公開(公告)日: | 2018-03-30 |
| 發明(設計)人: | 徐向陽 | 申請(專利權)人: | 深圳市華星光電技術有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36 |
| 代理公司: | 深圳市德力知識產權代理事務所44265 | 代理人: | 林才桂 |
| 地址: | 518132 廣東*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 像素 驅動 電路 | ||
1.一種像素驅動電路,其特征在于,包括:呈陣列式排布的多個像素單元(5)、自上而下對應第n行像素單元(5)設置的沿水平方向延伸的第n條主柵極掃描線(G(n))、自上而下對應第n行像素單元(5)設置的沿水平方向延伸的第n條電荷共享柵極掃描線(GS(n))、及自左至右對應第m列像素單元(5)設置的沿豎直方向延伸的第m條數據線(D(m)),n與m均為正整數;
每一像素單元(5)均包括第一薄膜晶體管(T1)、第二薄膜晶體管(T2)、第三薄膜晶體管(T3)、主區像素電極(51)、次區像素電極(52)、及電荷共享電容(C1);對于第n行第m列像素單元(5),所述第一薄膜晶體管(T1)的柵極電性連接第n條主柵極掃描線(G(n))、源極電性連接第m條數據線(D(m))、漏極電性連接主區像素電極(51),所述第二薄膜晶體管(T2)的柵極電性連接第n條主柵極掃描線(G(n))、源極電性連接第m條數據線(D(m))、漏極電性連接次區像素電極(52),所述第三薄膜晶體管(T3)的柵極電性連接第n條電荷共享柵極掃描線(GS(n))、源極電性連接次區像素電極(52)、漏極電性連接電荷共享電容(C1)的一端,電荷共享電容(C1)的另一端接入公共電壓(Com);
第n條主柵極掃描線(G(n))傳輸第n條主柵極掃描脈沖信號,第n條電荷共享柵極掃描線(GS(n))傳輸第n條電荷共享柵極掃描脈沖信號,所述第n條主柵極掃描脈沖信號比第n條電荷共享柵極掃描脈沖信號提前一個脈沖寬度;
所述的像素驅動電路還包括:第一GOA驅動模塊(6)和第二GOA驅動模塊(7),所述第一GOA驅動模塊(6)與所有的主柵極掃描線電性連接,向主柵極掃描線提供主柵極掃描脈沖信號,第二GOA驅動模塊(7)與所有的電荷共享柵極掃描線電性連接,向電荷共享柵極掃描線提供電荷共享柵極掃描脈沖信號;
所述第一GOA驅動模塊(6)與第二GOA驅動模塊(7)同時進行正向掃描驅動或同時進行反向掃描驅動;所述第一GOA驅動模塊(6)先于第二GOA驅動模塊(7)一個脈沖寬度進行驅動。
2.如權利要求1所述的像素驅動電路,其特征在于,通過向第一GOA驅動模塊(6)輸入第一掃描啟動信號(STV1)開始主柵極掃描線的逐條掃描;通過向第二GOA驅動模塊(7)輸入第二掃描啟動信號(STV2)開始電荷共享柵極掃描線的逐條掃描;所述第一掃描啟動信號(STV1)比第二掃描啟動信號(STV2)提前一個脈沖寬度。
3.如權利要求1所述的像素驅動電路,其特征在于,所述第一GOA驅動模塊(6)與第二GOA驅動模塊(7)同時進行正向掃描驅動時,第一GOA驅動模塊(6)按第一條至最后一條的次序提供主柵極掃描脈沖信號,主柵極掃描線按第一條至最后一條的次序自上而下逐條傳輸主柵極掃描脈沖信號,第二GOA驅動模塊(7)按第一條至最后一條的次序提供電荷共享柵極掃描脈沖信號,電荷共享柵極掃描線按第一條至最后一條的次序自上而下逐條傳輸電荷共享柵極掃描脈沖信號。
4.如權利要求1所述的像素驅動電路,其特征在于,所述第一GOA驅動模塊(6)與第二GOA驅動模塊(7)同時進行反向掃描驅動時,第一GOA驅動模塊(6)按最后一條至第一條的次序提供主柵極掃描脈沖信號,主柵極掃描線按最后一條至第一條的次序自下而上逐條傳輸主柵極掃描脈沖信號,第二GOA驅動模塊(7)按最后一條至第一條的次序提供電荷共享柵極掃描脈沖信號,電荷共享柵極掃描線按最后一條至第一條的次序自下而上逐條傳輸電荷共享柵極掃描脈沖信號。
5.如權利要求1所述的像素驅動電路,其特征在于,所述主區像素電極(51)與次區像素電極(52)均為“米”字型結構,材料均為ITO。
6.如權利要求1所述的像素驅動電路,其特征在于,所述主柵極掃描脈沖信號與電荷共享柵極掃描脈沖信號的脈沖寬度相等。
7.如權利要求1所述的像素驅動電路,其特征在于,所述第一GOA驅動模塊(6)與第二GOA驅動模塊(7)分別設于所述呈陣列式排布的多個像素單元(5)的左右兩邊。
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