[發明專利]一種基于柵極驅動電路及其液晶顯示器有效
| 申請號: | 201610058675.0 | 申請日: | 2016-01-28 |
| 公開(公告)號: | CN105609076B | 公開(公告)日: | 2017-09-15 |
| 發明(設計)人: | 趙莽 | 申請(專利權)人: | 武漢華星光電技術有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36 |
| 代理公司: | 深圳市威世博知識產權代理事務所(普通合伙)44280 | 代理人: | 李慶波 |
| 地址: | 430070 湖北省武漢市*** | 國省代碼: | 湖北;42 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 基于 柵極 驅動 電路 及其 液晶顯示器 | ||
技術領域
本發明涉及顯示技術領域,特別是涉及一種柵極驅動電路及其液晶顯示器。
背景技術
Gate Driver On Array,簡稱GOA,也就是利用現有薄膜晶體管液晶顯示器Array制程將Gate行掃描驅動信號電路制作在Array基板上,實現對Gate逐行掃描的驅動方式的一項技術。
隨著低溫多晶硅(LTPS)半導體薄膜晶體管的發展,而且由于LTPS半導體本身超高載流子遷移率的特性,相應的面板周邊集成電路也成為大家關注的焦點,并且很多人投入到System on Panel(SOP)的相關技術研究,并逐步成為現實。
一般LTPS工藝中普遍采用的CMOS GOA功能的模塊設計,其中包括了:Latch鎖存器單元,用于級傳信號的鎖存,是GOA電路設計的核心部分,主要由兩個時鐘控制反相器和兩個反相器組成;與非門信號處理單元,通過CK控制信號線與鎖存的數據進行與非處理,用于產生本級的控制端驅動信號;CMOS電路的輸出Buffer,用于增加控制端驅動信號的驅動能力,減小傳輸信號的RC Loading。
對于時鐘控制反相器和與非門,我們定義靠近VGH和VGL的晶體管為第一晶體管,靠近輸出端的晶體管為第二晶體管。
上述兩個模塊的電路連接方式較為單一,其中第一和第二晶體管在長時間工作的過程中需要承受的Stress程度不一樣,因此第一和第二晶體管的變異程度也不一樣。這種晶體管的不均勻性可能會導致信號鎖存的變異以及與非門邏輯的錯誤,嚴重時會影響電路的正常工作,造成整個電路的失效。
發明內容
本發明主要解決的技術問題是提供一種柵極驅動電路及其液晶顯示器,能夠有效提高電路設計的均勻性以及電路工作的穩定性。
為解決上述技術問題,本發明采用的一個技術方案是:提供一種柵極驅動電路,包括:輸入與鎖存電路、電性連接輸入與鎖存電路的信號處理電路以及電性連接信號處理電路的輸出緩沖電路;
輸入與鎖存電路根據上級掃描驅動信號、第一時鐘信號以及與第一時鐘信號反相的第二時鐘信號輸出第一控制信號,信號處理電路根據第一控制信號以及第三時鐘信號輸出第二控制信號,輸出緩沖電路根據第二控制信號輸出本級掃描驅動信號;
其中,輸入與鎖存電路或信號處理電路包括并聯設置的兩個開關組件,其中每一開關組件分別包括串聯設置的兩個開關管,兩個開關組件的一開關組件的兩個開關管的控制端與兩個開關組件的另一開關組件的兩個開關管的控制端交叉連接。
其中,輸入與鎖存電路包括:第一時鐘控制反相器、第二時鐘控制反相器以及第一反相器,第一時鐘控制反相器的正相控制端接入第一時鐘信號,第一時鐘控制反相器的反相控制端接入第二時鐘信號,第一時鐘控制反相器的輸入端接入上級掃描驅動信號,第一時鐘控制反相器的輸出端連接第二時鐘控制反相器的輸出端,第二時鐘控制反相器的正相控制端接入第二時鐘信號,第二時鐘控制反相器的反相控制端接入第一時鐘信號,第一反相器的輸入端連接第一時鐘控制反相器的輸出端和第二時鐘控制反相器的輸出端,第一反相器的輸出端連接第二時鐘控制反相器的輸入端,并輸出第一控制信號,其中第一時鐘控制反相器和第二時鐘控制反相器的至少一個內設置有連接于第一時鐘控制反相器和第二時鐘控制反相器的至少一個的輸出端與參考電位之間的兩個開關組件。
其中,第一時鐘控制反相器包括第一P型開關管、第二P型開關管、第三P型開關管、第四P型開關管、第一N型開關管、第二N型開關管、第三N型開關管以及第四N型開關管;
第一P型開關管控制端與第四P型開關管的控制端相連接,并接入第二時鐘信號,第二P型開關管的控制端和第三P型開關管的控制端相連接,并接入上級掃描驅動信號,第一P型開關管的第一傳輸端和第三P型開關管的第一傳輸端接入高參考電位,第二P型開關管的第一傳輸端與第一P型開關管的第二傳輸端相連接,第四P型開關管的第一傳輸端和第三P型開關管的第二傳輸端相連接,第二P型開關管的第二傳輸端和第四P型開關管的第二傳輸端連接第一時鐘控制反相器的輸出端;
第一N型開關管的控制端與第四N型開關管的控制端相連接,并接入上級掃描驅動信號,第二N型開關管和第三N型開關管的控制端相連接,并接入第一時鐘信號,第二N型開關管的第一傳輸端和第四N型開關管的第一傳輸端接入低參考電位,第一N型開關管的第一傳輸端與第二N型開關管的第二傳輸端相連接,第三N型開關管的第一傳輸端與第四N型開關管的第二傳輸端相連接,第一N型開關管的第二傳輸端和第三N型開關管的第二傳輸端連接第一時鐘控制反相器的輸出端。
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