[實用新型]一種雷達數據處理系統有效
| 申請號： | 201520163180.5 | 申請日： | 2015-03-23 |
| 公開（公告）號： | CN204462379U | 公開（公告）日： | 2015-07-08 |
| 發明（設計）人： | 王雪萍 | 申請（專利權）人： | 北京潤科通用技術有限公司 |
| 主分類號： | G01S7/40 | 分類號： | G01S7/40;G01S7/41 |
| 代理公司： | 北京集佳知識產權代理有限公司 11227 | 代理人： | 王寶筠 |
| 地址： | 100192 北京市海淀區西*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 雷達 數據處理系統 | ||
1.一種雷達數據處理系統，其特征在于，包括：
發送高程數據的上位機；
與所述上位機連接的，進行遮擋計算以得出遮擋數據的第一DSP；
分別與所述上位機和所述第一DSP連接，將所述第一DSP得出的遮擋數據進行外傳的第二DSP；
其中，所述第一DSP和所述第二DSP均為多核DSP，所述第一DSP的處理核數量多于第二DSP的處理核數量。
2.根據權利要求1所述的雷達數據處理系統，其特征在于，所述第二DSP包括：一個主核和一個從核；
所述第一DSP包括：一個主核和多個從核，所述第一DSP的一個主核和多個從核并行進行遮擋計算以得出遮擋數據。
3.根據權利要求2所述的雷達數據處理系統，其特征在于，所述第一DSP和所述第二DSP通過Hyperlink接口連接。
4.根據權利要求1所述的雷達數據處理系統，其特征在于，所述上位機分別與所述第一DSP和第二DSP采用PCIE總線連接。
5.根據權利要求1所述的雷達數據處理系統，其特征在于，還包括：
與所述第二DSP連接的FPGA；
與所述第一DSP連接，存儲第一DSP存放的數據的第一DDR；
與所述第二DSP連接，存儲第二DSP存放的數據的第二DDR。
6.根據權利要求5所述的雷達數據處理系統，其特征在于，所述第一DDR和第二DDR的內存均為2G。
7.根據權利要求5所述的雷達數據處理系統，其特征在于，所述第二DSP與所述FPGA通過高速串行數據訪問RapidIO接口連接。
8.根據權利要求1-7任一所述的雷達數據處理系統，其特征在于，所述第一DSP的處理核數量為8個。
9.根據權利要求8所述的雷達數據處理系統，其特征在于，所述第一DSP的共享內存為4M，各處理核的內存為512K。
10.根據權利要求1或9所述的雷達數據處理系統，其特征在于，所述第二DSP的內存為256M。
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