[發明專利]一種實現軟關機后關閉系統電源的裝置和方法在審
| 申請號: | 201510533606.6 | 申請日: | 2015-08-27 |
| 公開(公告)號: | CN105183509A | 公開(公告)日: | 2015-12-23 |
| 發明(設計)人: | 劉強;金長新;于治樓 | 申請(專利權)人: | 浪潮集團有限公司 |
| 主分類號: | G06F9/445 | 分類號: | G06F9/445;G06F1/26 |
| 代理公司: | 濟南信達專利事務所有限公司 37100 | 代理人: | 姜明 |
| 地址: | 250101 山東*** | 國省代碼: | 山東;37 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 實現 關機 關閉 系統 電源 裝置 方法 | ||
技術領域
本發明涉及計算機關機技術,具體的說是一種實現軟關機后關閉系統電源的裝置和方法。
背景技術
隨著國產芯片研發能力的提升,國產處理器的種類與性能日益增加,已經開始在服務器產品中應用。目前國產處理器種類繁多,適用于服務器領域的國產處理器,大多沒有專用橋片配合,而是采用PCIESWITCH擴展其連接外設的能力。比如飛騰處理器等都是沒有南橋與CPU連接的,CPU的外設主要靠PCIESWITCH進行擴展,而南橋的一些類似休眠等信號在PCIESWITCH上是沒有的,這樣相對比X86平臺,為了實現X86服務器的一些功能,即很多橋片所實現的功能,在國產處理器平臺上需要采用其他方法實現。
傳統X86服務器系統中,南橋本身設計有待機休眠及關機等狀態的指示信號,當系統處于待機或者休眠、關機狀態時,對應信號電平會發生變化,根據這個信號狀態變化來判斷系統所處狀態,進而控制系統電源。
發明內容
本發明針對目前需求以及現有技術發展的不足之處,提供一種在國產處理器服務器系統中實現軟關機后關閉系統電源的裝置和方法。
本發明所述一種實現軟關機后關閉系統電源的裝置和方法,解決上述技術問題采用的技術方案如下:所述實現軟關機后關閉系統電源的裝置,主要包括國產CPU、可編程邏輯器件、系統電源電路和CPU外設,其中,所述國產CPU通過GPIO連接到可編程邏輯器件上,所述可編程邏輯器件與所述系統電源電路連接通信,同時,所述可編程邏輯器件與CPU外設連接通信。
優選的,所述可編程邏輯器件向系統電源電路發送控制信號,同時所述系統電源電路向可編程邏輯器件發送反饋信號。
優選的,所述可編程邏輯器件通過復位信號連接CPU外設。
本發明所述軟關機后關閉系統電源的方法,通過國產CPU的GPIO配合可編程邏輯器件,將GPIO連接到可編程邏輯器件上,可編程邏輯器件根據外部CPU的GPIO狀態及其他狀態,對整個系統的電源和復位進行控制;操作系統下進行軟關機時,可編程邏輯器件根據CPU的斷電時序,控制電源使能引腳,關閉系統電源。
本發明所述一種實現軟關機后關閉系統電源的裝置和方法,與現有技術相比具有的有益效果是:本發明選擇通用GPIO來作為判斷手段,將GPIO連接到可編程邏輯器件上,可編程邏輯器件根據外部處理器的GPIO狀態及其他狀態對整個系統的電源和復位等進行控制,實現系統軟關機時關閉整機電源;并且,本發明構思新穎、設計巧妙、實現簡單,功耗較低,因此具有較好的推廣使用價值。
附圖說明
附圖1為所述實現軟關機后關閉系統電源的裝置的原理框圖;
附圖2為所述實現軟關機后關閉系統電源的方法的實施框圖。
具體實施方式
為使本發明的目的、技術方案和優點更加清楚明白,以下結合具體實施例,并參照附圖,對本發明所述一種實現軟關機后關閉系統電源的裝置和方法進一步詳細說明。
在不采用南橋的國產處理器系統中,因沒有專用芯片引腳來標識系統狀態,本發明所述裝置和方法,在不采用南橋芯片的國產處理器服務器系統中,選擇通用GPIO來作為判斷手段,通過國產處理器的GPIO配合可編程邏輯器件,將GPIO連接到可編程邏輯器件上,可編程邏輯器件根據外部處理器的GPIO狀態及其他狀態,對整個系統的電源和復位等進行控制,實現操作系統下關機后關閉系統電源。
實施例:
本實施例所述一種實現軟關機后關閉系統電源的裝置,其整體架構如附圖1所示,該裝置主要包括國產CPU、可編程邏輯器件、系統電源電路和CPU外設,其中,所述國產CPU通過GPIO連接到可編程邏輯器件上,所述可編程邏輯器件與所述系統電源電路連接通信,同時,所述可編程邏輯器件與CPU外設連接通信。
所述GPIO(GeneralPurposeInputOutput,通用輸入/輸出),也稱為總線擴展器,利用工業標準I2C、SMBus或SPI接口簡化了I/O口的擴展。當微控制器或芯片組沒有足夠的I/O端口,或當系統需要采用遠端串行通信或控制時,GPIO能夠提供額外的控制和監視功能。
本實施例所述實現軟關機后關閉系統電源的裝置中,所述可編程邏輯器件,適用于統一控制服務器系統的電源時序和復位時序;所述可編程邏輯器件通過復位信號連接CPU外設;所述可編程邏輯器件向系統電源電路發送控制信號,同時所述系統電源電路向可編程邏輯器件發送反饋信號。
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