[發明專利]顯示面板及顯示裝置有效
| 申請號: | 201510379531.0 | 申請日: | 2015-07-01 |
| 公開(公告)號: | CN104934005B | 公開(公告)日: | 2017-05-17 |
| 發明(設計)人: | 姚星;林家強;張玉婷;張慧 | 申請(專利權)人: | 京東方科技集團股份有限公司 |
| 主分類號: | G09G3/36 | 分類號: | G09G3/36 |
| 代理公司: | 北京天昊聯合知識產權代理有限公司11112 | 代理人: | 柴亮,張天舒 |
| 地址: | 100015 *** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 顯示 面板 顯示裝置 | ||
技術領域
本發明屬于顯示技術領域,具體涉及一種顯示面板及顯示裝置。
背景技術
TFT-LCD(Thin Film Transistor-Liquid Crystal Display,薄膜晶體管液晶顯示裝置)實現一幀畫面顯示的基本原理是通過柵極(gate)驅動從上到下依次對每一行像素輸入一定寬度的方波進行選通,再通過源極(source)驅動每一行像素所需的信號依次從上往下輸出。目前制造這樣一種結構的顯示器件通常是柵極驅動電路和源極驅動電路通過COF(Chip On Film,覆晶薄膜)或COG(Chip On Glass,芯片直接固定在玻璃上)工藝制作在玻璃面板上的,但是當分辨率較高時,柵極驅動電路和源極驅動電路的輸出均較多,驅動電路的長度也將增大,這將不利于模組驅動電路的壓焊(Bonding)工藝。
為了克服以上問題,現有顯示器件的制造采用GOA(Gate Drive On Array)電路的設計,相比現有的COF或COG工藝,其不僅節約了成本,而且可以做到面板兩邊對稱的美觀設計,同時也可省去柵極驅動電路的Bonding區域以及外圍布線空間,從而實現了顯示裝置窄邊框的設計,提高了顯示裝置的產能和良率。但是伴隨著顯示面板的分辨率和尺寸的增加,每個GOA的負載也隨之增大,也就是說GOA電路中的每個移位寄存器的薄膜晶體管(TFT)的尺寸也越大,因此導致像素的充電越難,相應的顯示面板的邊框越寬。
發明內容
本發明所要解決的技術問題包括,針對現有的顯示面板存在上述的問題,提供一種邊框較窄、顯示效果均一的顯示面板及顯示裝置。
解決本發明技術問題所采用的技術方案是一種顯示面板,包括顯示區域和周邊區域,所述顯示區域包括交叉設置的多條柵線和多條數據線,所述柵線和所述數據線交叉限定出多個像素單元,其中,至少一條所述柵線包括斷開設置的至少兩個柵線段,每一個所述柵線段對應控制至少一個像素單元,所述顯示區域按照所述柵線段的斷開位置分為至少兩個子顯示區域,至少一個所述子顯示區域中設置有與所述柵線段連接的移位寄存器單元,所述移位寄存器單元用于為與其連接的所述柵線段提供柵極掃描信號。
優選的是,每條所述柵線均包括斷開設置的至少兩個柵線段,且位于同一行的所述柵線段至少與一個所述移位寄存器單元連接。
進一步優選的是,各行所述柵線中的柵線段的斷開位置相同,位于同一子顯示區域中的每個所述柵線段分別連接不同的移位寄存器單元,且驅動同一子顯示區域中所述柵線段的各個所述移位寄存器單元級聯在一起。
更進一步優選的是,每一行所述柵線中的各個所述柵線段均連接單獨的移位寄存器單元,且位于同一子顯示區域中的各個所述移位寄存器單元級聯在一起。
更進一步優選的是,所述顯示區域包括三個子顯示區域,每一所述柵線分為三個柵線段,每一所述子顯示區域包括所有柵線的同一柵線段。
進一步優選的是,每條所述柵線包括長度相同的多個柵線段,位于同一子顯示區域的所述柵線段分別連接不同的移位寄存器單元,且位于同一子顯示區域的所述移位寄存器單元級聯在一起。
優選的是,所述移位寄存器單元連接多條信號線,所述信號線與所述數據線平行設置。
優選的是,所述移位寄存器單元包括9個開關單元和一個存儲電容,所述柵線段對應控制9個像素單元,每一所述像素單元設置有一個開關單元,所述存儲電容設置在其中一像素單元內。
進一步優選的是,所述9個開關單元為對應的第一晶體管至第九晶體管;其中,
所述第一晶體管的第一極連接其控制極和信號輸入端,第二極連接存儲電容的第一端;
所述第二晶體管的第一極連接第一晶體管的第二極,第二極連接低電源端,控制極連接復位信號端;
所述第三晶體管的第一極連接時鐘信號輸入端,第二極連接存儲電容的第二端和信號輸出端,控制極連接存儲電容的第一端;
所述第四晶體管的第一極連接存儲電容的第二端和信號輸出端,第二極連接低電源端,控制極連接第五晶體管的第二極;
所述第五晶體管的第一極連接高電壓端,第二極連接第六晶體管和第七晶體管的第一極,控制極連接第九晶體管的第二極;
所述第六晶體管的第一極連接第四晶體管的控制極,第二極連接低電源端,控制極連接存儲電容的第一端;
所述第七晶體管的第一極連接第四晶體管的控制極,第二極連接低電源端,控制極連接存儲電容的第一端;
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