[發(fā)明專利]一種采樣電壓求和的相位插值型時鐘恢復(fù)電路有效
| 申請?zhí)枺?/td> | 201510021777.0 | 申請日： | 2015-01-15 |
| 公開（公告）號： | CN104506170B | 公開（公告）日： | 2017-08-11 |
| 發(fā)明（設(shè)計）人： | 覃林;黃魯 | 申請（專利權(quán)）人： | 中國科學(xué)技術(shù)大學(xué)先進(jìn)技術(shù)研究院 |
| 主分類號： | H03K5/135 | 分類號： | H03K5/135 |
| 代理公司： | 合肥市長遠(yuǎn)專利代理事務(wù)所(普通合伙)34119 | 代理人： | 程篤慶,黃樂瑜 |
| 地址： | 230088 安徽*** | 國省代碼： | 安徽;34 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 采樣 電壓 求和 相位 插值型 時鐘 恢復(fù) 電路 | ||
1.一種采樣電壓求和的相位插值型時鐘恢復(fù)電路，其特征在于，包括：CLKI輸入端、CLKQ輸入端、第一上升沿采樣保持電路(1)、第一下降沿采樣保持電路(2)、第二上升沿采樣保持電路(3)、第二下降沿采樣保持電路(4)、第一求和電路(5)、第二求和電路(6)和相位插值電路(7)；
CLKI輸入端分別連接至第一上升沿采樣保持電路(1)、第一下降沿采樣保持電路(2)和相位插值電路(7)；第一上升沿采樣保持電路(1)和第一下降沿采樣保持電路(2)均連接至第一求和電路(5)輸入端，第一求和電路(5)輸出端連接至相位插值電路(7)；
CLKQ輸入端分別連接至第二上升沿采樣保持電路(3)、第二下降沿采樣保持電路(4)和相位插值電路(7)；第二上升沿采樣保持電路(3)和第二下降沿采樣保持電路(4)均連接至第二求和電路(6)輸入端，第二求和電路(6)輸出端連接至相位插值電路(7)；
第一上升沿采樣保持電路(1)、第一下降沿采樣保持電路(2)、第二上升沿采樣保持電路(3)、第二下降沿采樣保持電路(4)均接收輸入數(shù)據(jù)Data作為觸發(fā)信號；
當(dāng)輸入數(shù)據(jù)Data上升沿時，第一上升沿采樣保持電路(1)采樣并保持CLKI信號電壓并傳遞給第一求和電路(5)，第二上升沿采樣保持電路(3)采樣并保持CLKQ信號電壓并傳遞給第二求和電路(6)；當(dāng)輸入數(shù)據(jù)Data下降沿時，第一下降沿采樣保持電路(2)采樣并保持CLKI信號電壓并傳遞給第一求和電路(5)，第二下降沿采樣保持電路(4)采樣并保持CLKQ信號電壓并傳遞給第二求和電路(6)；第一求和電路(5)和第二求和電路(6)對采樣電壓進(jìn)行加法運(yùn)算后將信號傳遞給相位插值電路(7)，相位插值電路(7)通過運(yùn)算輸出相應(yīng)的時鐘Rec_Clk_ana；
所述的采樣電壓求和的相位插值型時鐘恢復(fù)電路的工作原理為：設(shè)Δt為時鐘抖動引入的時間誤差，N表示連續(xù)0或連續(xù)1的個數(shù)，T表示時鐘周期；輸入數(shù)據(jù)在上升沿to時刻、下降沿to+Δt+N*T時刻分別觸發(fā)第一上升沿采樣保持電路(1)和第二上升沿采樣保持電路(3)、第一下降沿采樣保持電路(2)和第二下降沿采樣保持電路(4)，采樣正交時鐘電壓CLKI和CLKQ，分別得到采樣電壓α和β，其中：
α＝sin(2πfto)+sin[2πf(to+N*T+Δt)]＝sin(2πfto)+sin[2πf(to+Δt)]
β＝cos(2πfto)+cos[2πf(to+N*T+Δt)]＝cos(2πfto)+cos[2πf(to+Δt)]，
α和β信號在相位插值電路PI中實現(xiàn)乘積運(yùn)算，得到：
2.如權(quán)利要求1所述的采樣電壓求和的相位插值型時鐘恢復(fù)電路，其特征在于，輸入數(shù)據(jù)Data為差分對輸入數(shù)據(jù)Data+和Data-，Data+和Data-觸發(fā)第一上升沿采樣保持電路(1)、第一下降沿采樣保持電路(2)、第二上升沿采樣保持電路(3)和第二下降沿采樣保持電路(4)對正交時鐘CLKI、CLKQ進(jìn)行采樣并輸出采樣電壓到第一求和電路(5)和第二求和電路(6)，第一求和電路(5)和第二求和電路(6)對數(shù)據(jù)上下邊沿采樣電壓進(jìn)行相加并輸出結(jié)果到相位插值電路(7)與正交時鐘CLKI、CLKQ進(jìn)行相乘運(yùn)算，獲得輸出恢復(fù)時鐘信號Rec_CLK_ana。
3.如權(quán)利要求1或2所述的采樣電壓求和的相位插值型時鐘恢復(fù)電路，其特征在于，第一求和電路(5)和第二求和電路(6)均包括輸入端In_rise+、輸入端In_rise-、輸入端In_fall+、輸入端In_fall-和輸出端；
第一求和電路(5)通過其輸入端In_rise+、輸入端In_rise-連接第一上升沿采樣保持電路(1)，通過其輸入端In_fall+、輸入端In_fall-連接第一下降沿采樣保持電路(2)，并通過其輸出端連接相位插值電路(7)；
第二求和電路(6)通過其輸入端In_rise+、輸入端In_rise-連接第二上升沿采樣保持電路(3)，通過其輸入端In_fall+、輸入端In_fall-連接第二下降沿采樣保持電路(4)，并通過其輸出端連接相位插值電路(7)。
4.如權(quán)利要求3所述的采樣電壓求和的相位插值型時鐘恢復(fù)電路，其特征在于，第一上升沿采樣保持電路(1)和第二上升沿采樣保持電路(3)電路結(jié)構(gòu)相同；第一下降沿采樣保持電路(2)和第二下降沿采樣保持電路(4)電路結(jié)構(gòu)相同。
5.如權(quán)利要求4所述的采樣電壓求和的相位插值型時鐘恢復(fù)電路，其特征在于，第一求和電路(5)和第二求和電路(6)采用相同的電路結(jié)構(gòu)。
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