[發明專利]一種曲線擬合電路、模擬預失真器和射頻信號發射機有效
| 申請號: | 201480024986.4 | 申請日: | 2014-10-31 |
| 公開(公告)號: | CN105745641B | 公開(公告)日: | 2019-02-19 |
| 發明(設計)人: | 黃偉 | 申請(專利權)人: | 華為技術有限公司 |
| 主分類號: | G06F17/10 | 分類號: | G06F17/10 |
| 代理公司: | 北京同達信恒知識產權代理有限公司 11291 | 代理人: | 馮艷蓮 |
| 地址: | 518129 廣東*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 曲線擬合 電路 模擬 失真 射頻 信號 發射機 | ||
1.一種曲線擬合電路,其特征在于,包括n個分段處理電路和q個第一加法電路;n大于或等于2;q為自然數;
每個分段處理電路,接收輸入信號,并按照預設規則截取所述輸入信號中的一部分,以及根據截取的部分生成待處理信號,并采用多項式擬合的方法根據所述待處理信號生成q個輸出信號;其中,不同分段處理電路截取的部分不完全相同;
每個第一加法電路,接收各個分段處理電路的q個輸出信號中的一個信號,并根據接收到的n個信號之和得到所述曲線擬合電路的一個輸出信號;其中,不同第一加法電路接收同一個分段處理電路的q個輸出信號中的不同輸出信號。
2.如權利要求1所述的曲線擬合電路,其特征在于,所述每個第一加法電路,具體用于:
接收各個分段處理電路輸出的q個輸出信號中的一個信號;并在每個分段處理電路的q個輸出信號中均不包括常數項時,將接收到的n個信號之和加上常數項作為所述曲線擬合電路的一個輸出信號;以及至少一個分段處理電路的q個輸出信號中包括常數項時,將接收到的n個信號之和作為所述曲線擬合電路的一個輸出信號。
3.如權利要求1所述的曲線擬合電路,其特征在于,每個分段處理電路具體用于:
接收輸入信號,并根據所述輸入信號的幅值和該分段處理電路的幅值預設范圍確定截取的部分,以及根據截取的部分生成待處理信號,并采用多項式擬合的方法根據所述待處理信號生成q個輸出信號。
4.如權利要求1所述的曲線擬合電路,其特征在于,每個分段處理電路具體用于:
接收輸入信號,并截取所述輸入信號曲線上兩點之間的部分,以及根據截取的部分生成待處理信號,并采用多項式擬合的方法根據所述待處理信號生成q個輸出信號。
5.如權利要求4所述的電路,其特征在于,每個分段處理電路包括限幅電路、多項式運算電路和加權電路;
所述限幅電路,接收輸入信號,并在所述輸入信號的幅值在所述限幅電路所在的分段處理電路的幅值預設范圍內時,生成幅值隨著所述輸入信號的幅值單調變化的待處理信號并輸出;并在所述輸入信號的幅值小于所述幅值預設范圍的最小值時,輸出第一預設值;以及在所述輸入信號的幅值大于所述幅值預設范圍的最大值時,輸出第二預設值;其中,所述第一預設值等于所述輸入信號的幅值為所述幅值預設范圍的最小值時生成的待處理信號的幅值,所述第二預設值等于所述輸入信號的幅值為所述幅值預設范圍的最大值時生成的待處理信號的幅值;
所述多項式運算電路,根據所述限幅電路輸出的待處理信號的幅值生成階數不高于預設階數的各階計算項的值;
所述加權電路,接收各階計算項的值,并根據加權系數中的各階計算項的系數與所述各階計算項的值生成所述分段處理電路的輸出信號。
6.如權利要求5所述的電路,其特征在于,所述限幅電路包括預調整電路和限幅放大器電路;
所述預調整電路,接收輸入信號,并將所述輸入信號放大和/或對所述輸入信號進行偏移調整后輸出;
所述限幅放大器電路,接收所述預調整電路輸出的信號,并在所述預調整電路輸出的信號的幅值在所述限幅放大器電路的限幅范圍內時,生成幅值隨著所述預調整電路輸出的信號的幅值單調變化的待處理信號并輸出;并在所述預調整電路輸出的信號的幅值小于所述限幅放大器電路的限幅范圍的最小值時,輸出所述第一預設值;以及在所述預調整電路輸出的信號的幅值大于所述限幅放大器電路的限幅范圍的最大值時,輸出所述第二預設值;
其中,所述限幅放大器電路的限幅范圍與所述限幅放大器電路所在的分段處理電路的幅值預設范圍之間的對應關系,與所述預調整電路接收到的輸入信號與所述預調整電路輸出的信號之間的對應關系相同。
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