[實用新型]帶隙基準源有效
| 申請號: | 201420388000.9 | 申請日: | 2014-07-14 |
| 公開(公告)號: | CN203965990U | 公開(公告)日: | 2014-11-26 |
| 發明(設計)人: | 周磊 | 申請(專利權)人: | 衢州市沃思電子技術有限公司 |
| 主分類號: | G05F3/26 | 分類號: | G05F3/26 |
| 代理公司: | 北京市清華源律師事務所 11441 | 代理人: | 李贊堅 |
| 地址: | 324000 浙江省*** | 國省代碼: | 浙江;33 |
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| 摘要: | |||
| 搜索關鍵詞: | 基準 | ||
技術領域
本實用新型涉及集成電路設計技術,尤其涉及集成電路的基準源及其附屬電路。
背景技術
基準源廣泛應用于各種模擬集成電路、數模混合信號集成電路和系統集成芯片中,其精度和穩定性直接決定整個系統的精度。在模/數轉換器(ADC)、數/模轉換器(DAC)、動態存儲器(DRAM)等集成電路設計中,低溫度系數、高電源抑制比(PSRR)的基準源設計十分關鍵。帶隙基準源就是一種較為穩定的基準源,它將負溫度系數的電壓與正溫度系數的電壓加權相加,由此抵消溫度對輸出電壓的影響。
傳統的帶隙基準源需要采用運算放大器形成的反饋環路實現電壓基準源的穩定輸出,由于運算放大器自身帶寬、增益的限制,使得電源電壓的波動在一定帶寬范圍內(尤其時中頻段)無法得到很好的抑制,由此影響基準電壓源的輸出信號質量。此外,傳統的帶隙基準電路中,輸出電壓VBE約為1.25V,這就限制了電源電壓在1V以下的應用。隨后改進的增強型帶隙基準源電路結構,采用前置電壓源單獨給帶隙基準源供電,使得電源電壓抑制比得到一定的提高,但是改進之后的電路結構,增加了靜態功耗與芯片面積。
此外,現有帶隙基準源還存在其它的不足。有鑒于此,有必要設計一種新的基準源及其附屬電路。
實用新型內容
針對現有技術存在的缺陷,本實用新型的目的在于提供基準源及其附屬電路,以便至少能在實現高電源電壓抑制比、提高工作穩定性或優化負載調整率中的某一個方面改善性能。
為解決以上技術問題,本實用新型提供一種帶隙基準源,該帶隙基準源配置有電源切換模塊及低壓差線性穩壓源,該電源切換模塊一輸入端接入外部電源,輸出端接帶隙基準源輸入端,帶隙基準源輸出端接低壓差線性穩壓源輸入端,低壓差線性穩壓源輸出端反饋接入電源切換模塊另一輸入端;帶隙基準源和低壓差線性穩壓源可分別向電源切換模塊提供使能信號,用以電源切換模塊在邏輯判斷后切換供電模式,給帶隙基準源提供外部電源電壓或低壓差線性穩壓源電壓,該帶隙基準源包括MOS管M18、MOS管M19、三極管Q1、三級管Q2、放大器IC及電阻R2、電阻R3、電阻R4;MOS管M18的源極與MOS管M19的源極共同接至電源,MOS管M18的柵極與MOS管M19的柵極共同接放大器IC的輸出端,MOS管M18的漏極通過電阻R2接放大器IC的一輸入端,MOS管M19的漏極通過電阻R3接放大器IC另一輸入端;該電阻R2接至三級管Q1的集電極,該三級管Q1的集電極與該三級管Q1的基極連接,該三級管Q1的發射極接地;該電阻R3通過電阻R4接至三級管Q2的集電極,該三級管Q2的集電極與該三級管Q2的基極連接,該三級管Q2的發射極接地。
與現有技術相比,本實用新型可以至少可以取得以下某一個方面的優點:
1、通過較為簡單的電源模式切換電路,可實現高電源電壓抑制比帶隙基準的設計,由此滿足低功耗、高電源電壓抑制比的設計需求;
2、在帶隙基準源基礎上增加自啟動電路單元及放大電路單元,使帶隙基準源可以自動進入正常工作狀態并增加其穩定性;
3、針對低壓差線性穩壓器結構增加帶寬的電路單元,優化了負載調整率,可滿足較大負載電容下輸出電壓穩定的要求。
附圖說明
通過閱讀下文優選實施方式的詳細描述,各種其他的優點和益處對于本領域普通技術人員將變得清楚明了。附圖僅用于示出優選實施方式的目的,而并不認為是對本實用新型的限制。而且在整個附圖中,用相同的參考符號來表示相同的部件。在附圖中:
圖1是本實用新型實施例基準源的電路框圖;
圖2是圖1中電源切換模塊的一種電路結構;
圖3是圖1中帶隙基準源的一種電路結構;
圖4是圖1中帶隙基準源的另一種電路結構;
圖5是圖1中低壓差線性穩壓源的一種電路結構;
圖6是圖1中低壓差線性穩壓源的另一種電路結構。
具體實施方式
在下面的描述中闡述了很多具體細節以便于充分理解本實用新型。但是本實用新型能夠以很多不同于在此描述的其它方式來實施,本領域技術人員可以在不違背本實用新型內涵的情況下做類似推廣,因此本實用新型不受下面公開的具體實施例的限制。
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