[實用新型]船用連續導航波雷達FPGA-DSP接口模塊有效
| 申請號： | 201420029932.4 | 申請日： | 2014-01-17 |
| 公開（公告）號： | CN203658574U | 公開（公告）日： | 2014-06-18 |
| 發明（設計）人： | 姚元飛;唐浩;何奎;錢延軍;楊仕東 | 申請（專利權）人： | 成都天奧信息科技有限公司 |
| 主分類號： | G01S7/02 | 分類號： | G01S7/02 |
| 代理公司： | 成都金英專利代理事務所(普通合伙) 51218 | 代理人： | 袁英 |
| 地址： | 610000 四川省*** | 國省代碼： | 四川;51 |
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| 摘要： | |||
| 搜索關鍵詞： | 連續 導航 雷達 fpga dsp 接口 模塊 | ||
1.船用連續導航波雷達FPGA-DSP接口模塊，其特征在于：它包括命令寄存器A、FIFO緩存器A、數據選擇器、命令寄存器B、FIFO緩存器B、DSP和MicroBlaze處理器；
命令寄存器A的輸入端分別與輸入命令和命令使能端相連，命令寄存器A的命令輸出端與FIFO緩存器A連接，數據選擇器的輸入端分別與輸入數據、數據使能端和量程數據連接，數據選擇器的數據輸出端與FIFO緩存器A相連，FIFO緩存器A命令輸出端輸出的FIFO滿信號產生中斷信號中斷DSP，FIFO緩存器A待檢數據輸出端與DSP相連，DSP的兩路dspce信號輸出端和一路dspaddr信號輸出端分別與FIFO緩存器A連接；
命令寄存器B的輸入端分別與角度數據、量程數據和自檢數據相連，命令寄存器B命令輸出端與FIFO緩存器B連接，DSP的目標數據輸出端、dspce信號輸出端、dspwe信號輸出端和dspaddr信號輸出端分別與FIFO緩存器B相連，FIFO緩存器B命令輸出端輸出的FIFO空信號產生網絡使能信號網絡使能MicroBlaze處理器，FIFO緩存器B的數據輸出端和數據總數輸出端分別與MicroBlaze處理器連接，MicroBlaze處理器的讀使能輸出端與FIFO緩存器B相連。
2.根據權利要求1所述的船用連續導航波雷達FPGA-DSP接口模塊，其特征在于：所述的MicroBlaze處理器的信號輸出端還與FPGA的網絡通信接口連接。
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