[發明專利]用于處理文本串的指令和邏輯有效
| 申請號： | 201410822302.7 | 申請日： | 2007-09-24 |
| 公開（公告）號： | CN104657113B | 公開（公告）日： | 2018-08-14 |
| 發明（設計）人： | M·朱利耶;J·格雷;S·米克斯;M·塞科尼;S·陳努帕蒂 | 申請（專利權）人： | 英特爾公司 |
| 主分類號： | G06F9/38 | 分類號： | G06F9/38 |
| 代理公司： | 永新專利商標代理有限公司 72002 | 代理人： | 劉瑜;王英 |
| 地址： | 美國加*** | 國省代碼： | 美國;US |
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| 摘要： | |||
| 搜索關鍵詞： | 用于 處理 文本 指令 邏輯 | ||
1.一種處理器，包括：
用于讀取比較指令的第一邏輯單元；
用于對所述比較指令進行譯碼的譯碼器邏輯單元；
多個64位單指令多數據(SIMD)浮點數據寄存器，包括：
第一64位SIMD浮點數據寄存器和第二64位SIMD浮點數據寄存器，分別用于存儲第一64位SIMD浮點操作數和第二64位SIMD浮點操作數，所述第一64位SIMD浮點操作數和所述第二64位SIMD浮點操作數中的每一個包括兩個32位浮點數據元素；以及
64位SIMD目的寄存器，所述比較指令的至少一個執行結果將被存儲在所述64位SIMD目的寄存器中，其中，所述第一64位SIMD浮點數據寄存器、所述第二64位SIMD浮點數據寄存器以及所述64位SIMD目的寄存器分別由所述比較指令內的第一SIMD操作數字段、第二SIMD操作數字段以及SIMD目的字段來識別；以及
多個執行單元，其中，所述多個執行單元中的至少一個執行單元用于執行所述比較指令，其中，所述比較指令使得所述處理器：
確定所述第一64位SIMD浮點操作數和所述第二64位SIMD浮點操作數的每個32位浮點數據元素是否有效，其中，所述第一64位SIMD浮點操作數的數據元素的有效性是在所述第一64位SIMD浮點操作數內部指示的；
僅將所述第一64位SIMD浮點操作數的有效32位浮點數據元素與所述第二64位SIMD浮點操作數的有效32位浮點數據元素進行比較，其中，與所述第二64位SIMD浮點操作數的有效32位浮點數據元素進行比較的所述第一64位SIMD浮點操作數的有效32位浮點數據元素是在相同的數據元素位置上；并且
存儲表示所比較的所述第一64位SIMD浮點操作數的有效32位浮點數據元素與所述第二64位SIMD浮點操作數的有效32位浮點數據元素是否相等的多個指示符。
2.如權利要求1所述的處理器，其中，所述處理器是RISC處理器。
3.如權利要求1或2所述的處理器，其中，所述比較指令具有用來指示多個數據元素大小其中之一的2位字段。
4.如權利要求1或2所述的處理器，其中，所述第一邏輯單元用于讀取第二比較指令，該第二比較指令將第一多個緊縮整數數據元素與第二多個緊縮整數數據元素進行比較，其中，所述多個執行單元中的至少一個執行單元用于執行所述第二比較指令，其中，所述第二比較指令使得所述處理器：
將所述第一多個緊縮整數數據元素中的整數數據元素與所述第二多個緊縮整數數據元素中的整數數據元素進行比較；以及
存儲多個擴展數據元素，每個擴展數據元素具有第一多位大小，所述多個擴展數據元素指示所比較的所述第一多個緊縮整數數據元素中的整數數據元素與所述第二多個緊縮整數數據元素中的整數數據元素是否相等。
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