[發明專利]一種像素電路、有機電致發光顯示面板及顯示裝置有效
| 申請號: | 201410640340.0 | 申請日: | 2014-11-13 |
| 公開(公告)號: | CN104318897A | 公開(公告)日: | 2015-01-28 |
| 發明(設計)人: | 木素真;胡祖權 | 申請(專利權)人: | 合肥鑫晟光電科技有限公司;京東方科技集團股份有限公司 |
| 主分類號: | G09G3/32 | 分類號: | G09G3/32 |
| 代理公司: | 北京同達信恒知識產權代理有限公司 11291 | 代理人: | 黃志華 |
| 地址: | 230011 *** | 國省代碼: | 安徽;34 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 像素 電路 有機 電致發光 顯示 面板 顯示裝置 | ||
技術領域
本發明涉及顯示技術領域,尤其涉及一種像素電路、有機電致發光顯示面板及顯示裝置。
背景技術
隨著顯示技術的進步,越來越多的有源矩陣有機發光二極管(Active?Matrix?Organic?Light?Emitting?Diode,AMOLED)顯示面板進入市場,與傳統的晶體管液晶顯示面板(Thin?Film?Transistor?Liquid?Crystal?Display,TFT?LCD)相比,具有低能耗、生產成本低、自發光、寬視角及響應速度快等優點,目前,在手機、PDA、數碼相機等顯示領域已經開始逐步取代傳統的LCD顯示屏。與TFT?LCD利用穩定的電壓控制亮度不同,AMOLED屬于電流驅動,需要穩定的電流來控制發光。
現有的驅動OLED發光的像素電路,如圖1所示,包括:驅動晶體管M1、開關晶體管M2、存儲電容C以及發光器件OLED;其中,驅動晶體管M1的柵極分別與開關晶體管M2的漏極和存儲電容C的一端相連、源極與高電壓信號端VDD相連、漏極分別與存儲電容的另一端和發光器件OLED的一端相連;開關晶體管M2的柵極與掃描信號端Gate相連、源極與數據信號端Data相連;發光器件OLED的另一端與低電壓信號端VSS相連;驅動晶體管M1驅動發光器件OLED發光時,驅動電流由高電壓信號端VDD、數據信號端Data以及驅動晶體管M1共同控制,由于OLED的發光亮度對其驅動電流的變化相當敏感,且驅動晶體管M1在制作過程中無法做到完全一致,而且由于工藝制程和器件老化,以及工作過程中溫度的變化等原因,會使各像素電路中的驅動晶體管M1的閾值電壓Vth存在不均勻性,這樣就導致了流過每個像素點OLED的電流發生變化使得顯示亮度不均,從而影響整個圖像的顯示效果。
因此,如何消除像素電路中驅動晶體管閾值電壓的變化對發光器件的發光亮度的影響,保證驅動發光器件OLED的電流的均一性,從而保證顯示畫面的質量,是本領域技術人員亟待解決的問題。
發明內容
本發明實施例提供了一種像素電路、有機電致發光顯示面板及顯示裝置,用以解決現有技術中存在的像素電路中驅動晶體管閾值電壓的變化影響發光器件的發光亮度的問題。
本發明實施例提供了一種像素電路,包括:初始化模塊、充電控制模塊、驅動模塊、具有發光器件的發光模塊;其中,
所述驅動模塊的控制端與第一節點相連,輸入端與第二節點相連,輸出端與所述發光模塊的輸入端相連;所述充電控制模塊的控制端與掃描信號端相連,輸入端與數據信號端相連,輸出端與第三節點相連;所述初始化模塊連接于所述第一節點、所述第二節點、所述第三節點、第一參考信號端、第一信號控制端和所述掃描信號端之間;所述發光模塊的第一控制端與第二信號控制端相連,第二控制端與發光信號控制端相連,輸出端與第二參考信號端相連;
在初始化階段,所述初始化模塊用于在所述掃描信號端的控制下對所述第一節點進行初始化,所述充電控制模塊用于在所述掃描信號端的控制下對所述第三節點進行初始化;
在補償階段,所述發光模塊用于在所述第二信號控制端的控制下將所述驅動模塊的輸出端與所述第二參考信號端導通,所述初始化模塊用于在所述第一信號控制端和所述掃描信號端的控制下對所述第一節點進行所述驅動模塊的閾值電壓補償;
在數據寫入階段,所述充電控制模塊用于在所述掃描信號端的控制下通過所述初始化模塊對所述第一節點進行數據寫入;
在發光階段,所述初始化模塊用于在所述第一信號控制端的控制下將所述第一參考信號端與所述驅動模塊的輸入端導通,使所述驅動模塊驅動所述發光模塊中的所述發光器件發光。
在一種可能的實施方式中,本發明實施例提供的上述像素電路中,所述驅動模塊,具體包括:驅動晶體管;
所述驅動晶體管的柵極與所述第一節點相連,源極與所述第二節點相連,漏極與所述發光模塊的輸入端相連。
在一種可能的實施方式中,本發明實施例提供的上述像素電路中,所述初始化模塊,具體包括:第一開關晶體管、第二開關晶體管和存儲電容;其中,
所述第一開關晶體管的柵極與所述掃描信號端相連,源極與所述第一參考信號端相連,漏極與所述第一節點相連;
所述第二開關晶體管的柵極與所述第一信號控制端相連,源極與所述第一參考信號端相連,漏極與所述第二節點相連;
所述存儲電容連接于所述第一節點與所述第三節點之間。
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