[發(fā)明專利]一種多核顯示控制方法及控制器在審
| 申請(qǐng)?zhí)枺?/td> | 201410609086.8 | 申請(qǐng)日: | 2014-11-04 |
| 公開(公告)號(hào): | CN104333721A | 公開(公告)日: | 2015-02-04 |
| 發(fā)明(設(shè)計(jì))人: | 張斌;吳小平;房志麗;黃際雷 | 申請(qǐng)(專利權(quán))人: | 北京德彼克創(chuàng)新科技有限公司 |
| 主分類號(hào): | H04N5/445 | 分類號(hào): | H04N5/445;H04N21/431;H04N5/202;H04N9/69 |
| 代理公司: | 暫無信息 | 代理人: | 暫無信息 |
| 地址: | 100085 北京市海淀區(qū)*** | 國省代碼: | 北京;11 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 多核 顯示 控制 方法 控制器 | ||
1.一種多核顯示控制方法,其特征在于,具體步驟包括:
步驟一、通過多核顯示控制器的DVI/HDMI接口、DisplayPort接口、VGA信號(hào)接口、模擬視頻信號(hào)接口中任意一個(gè)或多個(gè)接口分別對(duì)應(yīng)接收來自外界的顯示信號(hào),并將信號(hào)轉(zhuǎn)換成一個(gè)或多個(gè)相應(yīng)的TTL信號(hào);
步驟二、幀緩存及DDR控制器將上述TTL信號(hào)按接口IP存儲(chǔ)到DDR的不同空間,并從DDR相應(yīng)空間讀取數(shù)據(jù)發(fā)送到對(duì)應(yīng)的縮放處理模塊中進(jìn)行圖像處理;
步驟三、縮放處理模塊對(duì)應(yīng)比較輸入與輸出格式的差別,計(jì)算縮小或放大比例,完成相應(yīng)顯示屏的顯示適配處理,并將信號(hào)發(fā)送到對(duì)應(yīng)的伽瑪、色彩校正及視頻增強(qiáng)模塊中;
步驟四、伽瑪、色彩校正及視頻增強(qiáng)模塊對(duì)接收到的信號(hào)分別進(jìn)行伽瑪、色彩校正和視頻增強(qiáng)效果處理,同時(shí),利用OSD引擎模塊將OSD界面與處理后信號(hào)進(jìn)行混合,混合信號(hào)被發(fā)送到多端口LVDS/V-by-One/eDP發(fā)送模塊中;
步驟五、多端口LVDS/V-by-One/eDP發(fā)送模塊根據(jù)相應(yīng)的顯示屏要求,結(jié)合LVDS/V-by-One/eDP協(xié)議對(duì)混合后信號(hào)進(jìn)行并行到串行轉(zhuǎn)換,形成最終顯示信號(hào)驅(qū)動(dòng)相應(yīng)顯示屏完成畫面顯示。
2.根據(jù)權(quán)利要求1所述的一種多核顯示控制方法,其特征在于,所述步驟二中,幀緩存及DDR控制器還可根據(jù)用戶定義IP實(shí)現(xiàn)信號(hào)的對(duì)應(yīng)接收、對(duì)應(yīng)存儲(chǔ)、對(duì)應(yīng)處理和顯示屏的對(duì)應(yīng)顯示。
3.根據(jù)權(quán)利要求1所述的一種多核顯示控制方法,其特征在于,所述畫面顯示包括:一屏一顯或一屏多顯;或者,多塊顯示屏上顯示一個(gè)畫面或多個(gè)畫面。
4.根據(jù)權(quán)利要求3所述的一種多核顯示控制方法,其特征在于,所述一屏多顯方式包括:畫面并列顯示、畫面重疊顯示或畫面覆蓋顯示。
5.根據(jù)權(quán)利要求1所述的一種多核顯示控制方法,其特征在于,所述多端口LVDS/V-by-One/eDP發(fā)送模塊輸出時(shí)采用共用時(shí)鐘方式實(shí)現(xiàn)同一顯示屏的顯示;或,采用獨(dú)立時(shí)鐘方式完成多個(gè)不同顯示屏的顯示。
6.根據(jù)權(quán)利要求1所述的一種多核顯示控制方法,其特征在于,所述最終顯示信號(hào)的分辨率至少可達(dá)3840×2160或4096×2160。
7.一種用于實(shí)現(xiàn)上述權(quán)利要求1至6中任一所述多核顯示控制方法的控制器,其特征在于,包括至少一個(gè)TMDS信號(hào)接收器、至少一個(gè)DP信號(hào)接收器、至少一個(gè)VGA信號(hào)接收與轉(zhuǎn)換器、至少一個(gè)模擬視頻信號(hào)接收與轉(zhuǎn)換器、幀緩存及DDR控制器、DDR模塊、OSD引擎模塊和多端口LVDS/V-by-One/eDP發(fā)送模塊,以及連接在幀緩存及DDR控制器和多端口LVDS/V-by-One/eDP發(fā)送模塊之間的至少四組順序連接的縮放處理模塊和伽瑪、色彩校正及視頻增強(qiáng)模塊;所述DDR模塊連接在幀緩存及DDR控制器上;所述OSD引擎模塊連接在多端口LVDS/V-by-One/eDP發(fā)送模塊信號(hào)端口的輸入端上,多端口LVDS/V-by-One/eDP發(fā)送模塊的輸出端與外界一個(gè)或多個(gè)顯示屏連通。
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