[發明專利]一種圖層變更同步的方法有效
| 申請號: | 201410541890.7 | 申請日: | 2014-10-14 |
| 公開(公告)號: | CN104375792B | 公開(公告)日: | 2017-11-03 |
| 發明(設計)人: | 羊海龍 | 申請(專利權)人: | 浙江宇視科技有限公司 |
| 主分類號: | G06F3/14 | 分類號: | G06F3/14 |
| 代理公司: | 北京博思佳知識產權代理有限公司11415 | 代理人: | 林祥 |
| 地址: | 310051 浙江省杭州市濱江*** | 國省代碼: | 浙江;33 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 變更 同步 方法 | ||
技術領域
本發明涉及圖像顯示技術領域,尤其涉及一種圖層變更同步的方法。
背景技術
一、視頻綜合平臺形態介紹
視頻綜合平臺在安防監控、指揮、應急調度等領域具有廣泛應用。視頻綜合平臺可提供模擬監控圖像、IP監控圖像、SDI監控圖像、EPON監控圖像、會議終端圖像等接入、管理、存儲以及大屏顯示等綜合應用,請參圖1。
監控圖像接入種類很多,如SDI、VGA、HDMI、光口、電口,IP的、非IP的等;送顯的屏幕組合也很多,如3*3、4*3、4*4、6*3等。為靈活地適應多種配置,在硬件形態上,視頻綜合平臺通常采取框架式插卡式設計,請參圖2所示。
輸入板卡、輸出板卡插在交換背板上,通過交換背板進行數據交換,如圖3。所示。
二、視頻綜合平臺圖層變換業務介紹
視頻綜合平臺具有開窗、消窗、窗口漫游、窗口縮放、窗口疊層等圖層變更業務,以下結合圖4進行解釋。
圖4顯示了9塊物理屏(視頻綜合平臺可以支持更多物理屏),可以把這9塊屏幕想象成一塊大的“虛擬”屏幕,在這塊大虛擬屏上進行各種圖像變更操作,具體如下:
開窗:圖像窗口從無到有的操作;
消窗:圖像窗口從有到無的操作;
漫游:已存在窗口離開原來位置,到其他位置顯示;
縮放:已存在窗口改變原始大小顯示;
疊層:多個窗口重疊顯示。
三、圖像業務管理——DDR讀拼操作與寫拼操作
多源圖像送顯需要DDR參與,借助緩存實現圖像的各種顯示,通常有兩種操作方式,讀拼操作與寫拼操作。
讀拼操作,故名思議就是把多路圖像從DDR中讀出來,然后完成拼接。圖5中,4路圖像要實現疊層,可以先把4路圖像寫入4塊DDR片區,然后控制讀地址,從4塊片區中讀取參與拼接的部分,實現疊層。讀拼操作地址管理復雜,DDR容量要求大。
寫拼操作,故名思議就是寫入DDR時完成拼接,DDR讀取的時候已成為完整的一副圖像讀取。圖6中,4幅圖像可以依次按照疊放次序放入DDR片區,通過控制每幅圖像的起始寫地址完成拼接,圖像讀取的時候,只要看成完整圖像讀取即可。寫拼方式DDR地址管理簡單,DDR容量要求小。
四、切換同步問題引入
切換同步問題引入:圖層在正常顯示時,用戶需要變更圖層,如開窗、消窗、漫游、疊層順序調整等,相應地CPU會向各業務板下發參數。由于參數很多,且需要分發到底層處理模塊,但CPU的配置總線下發速度受限,因此在變更圖層操作時,普遍會存在圖7所示的情況:
(1)部分模塊先生效參數,如模塊1、模塊n。
(2)部分模塊晚生效參數,如模塊n、模塊m。
(3)對某幀圖像而言,存在新老參數共存的可能,如第X+1幀,導致圖像顯示短暫花屏。
(4)對于跨屏顯示的圖像而言,如圖4中“縮小+漫游”的圖片跨了上下兩個屏,假如正好這兩個屏在兩塊輸出板上,一旦兩個輸出板的配置開始和結束時間不一致,將導致半幅圖像先更新,半幅圖像晚更新的情況。
發明內容
有鑒于此,本發明提供一種圖層變更同步的方法。
應用于單屏圖層變更的同步方法為:在圖層變更過程中,若涉及圖層變更配套參數的下發,則在CPU下發該圖層變更配套參數前,CPU下發對應圖層的寫使能關閉信號,DDR寫入管理模塊在接收到該寫使能關閉信號后,基于幀使得對應圖層的寫使能開關處于關閉狀態;在該圖層變更配套參數下發完成后,DDR寫入管理模塊基于幀打開對應圖層的寫使能開關;并且,在DDR寫入管理模塊基于幀使得對應圖層的寫使能開關處于關閉狀態時,底圖刷新模塊進行底圖刷新操作。
應用于多屏圖層變更同步的方法包括:每個屏對應一FPGA,每個FPGA包括各自的DDR寫入管理模塊和底圖刷新模塊;在圖層變更過程中,若涉及圖層變更配套參數的下發,則在CPU下發該圖層變更配套參數前,CPU下發對應圖層的寫使能關閉信號,再下發各DDR寫入管理模塊共享的心跳脈沖,各DDR寫入管理模塊在同時檢測到心跳脈沖后,基于幀關閉對應圖層的寫使能開關;在該圖層變更配套參數下發完成后,CPU下發對應圖層的寫使能打開信號,再下發各DDR寫入管理模塊共享的心跳脈沖,各DDR寫入管理模塊在同時檢測到心跳脈沖后,基于幀打開對應圖層的寫使能開關;并且,在各DDR寫入管理模塊基于幀使得對應圖層的寫使能開關關閉時,各FPGA的底圖刷下模塊進行底圖刷新操作。
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