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[發明專利]一種像素電路的驅動方法有效

專利信息
申請號: 201410522250.1 申請日: 2014-09-30
公開(公告)號: CN104318894B 公開(公告)日: 2017-02-15
發明(設計)人: 龍春平;田宏偉 申請(專利權)人: 京東方科技集團股份有限公司
主分類號: G09G3/3208 分類號: G09G3/3208;H01L27/32
代理公司: 北京中博世達專利商標代理有限公司11274 代理人: 申健
地址: 100015 *** 國省代碼: 北京;11
權利要求書: 查看更多 說明書: 查看更多
摘要:
搜索關鍵詞: 一種 像素 電路 驅動 方法
【說明書】:

技術領域

發明涉及顯示技術領域,尤其涉及一種像素電路及其驅動方法、顯示裝置。

背景技術

隨著顯示技術的急速進步,作為顯示裝置核心的半導體元件技術也隨之得到了飛躍性的進步。對于現有的顯示裝置而言,有機發光二極管(Organic?Light?Emitting?Diode,OLED)作為一種電流型發光器件,因其所具有的自發光、快速響應、寬視角和可制作在柔性襯底上等特點而越來越多地被應用于高性能顯示領域當中。

采用上述OLED器件可以構成OLED顯示器,該顯示器的陣列基板上設置有多個TFT(Thin?Film?Transistor,薄膜晶體管)。為了提高TFT的載流子遷移率,并降低電阻率,使得通過相同電流時,功耗較小。一般采用多晶硅構成上述TFT。然而由于生產工藝和多晶硅的特性,導致在大面積玻璃基板上制作的TFT開關電路時,常常在諸如閾值電壓Vth、遷移率等電學參數上出現波動,從而使得流經OLED器件的電流不僅會隨著TFT長時間導通所產生的導通電壓應力的變化而改變,而且其還會隨著TFT的閾值電壓Vth漂移而有所不同。如此一來,將會影響到顯示器的亮度均勻性與亮度恒定性。從而降低顯示器的畫面品質和質量。

發明內容

本發明的實施例提供一種像素電路及其驅動方法、顯示裝置,能夠改善顯示器顯示亮度不均勻的不良現象。

為達到上述目的,本發明的實施例采用如下技術方案:

本發明實施例的一方面,提供一種像素電路,包括:第一晶體管、第二晶體管、第三晶體管、第四晶體管、第五晶體管、第六晶體管、存儲電容以及發光器件;

所述第一晶體管的柵極連接發光控制信號輸入端,第一極連接所述存儲電容的一端,第二極與參考電壓端相連接;

所述第二晶體管的柵極連接復位信號輸入端,第一極連接所述存儲電容的另一端,第二極與所述參考電壓端相連接;

所述第三晶體管的柵極連接柵線,第一極連接數據線,第二極與所述存儲電容的一端相連接;

所述第四晶體管的柵極連接所述柵線,第一極連接所述存儲電容的另一端,第二極與所述第五晶體管的第二極相連接;

所述第五晶體管的柵極連接所述存儲電容的另一端,第一極連接第一電壓端,第二極與所述第四晶體管的第二極相連接;

所述第六晶體管的柵極連接所述發光控制信號輸入端,第一極連接所述第五晶體管的第二極,第二極連接所述發光器件的陽極;

所述發光器件的陰極連接第二電壓端。

本發明實施例的另一方面,提供一種顯示裝置包括如上所述的任意一種像素電路。

本發明實施例的又一方面,提供一種像素電路驅動方法,包括驅動如上所述的任意一種像素電路的方法,所述方法還包括:

導通第二晶體管,將參考電壓端輸入的電壓信號傳輸至第五晶體管的柵極,并存入存儲電容中;

導通第三晶體管,將數據線輸入的數據電壓通過所述第三晶體管傳輸至所述第三晶體管的第二極,并保存至所述存儲電容中;導通第四晶體管,將所述第五晶體管的柵極和第二極進行導通,對所述第五晶體管的柵極進行電壓寫入;

導通第一晶體管、所述第五晶體管和第六晶體管,通過所述第五晶體管和所述第六晶體管的電流驅動發光器件發光。

本發明實施例提供一種像素電路及其驅動方法、顯示裝置,其中所述像素電路通過多個晶體管以及一個存儲電容對電路進行開關和充放電控制。具體的,作為驅動晶體管的第五晶體管的一端直接與第一電壓端連接,并在像素電路中引入參考電壓,使得流過發光器件的驅動電流僅于上述參考電壓和數據線輸入的數據電壓有關。這樣一來。不僅能夠在避免發光器件受到閾值電壓影響,還可以避免第一電壓端的歐姆電壓降對流過發光器件的驅動電流產生影響,此外由于第五晶體管直接與第一電壓端相連接,避免了第五晶體管的柵源電壓出現非線性變化,從而對流過發光器件的驅動電流產生影響。綜上所述,本發明提供的像素電路能夠改善顯示裝置顯示亮度的均勻性。

附圖說明

為了更清楚地說明本發明實施例或現有技術中的技術方案,下面將對實施例或現有技術描述中所需要使用的附圖作簡單地介紹,顯而易見地,下面描述中的附圖僅僅是本發明的一些實施例,對于本領域普通技術人員來講,在不付出創造性勞動的前提下,還可以根據這些附圖獲得其他的附圖。

圖1為本發明實施例提供的一種像素電路的結構示意圖;

圖2為本發明實施例提供的一種像素電路的控制信號時序圖;

圖3-圖5為本發明實施例提供的一種像素電路在各個階段的連接示意圖;

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