[發明專利]同步網絡應用內的傳輸參考信號清理無效
| 申請號: | 201410085554.6 | 申請日: | 2014-03-10 |
| 公開(公告)號: | CN104052561A | 公開(公告)日: | 2014-09-17 |
| 發明(設計)人: | S·尼瑪瓦卡爾;G·E·比爾斯;P·S·拜卓斯安;M·A·博爾多格納;萬泓 | 申請(專利權)人: | LSI公司 |
| 主分類號: | H04J3/06 | 分類號: | H04J3/06 |
| 代理公司: | 中國國際貿易促進委員會專利商標事務所 11038 | 代理人: | 劉倜 |
| 地址: | 美國加*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關鍵詞: | 同步 網絡 應用 傳輸 參考 信號 清理 | ||
1.一種網絡參考時鐘處理器模塊,包括:
數字鎖相環,被配置用于至少大體上衰減來自至少一個參考信號的漂移噪聲部分;以及
一個或多個模擬鎖相環,通信地耦合至所述數字鎖相環,并且被配置用于接收來自所述數字鎖相環的至少一個參考信號,所述一個或多個模擬鎖相環被配置用于衰減具有來自至少一個頻率信號的第一噪聲部分,
其中,所述一個或多個模擬鎖相環被配置用于將至少一個參考信號提供至通信地耦合到所述模擬鎖相環的收發器,至少一個參考信號用于同步由所述收發器傳輸的數據的傳輸。
2.如權利要求1所述的網絡參考時鐘處理器模塊,其中所述一個或多個模擬鎖相環被耦合至所述數字鎖相環,并且被配置用于提供至少一個或多個參考信號以支持要求可追溯計時參考的其他網絡處理器功能。
3.如權利要求1所述的網絡參考時鐘處理器模塊,進一步包括通信地連接至所述數字鎖相環的輸入復用器,所述輸入復用器被配置用于接收多個參考信號且選擇性地將至少一個參考信號輸出至所述數字鎖相環。
4.如權利要求3所述的網絡參考時鐘處理器模塊,其中所述多個參考信號包括至少本地參考時鐘信號或恢復的時鐘信號。
5.如權利要求1所述的網絡參考時鐘處理器模塊,其中所述收發器被配置用于在同步以太網環境內傳輸同步的數據。
6.如權利要求1所述的網絡參考時鐘處理器模塊,其中所述收發器被配置用于基于所述至少一個參考信號而同步所述數據。
7.一種處理器,包括:
網絡參考時鐘處理器模塊,所述網絡參考時鐘處理器模塊包括:
數字鎖相環,被配置用于至少大體上衰減來自至少一個參考信號的漂移噪聲部分;
一個或多個模擬鎖相環,通信地耦合至所述數字鎖相環,并且被配置用于接收來自所述數字鎖相環的至少一個參考信號,所述模擬鎖相環被配置用于衰減來自所述至少一個參考信號的具有第一頻率特性的抖動噪聲部分;以及
通信地耦合至所述模擬鎖相環的收發器,所述收發器被配置用于衰減來自所述至少一個參考信號的具有第二頻率特性的抖動噪聲部分,所述收發器被配置用于使用所述至少一個參考信號來同步一個或多個數據信號。
8.如權利要求7所述的處理器,其中一個或多個模擬PLL耦合至所述數字鎖相環,并且被配置用于提供至少一個或多個參考信號以支持要求可追溯計時參考的其他網絡處理器功能。
9.如權利要求7所述的處理器,進一步包括通信地連接至所述數字鎖相環的輸入復用器,所述輸入復用器被配置用于接收多個參考信號且選擇性地將所述至少一個參考信號輸出至所述數字鎖相環。
10.如權利要求9所述的處理器,其中所述多個參考信號包括至少本地參考時鐘信號或恢復的時鐘信號。
11.如權利要求9所述的處理器,進一步包括通信地連接至所述輸入復用器的一個或多個微處理器核,所述一個或多個微處理器核被配置用于將選擇信號發送至所述輸入復用器,以使所述輸入復用器輸出響應于所述選擇信號的至少一個參考信號。
12.如權利要求7所述的處理器,其中所述收發器被配置用于傳輸在同步以太網環境內作為同步比特的串行化數據。
13.如權利要求7所述的處理器,其中所述收發器被配置用于恢復來自一個或多個數據信號的所述至少一個參考信號。
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