[發明專利]一種像素電路在審
| 申請號： | 201410041783.8 | 申請日： | 2014-01-28 |
| 公開（公告）號： | CN103760701A | 公開（公告）日： | 2014-04-30 |
| 發明（設計）人： | 鐘博欽 | 申請（專利權）人： | 友達光電股份有限公司 |
| 主分類號： | G02F1/133 | 分類號： | G02F1/133;G09G3/36 |
| 代理公司： | 北京律誠同業知識產權代理有限公司 11006 | 代理人： | 徐金國 |
| 地址： | 中國臺灣新竹科*** | 國省代碼： | 中國臺灣;71 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 像素 電路 | ||
1.一種像素電路，電性耦接至一數據線、一第一掃描線與一第二掃描線，其特征在于，所述像素電路包括：
一主像素單元，電性耦接至所述第一掃描線和所述數據線，用以確定主像素的顯示灰階；
一第一子像素單元，電性耦接至所述第一掃描線和所述數據線，用以確定第一子像素的顯示灰階；以及
一第二子像素單元，電性耦接至所述第一掃描線、所述第二掃描線、所述數據線和一輔助存儲電容，用以確定第二子像素的顯示灰階。
2.根據權利要求1所述的像素電路，其特征在于，所述主像素單元還包括：
一第一薄膜晶體管，具有一第一端、一第二端和一控制端，所述第一薄膜晶體管的第一端電性連接至所述數據線，所述第一薄膜晶體管的控制端電性連接至所述第一掃描線；
一主像素電極，電性連接至所述第一薄膜晶體管的第二端；以及
一主存儲電容，其中，所述第一薄膜晶體管電性耦接于所述數據線與所述主存儲電容之間。
3.根據權利要求1所述的像素電路，其特征在于，所述第一子像素單元還包括：
一第二薄膜晶體管，具有一第一端、一第二端和一控制端，所述第二薄膜晶體管的第一端電性連接至所述數據線，所述第二薄膜晶體管的控制端電性連接至所述第一掃描線；
一第三薄膜晶體管，具有一第一端、一第二端和一控制端，所述第三薄膜晶體管的第一端電性連接至所述第二薄膜晶體管的第二端，所述第三薄膜晶體管的控制端電性連接至所述第一掃描線，所述第三薄膜晶體管的第二端電性連接至一面板共通電壓；
一第一子像素電極，電性連接至所述第二薄膜晶體管的第二端和所述第三薄膜晶體管的第一端；以及
一第一存儲電容，其中，所述第二薄膜晶體管電性耦接于所述數據線與所述第一存儲電容之間。
4.根據權利要求1所述的像素電路，其特征在于，所述第二子像素單元還包括：
一第四薄膜晶體管，具有一第一端、一第二端和一控制端，所述第四薄膜晶體管的第一端電性連接至所述數據線，所述第四薄膜晶體管的控制端電性連接至所述第一掃描線；
一第五薄膜晶體管，具有一第一端、一第二端和一控制端，所述第五薄膜晶體管的第一端電性連接至所述第四薄膜晶體管的第二端，所述第五薄膜晶體管的控制端電性連接至所述第二掃描線，所述第五薄膜晶體管的第二端電性連接至所述輔助存儲電容；
一第二子像素電極，電性連接至所述第四薄膜晶體管的第二端和所述第五薄膜晶體管的第一端；以及
一第二存儲電容，其中，所述第四薄膜晶體管電性耦接于所述數據線與所述第二存儲電容之間。
5.根據權利要求1所述的像素電路，其特征在于，當所述第一掃描線為高電平時，所述第一薄膜晶體管、第二薄膜晶體管、第三薄膜晶體管和第四薄膜晶體管均處于開通狀態。
6.根據權利要求5所述的像素電路，其特征在于，所述主像素單元對應的電壓等于所述數據線上的電位電壓，所述第一子像素單元對應的電壓等于所述數據線上的電位電壓與所述面板共通電壓共享結束時的電位電壓。
7.根據權利要求1所述的像素電路，其特征在于，當所述第二掃描線為高電平時，所述第五薄膜晶體管處于開通狀態，所述第二子像素單元對應的電壓等于所述數據線上的電位電壓與所述輔助電容共享結束時的電位電壓。
8.根據權利要求1所述的像素電路，其特征在于，所述主像素單元的顯示灰階、所述第一子像素的顯示灰階和所述第二子像素的顯示灰階各自的電壓均不相同。
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