[實用新型]多視區裸眼3D 播放系統有效
| 申請號: | 201320417673.8 | 申請日: | 2013-07-12 |
| 公開(公告)號: | CN203466924U | 公開(公告)日: | 2014-03-05 |
| 發明(設計)人: | 曹聰;林家用;任振波;安鵬莉;張長杰;毛杰 | 申請(專利權)人: | 上海環鼎影視科技有限公司 |
| 主分類號: | H04N13/00 | 分類號: | H04N13/00;H04N13/04;G06F3/14 |
| 代理公司: | 上海晨皓知識產權代理事務所(普通合伙) 31260 | 代理人: | 成麗杰 |
| 地址: | 201210 上海市浦東新*** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 多視區 裸眼 播放 系統 | ||
【技術領域】
本發明涉及一種多視區裸眼3D顯示系統,屬于播放顯示的技術領域,具體涉及一種采用LED屏進行裸眼3D顯示。
【背景技術】
所謂裸眼3D顯示技術是指將原有3D信號流中的左右眼圖像進行分離,然后通過雙目視差原理,不用佩戴眼鏡和頭盔就可以直接呈現立體效果。
目前流行的集中3D技術都需要額外佩戴觀看用具,通過觀看用具區分出左右眼不同畫面,從而得到觀賞3D的效果。佩戴的觀看用具不外乎眼鏡和頭盔,長時間佩戴會讓人覺得疲憊和頭疼,特別是對于已經有近視,需要佩戴近視眼鏡的人而言以這種方式觀看3D視頻,負擔較重。
目前的裸眼3D技術還不成熟,對于裸眼3D顯示技術,采用液晶顯示屏只是小范圍單視角的觀察,只適合室內使用。
目前最為熱門也最為困難的是將裸眼3D技術應用到戶外大型LED屏上。在戶外大型LED屏上采用裸眼3D,就要求可視范圍廣,能夠在多角度的范圍內觀察到3D效果;采用從電腦上的3D片源進行播放時,一般情況電腦輸出VGA信號,是一種模擬信號,而3D播放需要的數字信號,所以不能直接播放,需要一個信號轉化處理過程。信號轉化處理繁瑣,會使系統更加復雜,而編程難度加大。導致整個方案更加難以穩定流程地實現。
【發明內容】
本發明針對以上情況提出了一種適合戶外LED顯示屏進行裸眼多視區3D顯示的3D播放系統。
本發明所涉及的一種多視區裸眼3D播放系統,包括視頻解碼單元和視頻顯示單元,該視頻解碼單元接收電腦和顯卡處的視頻信息并進行視頻解碼處理,將DVI(Digital?VisualInterface數字視頻接口,該數字視頻接口有DVI-A、DVI-D和DVI-I三種不同接口形式,其中DVI-D只有數字接口)信號處理成為兩路LVDS信號(Low-Voltage?Differential?Signaling低壓差分信號)發送至視頻顯示單元,通過視頻顯示單元分別將對應左眼和右眼的兩路信號轉換為全數字輸出的DVI-D信號,并加載到LED顯示屏上,進行LED屏裸眼3D播放。
該視頻解碼單元包括寫數據緩沖模塊、數據位數轉換模塊、SDRAM控制器、讀操作模塊、寫操作模塊、讀數據緩沖模塊、現場可編程門陣列控制板(FPGA控制板)和低壓差分信號(LVDS)發生器;該寫數據緩沖模塊輸入端連接至電腦和顯卡,該寫數據緩沖模塊輸出端連接數據位數轉換模塊,該數據位數轉換模塊轉換位數后存入SDRAM控制器,SDRAM控制器控制讀操作模塊進行讀操作,控制寫操作模塊進行寫操作;該寫數據緩沖模塊的數據送至FPGA控制板,通過讀數據緩沖模塊將SDRAM的數據轉成3D所需要的LVDS信號,發送到LVDS發生器。
該視頻顯示單元包括兩路信號傳遞線,分別是右眼信號傳遞線和左眼信號傳遞線,該每路信號傳遞線都包括依次信號連接的信號轉換器、信號分頻器、LED控制器和外部接口,該兩路信號傳遞線接收由視頻解碼單元輸出的兩路LVDS信號。
一種多視區裸眼3D播放方法,運用多視區裸眼3D播放系統,該系統中的視頻解碼單元接收顯卡直接輸出3D視頻的DVI信號,而后將信號高速緩存并采用視頻分離芯片將左右眼圖像分離,通過高速視頻無損時鐘同步分割技術,同步輸出雙通道的LVDS信號,實現數據傳送;該視頻顯示單元:將雙通道的LVDS信號轉換為全數字輸出的DVI-D信號,數字信號通過分頻器分別將左眼信號分成N路,將右眼信號分成N路。通過網卡同步發送到LED控制系統,通過LED顯示屏進行播放。
該視頻解碼單元包括寫數據緩沖模塊、數據位數轉換模塊、SDRAM控制器、讀操作模塊、寫操作模塊、讀數據緩沖模塊、現場可編程門陣列控制板(FPGA控制板)和低壓差分信號(LVDS)發生器;該寫數據緩沖模塊過渡存儲電腦和顯卡裝置輸出的DVI信號,數據位數轉換模塊轉換寫數據緩沖模塊中數據的數位,讓數據數位大小符合SDRAM標準位數要求;經過數據位數轉換模塊轉換位數后存入SDRAM控制器,SDRAM控制器控制讀操作模塊進行讀操作,控制寫操作模塊進行寫操作;該寫數據緩沖模塊的數據送至FPGA控制板,通過讀數據緩沖模塊將SDRAM的數據轉成3D所需要的LVDS信號,發送到LVDS發生器。
該視頻解碼單元還包括時鐘同步控制器,該時鐘同步控制器與FPGA控制板連接,并受FPGA控制板控制;該時鐘同步控制器控制信號同時輸出,由視頻解碼單元輸出兩路LVDS信號,同步地傳輸至視頻顯示單元。
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