[實用新型]基于CPLD的上電時序控制電路有效
| 申請?zhí)枺?/td> | 201320124277.6 | 申請日： | 2013-03-19 |
| 公開（公告）號： | CN203311194U | 公開（公告）日： | 2013-11-27 |
| 發(fā)明（設計）人： | 程金枝;朱瑞霖 | 申請（專利權）人： | 上海斐訊數(shù)據(jù)通信技術有限公司 |
| 主分類號： | G05B19/042 | 分類號： | G05B19/042 |
| 代理公司： | 暫無信息 | 代理人： | 暫無信息 |
| 地址： | 201616 上海市*** | 國省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關鍵詞： | 基于 cpld 時序 控制電路 | ||
【權利要求書】：
1.基于CPLD的上電時序控制電路，其特征在于，所述基于CPLD的上電時序控制電路包括：
??PMOS管開關，所述PMOS管開關柵極連接CPLD控制端邏輯電路，源極連接主板3.3V電源，漏極連接扣板的3.3V供電端。
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