[實用新型]基于PLB總線的SJA1000接口IP核有效
| 申請號: | 201320016223.8 | 申請日: | 2013-01-14 |
| 公開(公告)號: | CN203084719U | 公開(公告)日: | 2013-07-24 |
| 發明(設計)人: | 趙哲 | 申請(專利權)人: | 無錫普智聯科高新技術有限公司 |
| 主分類號: | G06F13/24 | 分類號: | G06F13/24 |
| 代理公司: | 天津盛理知識產權代理有限公司 12209 | 代理人: | 王利文 |
| 地址: | 214135 江蘇省無錫市無錫市新*** | 國省代碼: | 江蘇;32 |
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| 摘要: | |||
| 搜索關鍵詞: | 基于 plb 總線 sja1000 接口 ip | ||
1.一種基于PLB總線的SJA1000接口IP核,其特征在于:包括PLB接口模塊、用戶邏輯模塊和中斷控制模塊,所述的PLB接口模塊通過地址/數據信號線和控制信號線與PLB總線相連接,該PLB接口模塊通過IPIC接口與用戶邏輯模塊及中斷控制模塊相連接;所述的用戶邏輯模塊和中斷控制模塊之間通過中斷控制信號線IntrEvent相連接實現中斷控制功能,用戶邏輯模塊還通過地址/數據信號線和控制信號線與SJA1000獨立CAN控制器相連接;中斷控制模塊通過Intr2Bus_DevIntr信號連接CPU。?
2.根據權利要求1所述的基于PLB總線的SJA1000接口IP核,其特征在于:所述的PLB接口模塊、用戶邏輯模塊、中斷控制模塊內置于FPGA內。?
3.根據權利要求2所述的基于PLB總線的SJA1000接口IP核,其特征在于:所述的CPU種類包括MicroBlaze軟核CPU,并內置于FPGA內。?
4.根據權利要求1至3任一項所述的基于PLB總線的SJA1000接口IP核,其特征在于:所述的用戶邏輯模塊由讀寫狀態機和地址數據選擇模塊連接構成,讀寫狀態機通過IPIC控制信號IPIC?Control?Signals同PLC接口模塊之間進行雙向數據傳送;所述的地址/數據選擇模塊通過地址線Address?Bus、數據線Data?Bus同PLB接口模塊之間進行雙向數據傳送。?
5.根據權利要求4所述的基于PLB總線的SJA1000接口IP核,其特征在于:所述的PLB接口模塊為PLB總線自帶的接口模塊。?
6.根據權利要求4所述的基于PLB總線的SJA1000接口IP核,其特征在于:所述的用戶邏輯模塊包括如下輸入信號:來自PLB接口模塊的時鐘信號Bus_2IP_Clk、復位信號Bus2IP_Reset、地址信號Bus2IP_Addr[4:0]、數據信號Bus2IP_Data[24:31]以及來自SJA1000獨立CAN控制器的中斷信號INT、數據信號DATA[7:0];所述的用戶邏輯模塊包括如下輸出信號:發送給PLB接口模塊的中斷信號IP2Bus_IntrEvent、應答信號IP2Bus_Ack、數據信號Bus2IP_Data[24:31],發送給SJA1000獨立CAN控制器的地址/數據信號DATA[7:0]、地址使能信號ALE、片選信號CS、讀寫信號RD/WR、復位信號RST以及向中斷控制模塊發送的中斷事件信號IntrEvent。?
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