[發明專利]一種適合不同位寬數據的存儲裝置有效
| 申請號: | 201310701576.6 | 申請日: | 2013-12-18 |
| 公開(公告)號: | CN103680600A | 公開(公告)日: | 2014-03-26 |
| 發明(設計)人: | 楊立杰;史雄偉;張偉楠;胡志臣;李浩璧 | 申請(專利權)人: | 北京航天測控技術有限公司 |
| 主分類號: | G11C11/4063 | 分類號: | G11C11/4063 |
| 代理公司: | 工業和信息化部電子專利中心 11010 | 代理人: | 田俊峰 |
| 地址: | 100041 *** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 適合 同位 數據 存儲 裝置 | ||
技術領域
本發明涉及數據存儲技術領域,特別是涉及一種適合不同位寬數據的存儲裝置。
背景技術
對于多通道的數字量高速采集模塊,由于總線帶寬限制,不能將數據實時傳送到上位機,因此需要將采集到的數據先進行緩存,待采集結束后由上位機讀取數字量數據,進行后續數據處理和分析。在使用過程中,采集的通道數需要用戶任意配置,然而所使用的大容量存儲器位數一般都是固定的。因此,不論配置的通道數是多少,都將固定位寬的數據送入存儲器。如果輸入通道數小于該位寬數,則將高位寫入0,這樣思路簡單、配置靈活,但是缺點也是顯而易見的,只有在配置的輸入通道數或輸出通道數與存儲器的位寬相同時,才能夠有效的利用存儲器空間。當配置的通道數少于確定的位寬數時,就會浪費大部分存儲空間,因此,現有技術存在在采集數據時經常造成存儲器空間浪費的問題;尤其是對于要求大數據量緩存的場合,需要的存儲器容量增大會顯著提高成本。因此,對采集到的不同位寬的數據進行有效存儲、提高存儲效率、降低成本成為設計需求。
發明內容
本發明要解決的技術問題是提供一種適合不同位寬數據的存儲裝置,用以解決現有技術在采集數據時經常造成存儲器空間浪費的問題。
為解決上述技術問題,本發明提供一種適合不同位寬數據的存儲裝置,包括:
DI數據采集單元、DI數據輸出單元、數據輸入預存儲單元、數據輸出預存儲單元、數據量調整控制邏輯單元、數據讀寫控制邏輯單元和同步動態隨機存儲器SDRAM控制器;其中,DI數據采集單元的每通道的DI數據采集位數與DI數據輸出單元的輸出位數由數據量調整控制邏輯單元確定,DI數據采集單元采集到的數據先寫入數據輸入預存儲單元,數據讀寫控制邏輯單元讀取數據輸入預存儲單元的數據并寫入SDRAM控制器;數據讀寫控制邏輯單元讀取SDRAM控制器中的數據,并將讀取的數據輸出至數據輸出預存儲單元,并最終由DI數據輸出單元輸出。
進一步,DI數據采集單元用于采集DI數據,將N個單比特數據流寫入數據輸入預存儲單元;每個通道對應一單比特數據流,每個數據流中包含的數據個數相同;DI數據輸出單元用于將數據輸出預存儲單元中的數據恢復成單獨位寬的數據流。
進一步,數據量調整控制邏輯單元,用于根據配置調整DI數據采集單元需要采集的數據量;如果要采集的數據量是SDRAM控制器輸入數據位數的整數倍,則不調整該數據量;如果不是,則將要采集的數據量增加至SDRAM控制器輸入數據位數的整數倍。
進一步,數據輸入預存儲單元包括M個1位輸入N位輸出的先入先出隊列FIFO;其中,每個FIFO容量為2N個字;每一個FIFO對應一個單比特數據流;采集的DI通道數即最大位寬為M,SDRAM控制器輸入數據位數也為N。
進一步,數據輸出預存儲單元包括M個N位輸入1位輸出的FIFO;每個FIFO容量為2N個字;每一個FIFO輸出一個單比特數據流。
進一步,數據讀寫控制邏輯單元,用于根據DI總位寬,讀取數據輸入預存儲單元的數據,并調整SDRAM控制器的地址,向SDRAM控制器發送寫命令,將數據寫入SDRAM控制器。
進一步,數據讀寫控制邏輯單元進行寫控制具體如下:
當數據輸入預存儲單元中至少有一個FIFO存儲有數據時,數據讀寫控制邏輯單元依次讀取每個非空FIFO中的數據,并依次將固定位寬的數據寫入SDRAM控制器,直至將數據輸入預存儲單元中所有FIFO中的數據都寫入到SDRAM控制器。
進一步,數據讀寫控制邏輯單元還用于向SDRAM控制器發送讀取命令,從SDRAM中讀取數據,然后將讀取的數據寫入數據輸出預存儲單元內。
進一步,當數據輸出預存儲單元中所有的FIFO均有設定容量的存儲空間時,則數據讀寫控制邏輯單元向SDRAM控制器發送讀命令,讀取數據后,調整地址,將讀取的數據寫入數據輸出預存儲單元對應的FIFO中。
本發明有益效果如下:
本發明的存儲裝置,適用于多通道不同位寬的數據高速采集和存儲;可提高存儲效率,降低成本;具有通用性,能夠適應不同類型的存儲器。
附圖說明
圖1是本發明實施例中一種適合不同位寬數據的存儲裝置結構示意圖;
圖2是本發明實施例中數據輸入預存儲單元的結構示意圖;
圖3是本發明實施例中數據輸出預存儲單元的結構示意圖;
圖4是本發明實施例中數據讀寫控制邏輯單元進行數據讀控制邏輯的流程圖;
圖5是本發明實施例中數據讀寫控制邏輯單元進行數據寫控制邏輯的流程圖。
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