[發明專利]產生任意頻率方波的累加計數器分頻方法無效
| 申請號： | 201310672103.8 | 申請日： | 2013-12-11 |
| 公開（公告）號： | CN103633996A | 公開（公告）日： | 2014-03-12 |
| 發明（設計）人： | 常鐸;董衛虎 | 申請（專利權）人： | 中國船舶重工集團公司第七〇五研究所 |
| 主分類號： | H03K23/00 | 分類號： | H03K23/00 |
| 代理公司： | 西北工業大學專利中心 61204 | 代理人： | 王鮮凱 |
| 地址： | 710075 陜西*** | 國省代碼： | 陜西;61 |
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| 摘要： | |||
| 搜索關鍵詞： | 產生 任意 頻率 方波 累加 計數器 分頻 方法 | ||
【權利要求書】：
1.一種產生任意頻率方波的累加計數器分頻方法，其特征在于包括以下步驟：
步驟一、根據公式將計數器的模值設置與輸入時鐘的輸入相等，這樣累加計數器的步長就在數字上和輸出的頻率值相等；式中，clk_in是輸入的時鐘頻率，clk_out是需要輸出的脈沖頻率，N是累加計數器的模值，STEP是累加計數器的步長；
步驟二、每輸入一個時鐘上升沿，就給計數器的值加STEP，這樣計次時輸出脈沖進行一次翻轉，在值不為整數時，將多余的數累加到下一次計數周期中，這樣產生的脈沖是相鄰兩個分頻比脈沖交錯產生，通過將計數差值累加到下一次，自動切換分頻比；
步驟三、根據計算的方法列寫出實現分頻的表達式，根據表達式列寫出程序；
步驟四、在賽靈思公司的ISE平臺上利用Verilog語言編寫程序；
步驟五、將編好的程序下載到目標芯片中。
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