[發明專利]在浮點操作中功率降低的方法有效
| 申請號: | 201310596158.5 | 申請日: | 2013-11-21 |
| 公開(公告)號: | CN103838549B | 公開(公告)日: | 2017-11-03 |
| 發明(設計)人: | 戴維·孔拉爾·坦倫包姆;科林·斯普林克爾;斯圖爾特·F·奧伯曼;蕭耀明;斯里尼瓦桑·耶爾;恩池·顏·孔 | 申請(專利權)人: | 輝達公司 |
| 主分類號: | G06F9/302 | 分類號: | G06F9/302 |
| 代理公司: | 北京市磐華律師事務所11336 | 代理人: | 謝栒,魏寧 |
| 地址: | 美國加利*** | 國省代碼: | 暫無信息 |
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| 摘要: | |||
| 搜索關鍵詞: | 浮點 操作 功率 降低 方法 | ||
1.一種用于使能在浮點操作中功率降低的計算機實現的方法,所述方法包括:
接收浮點數,包括混合乘加指令的操作數A、操作數B和操作數C,其中所述混合乘加指令表示為所述操作數A乘以所述操作數B加上所述操作數C;
確定所述混合乘加指令針對浮點數不要求遵從精度標準;
通過將所述操作數C的指數與所述操作數A的指數和所述操作數B的指數的和相比較來檢查操作數的指數;
基于檢查所述操作數的所述指數,生成選通信號用于集成電路,其中所述集成電路配置為實施所述混合乘加指令的操作,并且通過標識所述操作數C的低階位以及所述操作數A乘以所述操作數B的積的低階位中的至少一個來生成所述選通信號,在不要求遵從所述精度標準的情況下,所述操作數C的低階位以及所述操作數A乘以所述操作數B的積的低階位中的至少一個是不必要的;以及
將所述選通信號發送到所述集成電路以關閉包括在所述集成電路中并與所述操作數C的低階位以及所述操作數A與所述操作數B的所述積的低階位中的至少一個相關聯的多個邏輯門。
2.一種用于使能在浮點操作中功率降低的運算子系統,所述運算子系統包括檢查器設備,所述檢查器設備包括邏輯設備,并且所述檢查器設備:
接收浮點數,包括混合乘加指令的操作數A、操作數B和操作數C,其中所述混合乘加指令表示為所述操作數A乘以所述操作數B加上所述操作數C;
確定所述混合乘加指令針對浮點數不要求遵從精度標準;
通過將所述操作數C的指數與所述操作數A的指數和所述操作數B的指數的和相比較來檢查操作數的指數;
基于檢查所述操作數的所述指數,生成選通信號用于集成電路,其中所述集成電路配置為實施所述混合乘加指令的操作,并且通過標識所述操作數C的低階位以及所述操作數A乘以所述操作數B的積的低階位中的至少一個來生成所述選通信號,在不要求遵從所述精度標準的情況下,所述操作數C的低階位以及所述操作數A乘以所述操作數B的積的低階位中的至少一個是不必要的;以及
將所述選通信號發送到所述集成電路以關閉包括在所述集成電路中并與所述操作數C的低階位以及所述操作數A與所述操作數B的所述積的低階位中的至少一個相關聯的多個邏輯門。
3.根據權利要求2所述的運算子系統,進一步包括混合乘加設備,其配置為:
經由所述選通信號關閉包括在所述集成電路中的所述多個邏輯門;以及
實施與所述指令相關聯的一個或多個操作而不考慮遵從所述精度標準。
4.根據權利要求2所述的運算子系統,其中所述精度標準包括電氣和電子工程師協會(IEEE)754、IEEE 754-1985、IEEE 854-1987和IEEE 754-2008中的至少一個。
5.根據權利要求2所述的運算子系統,其中確定所述混合乘加指令不要求遵從所述精度標準包括接收用于所述混合乘加指令的操作模式,所述操作模式與以下各項中的至少一個相關聯:
接收自用戶輸入設備的手動超控;
指示所述混合乘加指令不要求遵從所述精度標準的編譯器通信;以及
指示應用不要求遵從所述精度標準的應用通信。
6.根據權利要求2所述的運算子系統,其中確定所述混合乘加指令不要求遵從所述精度標準與要求小于所述精度標準的圖形渲染的特定應用相關聯。
7.根據權利要求2所述的運算子系統,進一步包括混合乘加設備,所述混合乘加設備配置為通過使用基于一個或多個部分積的乘法器陣列將所述操作數A乘以所述操作數B,并且其中所述檢查器設備進一步配置為標識所述部分積的低階位和所述部分積的高階位,并且其中所述混合乘加設備進一步配置為斷開所述部分積的所述低階位的觸發器。
8.根據權利要求2所述的運算子系統,其中所述檢查器設備進一步配置為通過由確定所述操作數C的指數極大于所述操作數A的指數和所述操作數B的指數的和來檢查操作數的指數而生成所述選通信號,并且其中所述運算子系統進一步包括混合乘加設備,所述混合乘加設備配置為斷開所述集成電路的配置為將所述操作數A乘以所述操作數B的觸發器。
9.根據權利要求2所述的運算子系統,其中所述檢查器設備進一步配置為通過檢查操作數的指數生成所述選通信號,并且其中檢查操作數的指數包括確定操作數C的指數極小于操作數A的指數加上操作數B的指數的和,并且其中所述運算子系統進一步包括混合乘加設備,所述混合乘加設備配置為斷開所述集成電路的配置為加上所述操作數C的觸發器。
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