[發明專利]響應指令執行舍入運算在審
| 申請號: | 201310524726.0 | 申請日: | 2007-09-21 |
| 公開(公告)號: | CN103593165A | 公開(公告)日: | 2014-02-19 |
| 發明(設計)人: | R.埃克索哈;S.斯托里 | 申請(專利權)人: | 英特爾公司 |
| 主分類號: | G06F9/302 | 分類號: | G06F9/302;G06F9/318 |
| 代理公司: | 中國專利代理(香港)有限公司 72001 | 代理人: | 湯春龍 |
| 地址: | 美國加利*** | 國省代碼: | 美國;US |
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| 摘要: | |||
| 搜索關鍵詞: | 響應 指令 執行 運算 | ||
1.一種處理器,包括:
控制器,對用戶級舍入指令做出響應,如果缺省舍入模式將被替換,該控制器從用戶級舍入指令的立即操作數中確定舍入模式,其中用戶級舍入指令包括識別源操作數的第一字段,識別目的操作數的第二字段和識別立即操作數的立即字段,其中立即操作數包括指示舍入模式的模式字段和指示缺省舍入模式是否將被替換的替換指示符;
第一擴展XMM寄存器,用于存儲具有多個打包的雙精度浮點值的目的操作數;
第二擴展XMM寄存器,用于存儲具有多個打包的雙精度浮點值的源操作數;
多媒體擴展控制和狀態寄存器,用于存儲缺省舍入模式;和
浮點單元,耦合到控制器和第一和第二擴展XMM寄存器,用于按照舍入模式對源操作數執行舍入運算并將舍入的源操作數寫入第一擴展XMM寄存器。
2.如權利要求1所述的處理器,其特征在于,立即操作數進一步包括指示處理器如何處理精度異常的精度抑制指示符。
3.如權利要求1所述的處理器,其特征在于,所述浮點單元還包括:
浮點加法器,用來根據所述舍入模式來把預定值加到所述源操作數上;和
浮點舍入器,用于對加法結果進行舍入運算。
4.如權利要求3所述的處理器,其特征在于,根據將被舍入的源操作數和所述舍入模式來確定所述預定值。
5.如權利要求1所述的處理器,其特征在于,所述舍入模式包括最接近的偶模式、朝-∞模式、朝+∞模式、截斷模式、部分遠離0的模式和向遠離0的方向舍入中的一種模式。
6.一種處理器,包括:
控制器,對用戶級舍入指令做出響應,如果缺省舍入模式將被替換,該控制器從用戶級舍入指令的立即操作數中確定舍入模式,其中用戶級舍入指令包括識別源操作數的第一字段,識別目的操作數的第二字段和識別立即操作數的立即字段,其中立即操作數包括指示舍入模式的模式字段和指示缺省舍入模式是否將被替換的替換指示符;
第一擴展XMM寄存器,用于存儲具有多個雙精度浮點值的目的操作數;
其中具有多個打包的雙精度浮點值的源操作數被存儲在存儲器中;
多媒體擴展控制和狀態寄存器,用于存儲缺省舍入模式;和
浮點單元,耦合到控制器、第一擴展XMM寄存器和存儲器,用于按照舍入模式對源操作數執行舍入運算并將舍入的源操作數寫入第一擴展XMM寄存器。
7.如權利要求6所述的處理器,其特征在于,立即操作數進一步包括指示處理器如何處理精度異常的精度抑制指示符。
8.如權利要求6所述的處理器,其特征在于,所述浮點單元還包括:
浮點加法器,用來根據所述舍入模式來把預定值加到所述源操作數上;和
浮點舍入器,用于對加法結果進行舍入運算。
9.如權利要求8所述的處理器,其特征在于,根據將被舍入的源操作數和所述舍入模式來確定所述預定值。
10.如權利要求6所述的處理器,其特征在于,所述舍入模式包括最接近的偶模式、朝-∞模式、朝+∞模式、截斷模式、部分遠離0的模式和向遠離0的方向舍入中的一種模式。
11.一種處理器,包括:
控制器,對用戶級舍入指令做出響應,如果缺省舍入模式將被替換,該控制器從用戶級舍入指令的立即操作數中確定舍入模式,其中用戶級舍入指令包括識別源操作數的第一字段,識別目的操作數的第二字段和識別立即操作數的立即字段,其中立即操作數包括指示舍入模式的模式字段和指示缺省舍入模式是否將被替換的替換指示符;
第一擴展XMM寄存器,用于存儲具有多個標量雙精度浮點值的目的操作數;
第二擴展XMM寄存器,用于存儲具有多個標量雙精度浮點值的源操作數;
多媒體擴展控制和狀態寄存器,用于存儲缺省舍入模式;和
浮點單元,耦合到控制器和第一和第二擴展XMM寄存器,用于按照舍入模式對源操作數的下雙精度浮點值執行舍入運算并將舍入的源操作數寫入第一擴展XMM寄存器的最低位置,其中將源操作數的上雙精度浮點值寫入第一擴展XMM寄存器,而不改變。
12.如權利要求11所述的處理器,其特征在于,立即操作數進一步包括指示處理器如何處理精度異常的精度抑制指示符。
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