[發明專利]一種無線通信設備頻率綜合器有效
| 申請號: | 201310418073.8 | 申請日: | 2013-09-13 |
| 公開(公告)號: | CN104467832B | 公開(公告)日: | 2017-10-24 |
| 發明(設計)人: | 潘吉華;馬明峰;魏旭;竇立剛 | 申請(專利權)人: | 貴州航天天馬機電科技有限公司 |
| 主分類號: | H03L7/18 | 分類號: | H03L7/18 |
| 代理公司: | 北京路浩知識產權代理有限公司11002 | 代理人: | 谷慶紅 |
| 地址: | 563000 貴州省*** | 國省代碼: | 貴州;52 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 無線通信 設備 頻率 綜合 | ||
技術領域
本發明涉及一種無線通信設備頻率綜合器,屬于無線電通訊技術領域。
背景技術
在通信技術領域,擴、跳頻技術以其低截獲率、保密性好、抗干擾、抗衰落能力強、多址連接靈活、對窄帶信號干擾小等特點,顯示出比其他傳輸體制無與倫比的優越性,而廣泛應用于導航、通信、遙控遙測等各個領域。
現代跳頻數字通信設備越來越復雜,高科技含量越來越高,抗干擾措施越來越來先進,跳頻速率越來越高,因此對通信設備的頻率綜合器提出了更高的要求,頻率合成器是擴頻電臺的關鍵核心部件之一,它的好壞直接影響電臺的通信質量、頻率切換速度、通信建立的速度、抗干擾性能、系統的穩定性、可靠性等。
發明內容
本發明的目的在于提供一種無線通信設備頻率綜合器,克服現有技術的不足,能適應快速跳頻,滿足抗干擾的要求。
本發明的目的是通過以下技術方案來實現的:一種無線通信設備頻率綜合器,它由兩路低頻回路、兩路跳頻回路、一路高中頻回路以及控制回路組成,其中,跳頻回路由DDS器A、鎖相環單元A及濾波單元A組成,高中頻回路由DDS器B、鎖相環單元B及濾波單元B組成,低頻回路由DDS器C及濾波單元C組成,控制回路由CPLD控制器和時鐘源組成,其中,DDS器A有兩個輸出端,其中一個輸出端和鎖相環單元A的輸入端相連,另一個輸出端作為分頻輸出與濾波單元A的輸出端相連,鎖相環單元A的輸出端和濾波單元A的輸入端相連,濾波單元A的輸出端作為跳頻輸出端,DDS器B有兩個輸出端,其中一個輸出端和鎖相環單元B的輸入端相連,鎖相環單元B的輸出端和濾波單元B的輸入端相連,濾波單元B的輸出端作為高中頻輸出端,DDS器C有兩個輸出端,其中一個輸出端與濾波單元C的輸入端相連,另一個輸出端作為低頻輸出與,濾波單元C作為低頻輸出端,DDS器B的另一個輸出端和DDS器C的另一個輸出端同時作為分頻輸出與濾波單元B的輸出端相連,CPLD控制器的輸入端與時鐘源的輸出端相連,CPLD控制器的輸出端分別與DDS器A、DDS器B以及DDS器C相連。
所述的濾波單元A、濾波單元B以及濾波單元C為低通濾波單元。
所述的CPLD控制器采用CPLD芯片。
所述的時鐘源為溫補型晶體振蕩器。
所述的DDS器A、DDS器B以及DDS器C采用AD9851DDS芯片。
本發明的有益效果在于:跳頻采用DDS激勵PLL的方法來實現頻率合成的方案,低頻頻率采用DDS直接產生方式,充分體現軟件無線電的靈活性和可移植性,頻率合成器擁有很快的鎖定時間,而又保證較小的雜散、準確的頻率精度、低的噪位噪聲、優良頻譜純度和寬的跳頻范圍,達到了較高的技術指標。
附圖說明
圖1為本發明的結構示意圖;
圖2為本發明跳頻回路的流程圖;
圖3為本發明向DDS控制器輸入頻率控制的時序圖。
其中,1-DDS器A,2-鎖相環單元,3-濾波單元A,4-DDS器B,5-鎖相環單元B,6-濾波單元B,7-DDS器C,8-濾波單元C,9-CPLD控制器,10-時鐘源。
具體實施方式
下面結合附圖進一步描述本發明的技術方案,但要求保護的范圍并不局限于所述。
如圖1,一種無線通信設備頻率綜合器,它由兩路低頻回路、兩路跳頻回路、一路高中頻回路以及控制回路組成,其中,跳頻回路由DDS器A1、鎖相環單元A2及濾波單元A3組成,高中頻回路由DDS器B4、鎖相環單元B5及濾波單元B6組成,低頻回路由DDS器C7及濾波單元C8組成,控制回路由CPLD控制器9和時鐘源10組成,其中,DDS器A1有兩個輸出端,其中一個輸出端和鎖相環單元A2的輸入端相連,另一個輸出端作為分頻輸出與濾波單元A3的輸出端相連,鎖相環單元A2的輸出端和濾波單元A3的輸入端相連,濾波單元A3的輸出端作為跳頻輸出端,DDS器B4有兩個輸出端,其中一個輸出端和鎖相環單元B5的輸入端相連,鎖相環單元B5的輸出端和濾波單元B6的輸入端相連,濾波單元B6的輸出端作為高中頻輸出端,DDS器C7有兩個輸出端,其中一個輸出端與濾波單元C8的輸入端相連,另一個輸出端作為低頻輸出與,濾波單元C8作為低頻輸出端,DDS器B4的另一個輸出端和DDS器C7的另一個輸出端同時作為分頻輸出與濾波單元B6的輸出端相連,CPLD控制器9的輸入端與時鐘源10的輸出端相連,CPLD控制器9的輸出端分別與DDS器A1、DDS器B4以及DDS器C7相連。
所述的濾波單元A3、濾波單元B6以及濾波單元C8為低通濾波單元。
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