[發明專利]陣列基板及其制作方法、顯示裝置有效
| 申請號: | 201310149512.X | 申請日: | 2013-04-26 |
| 公開(公告)號: | CN103219319A | 公開(公告)日: | 2013-07-24 |
| 發明(設計)人: | 李凡;董向丹 | 申請(專利權)人: | 京東方科技集團股份有限公司;成都京東方光電科技有限公司 |
| 主分類號: | H01L23/522 | 分類號: | H01L23/522;H01L27/12;H01L21/77;H01L21/768 |
| 代理公司: | 北京銀龍知識產權代理有限公司 11243 | 代理人: | 許靜;黃燦 |
| 地址: | 100015 *** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 陣列 及其 制作方法 顯示裝置 | ||
技術領域
本發明涉及顯示領域,特別是指一種陣列基板及其制作方法、顯示裝置。
背景技術
現有液晶顯示器中,柵掃描線一般是從上而下成行排列,數據線一般是從左到右成列排列。由于液晶顯示器的驅動集成電路(IC)一般設計在屏幕的下方,這樣對于連接驅動集成電路與每一行柵掃描線的連接線來說,連接線的寬度相同,長度不同,因此造成了不同連接線電阻的差異比較大,容易產生RC?delay(電阻電容延遲),導致柵極驅動信號的上升沿和下降沿都有一定的延時。
如果柵極驅動信號的延時比較嚴重,那么當第n行柵掃描線的柵極驅動信號GATE1正處于下降沿時,第n+1行柵掃描線的柵極驅動信號GATE2已經開始上升。則第n行柵掃描線對應的各個TFT還沒有全部關斷,第n+1行柵掃描線上的各個TFT已經開啟,數據驅動器開始向第n+1行柵掃描線上的各個TFT輸出數據信號,造成與輸出到第n行柵掃描線對應的各個TFT的數據信號發生混淆,影響畫面顯示。
發明內容
本發明要解決的技術問題是提供一種陣列基板及其制作方法、顯示裝置,能夠降低連接線間的電阻差異,改善RC?delay現象,提高顯示裝置的顯示效果。
為解決上述技術問題,本發明的實施例提供技術方案如下:
一方面,提供一種陣列基板,包括驅動集成電路、布置在像素區域的多條金屬走線以及分別連接所述驅動集成電路與每一金屬走線的多條連接線,其中,每一連接線包括一主連接線和與所述主連接線對應的輔連接線,所述輔連接線與所述主連接線的一部分并聯連接。
進一步地,上述方案中,所述主連接線與所述輔連接線位于不同層,且所述主連接線與所述輔連接線之間隔有絕緣層,所述主連接線與所述輔連接線通過過孔相連接。
進一步地,上述方案中,所述陣列基板的扇形走線區包括有第一區域和第二區域,所述第一區域走線間的橫向距離小于1um,所述第二區域走線間的橫向距離大于5um,其中,所述輔連接線位于所述第二區域中。
進一步地,上述方案中,所述主連接線與對應輔連接線連接的兩個過孔中,其中一個過孔設置在所述第二區域主連接線由斜向轉為垂直走向的轉折處,另一個過孔設置在像素的靜電保護區域。
進一步地,上述方案中,在所述驅動集成電路設置在陣列基板的下方時,所述連接線連接所述驅動集成電路和陣列基板上成行排列的柵掃描線,其中,所述主連接線為采用柵金屬層制成,與其對應的輔連接線為采用源漏金屬層制成。
進一步地,上述方案中,在所述驅動集成電路設置在陣列基板的側邊時,所述連接線連接所述驅動集成電路和陣列基板上成列排列的數據線,其中,所述主連接線為采用源漏金屬層制成,與其對應的輔連接線為采用柵金屬層制成。
本發明實施例還提供了一種顯示裝置,包括如上所述的陣列基板。
本發明實施例還提供了一種陣列基板的制作方法,所述陣列基板包括驅動集成電路、布置在像素區域的多條金屬走線,其中,所述方法包括:
通過構圖工藝形成分別連接所述驅動集成電路與每一金屬走線的多條連接線的圖形,所述連接線的圖形包括主連接線的圖形和與所述主連接線對應的輔連接線的圖形,所述輔連接線與所述主連接線的一部分并聯連接。
進一步地,上述方案中,在所述驅動集成電路設置在陣列基板的下方,所述連接線連接所述驅動集成電路和陣列基板上成行排列的柵掃描線時,所述方法包括:
利用柵金屬層形成柵掃描線和主連接線的圖形;
形成柵絕緣層,通過構圖工藝在所述柵絕緣層上形成過孔圖形;
利用源漏金屬層形成數據線和輔連接線的圖形,使得所述主連接線與所述輔連接線通過所述過孔相連接。
進一步地,上述方案中,在所述驅動集成電路設置在陣列基板的側邊,所述連接線連接所述驅動集成電路和陣列基板上成列排列的數據線時,所述方法包括:
利用柵金屬層形成柵掃描線和輔連接線的圖形;
形成柵絕緣層,通過構圖工藝在所述柵絕緣層上形成過孔圖形;
利用源漏金屬層形成數據線和主連接線的圖形,使得所述主連接線與所述輔連接線通過所述過孔相連接。
本發明的實施例具有以下有益效果:
上述方案中,連接驅動集成電路與每一金屬走線的連接線包括一主連接線和與所述主連接線對應的輔連接線,所述輔連接線與所述主連接線的一部分并聯連接,這樣通過輔連接線能夠改變各條連接線的電阻值,使得各條連接線之間的電阻值差異變小,改善RC?delay現象,進而提高顯示裝置的顯示效果。
附圖說明
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