[發明專利]實時積分漂移補償交替式積分器及其誤差控制方法有效
| 申請號： | 201310094898.9 | 申請日： | 2013-03-22 |
| 公開（公告）號： | CN103199844A | 公開（公告）日： | 2013-07-10 |
| 發明（設計）人： | 劉冬梅;萬寶年;陳波;趙衛忠 | 申請（專利權）人： | 合肥工業大學 |
| 主分類號： | H03K19/00 | 分類號： | H03K19/00 |
| 代理公司： | 安徽合肥華信知識產權代理有限公司 34112 | 代理人： | 余成俊 |
| 地址： | 230009 *** | 國省代碼： | 安徽;34 |
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| 摘要： | |||
| 搜索關鍵詞： | 實時 積分 漂移 補償 交替 積分器 及其 誤差 控制 方法 | ||
1.一種實時積分漂移補償交替式積分器，其特征在于：包括有兩路積分單元，以實時積分漂移補償型積分器作為一個積分單元，兩路積分單元的信號輸入端通過開關模塊一交替與微分信號接通，兩路積分單元分時間段對微分信號進行積分，兩路積分單元輸出的信號分別經開關模塊二交替接入模數轉換器轉換為數字信號，兩路數字信號共同接入現場可編程門陣列，該數字信號在現場可編程門陣列中完成信號的保持及累加，完成積分信號的拼接，最后通過數模轉換器轉換成模擬信號用于輸出。
2.根據權利要求1所述的實時積分漂移補償交替式積分器，其特征在于：所述的開關模塊一、二為雙路單刀雙擲開關。
3.根據權利要求1所述的實時積分漂移補償交替式積分器，其特征在于：所述的模數轉換器和數模轉換器采用采樣位數為16位的雙極性芯片。
4.根據權利要求1所述的實時積分漂移補償交替式積分器，其特征在于：所述的現場可編程門陣列為Altera?公司的Cyclone?II系列FPGA。?
5.一種基于權利要求1所述實時積分漂移補償交替式積分器的控制積分誤差的誤差控制方法，其特征在于，具體包括以下內容：
T為一個工作周期，以nT時刻后的一個周期為例：在nT時刻，積分單元B的輸入接地，積分單元A的輸入接入微分信號，積分單元A已于nT-τ時刻開始進入積分狀態，同時將nT時刻的積分單元B的輸出值VB(nT)保持在FPGA的保持累加器中，在[nT，nT+T/2]時間段內，在FPGA中完成值VB(nT)與積分單元A的輸出值的相加，積分單元B于nT+τ時刻開始進入電容泄放狀態；
在nT+T/2時刻，積分單元A的輸入接地，積分單元B的輸入端接微分信號，積分單元B已于nT+(T/2-τ)時刻開始進入積分狀態，同時將nT+T/2時刻的積分單元A的輸出值VA(nT+T/2)保持在FPGA的保持累加器中，在[nT+T/2，nT+T]時間段內，在FPGA中完成值值VA(nT+T/2)與積分單元B的輸出值的相加，積分單元A于nT+(T/2+τ)時刻開始進入電容泄放狀態。
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