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[發明專利]一種電源控制系統及其實現方法有效

專利信息
申請號: 201310080404.1 申請日: 2013-03-13
公開(公告)號: CN104052146B 公開(公告)日: 2018-03-09
發明(設計)人: 李晨;謝華;梁潔 申請(專利權)人: 國民技術股份有限公司
主分類號: H02J9/06 分類號: H02J9/06
代理公司: 深圳市威世博知識產權代理事務所(普通合伙)44280 代理人: 何青瓦
地址: 518057 廣東省深圳市南山區*** 國省代碼: 廣東;44
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摘要:
搜索關鍵詞: 一種 電源 控制系統 及其 實現 方法
【權利要求書】:

1.一種電源控制系統,其特征在于,所述電源控制系統包括第一輸入端、第二輸入端、輸出端、第一開關模塊、第二開關模塊、第三開關模塊、第四開關模塊、第一開關控制模塊以及第二開關控制模塊,其中所述第一輸入端用于連接外部電源,所述第二輸入端用于連接內部電源,所述第一開關模塊連接于所述第一輸入端與所述輸出端之間,所述第二開關模塊連接于所述第二輸入端與所述輸出端之間,所述第三開關模塊連接于所述第一輸入端與所述第二開關模塊之間,所述第四開關模塊連接于所述第二開關控制模塊與所述第二開關模塊之間,所述第一開關控制模塊連接所述第一輸入端、所述第二輸入端、所述第一開關模塊、所述第三開關模塊以及所述第四開關模塊,所述第二開關控制模塊連接所述第二輸入端,并接收一喚醒信號,當所述第一輸入端上存在外部電源電壓,所述第二輸入端上存在內部電源電壓時,所述第一開關控制模塊控制所述第一開關模塊和所述第三開關模塊導通,并控制所述第四開關模塊截止,以使得所述外部電源電壓經所述第一開關模塊輸出至所述輸出端,并經所述第三開關模塊控制所述第二開關模塊截止,當所述第一輸入端上不存在外部電源電壓,所述第二輸入端上存在內部電源電壓時,所述第一開關控制模塊控制所述第一開關模塊和所述第三開關模塊截止,并控制所述第四開關模塊導通,所述第二開關控制模塊將所述喚醒信號經所述第四開關模塊輸出至所述第二開關模塊,以由所述喚醒信號控制所述第二開關模塊導通或截止。

2.根據權利要求1所述的電源控制系統,其特征在于,所述第一開關模塊、所述第二開關模塊、所述第三開關模塊和所述第四開關模塊分別包括至少一開關元件及至少一反向隔離元件,所述反向隔離元件用于防止電流經所述開關元件反向流通。

3.根據權利要求1所述的電源控制系統,其特征在于,所述電源控制系統進一步包括電壓轉換模塊,所述電壓轉換模塊連接于所述第一開關模塊和所述輸出端之間,以對經所述第一開關模塊輸出的外部電源電壓進行電壓轉換。

4.根據權利要求1所述的電源控制系統,其特征在于,所述第一開關模塊包括第一PMOS管和第二PMOS管,所述第一PMOS管的漏極與所述第二PMOS管的漏極連接,所述第一PMOS管的源極連接所述第一輸入端,所述第二PMOS管的源極連接所述輸出端,所述第一PMOS管和所述第二PMOS管的柵極連接所述第一開關控制模塊。

5.根據權利要求4所述的電源控制系統,其特征在于,所述第二開關模塊包括第三PMOS管和第四PMOS管,所述第三PMOS管的漏極與所述第四PMOS管的漏極連接,所述第三PMOS管的源極連接所述第二輸入端,所述第四PMOS管的源極連接所述輸出端,所述第三PMOS管和所述第四PMOS管的柵極連接所述第三開關模塊和第四開關模塊。

6.根據權利要求5所述的電源控制系統,其特征在于,所述第三開關模塊包括第五PMOS管和第六PMOS管,所述第五PMOS管的漏極與所述第六PMOS管的漏極連接,所述第五PMOS管的源極連接所述第一輸入端,所述第六PMOS管的源極連接所述第三PMOS管和所述第四PMOS管的柵極,所述第五PMOS管和所述第六PMOS管的柵極連接所述第一開關控制模塊。

7.根據權利要求6所述的電源控制系統,其特征在于,所述第四開關模塊包括第七PMOS管、第八PMOS管以及第一NMOS管,所述第七PMOS管的漏極與所述第八PMOS管的漏極連接,所述第七PMOS管的源極連接所述第一NMOS管的漏極,所述第八PMOS管的源極和所述第一NMOS管的源極連接所述第三PMOS管和所述第四PMOS管的柵極,所述第七PMOS管和第八PMOS管的柵極連接所述第一輸入端,所述第一NMOS管的柵極連接所述第一開關控制模塊,所述第二開關控制模塊將所述喚醒信號輸入至所述第一NMOS管的漏極。

8.根據權利要求7所述的電源控制系統,其特征在于,所述第一開關控制模塊包括第一電阻、第二電阻和第二NMOS管,所述第一電阻的一端連接所述第一輸入端,所述第一電阻的另一端接地,所述第二電阻的一端連接所述第二輸入端,所述第二電阻的另一端連接所述第二NMOS管的漏極,所述第二NMOS管的源極接地,所述第二NMOS管的柵極連接所述第一輸入端,所述第一PMOS管、所述第二PMOS管、所述第五PMOS管、所述第六PMOS管以及所述第一NMOS管的柵極連接于所述第二電阻的另一端與所述第二NMOS管的漏極之間。

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