[發明專利]用于將浮點值四舍五入為整數浮點值的裝置和方法有效
| 申請號: | 201280060336.6 | 申請日: | 2012-11-29 |
| 公開(公告)號: | CN103988170A | 公開(公告)日: | 2014-08-13 |
| 發明(設計)人: | 大衛·雷蒙德·魯茨;內爾·伯吉斯;薩布琳娜·瑪麗·羅梅洛 | 申請(專利權)人: | ARM有限公司 |
| 主分類號: | G06F7/499 | 分類號: | G06F7/499 |
| 代理公司: | 北京東方億思知識產權代理有限責任公司 11258 | 代理人: | 李曉冬 |
| 地址: | 英國*** | 國省代碼: | 英國;GB |
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| 摘要: | |||
| 搜索關鍵詞: | 用于 浮點 四舍五入 整數 裝置 方法 | ||
1.一種數據處理裝置,包括:
處理電路,被配置來執行用于將浮點值四舍五入為整數浮點值的四舍五入為整數浮點操作,所述浮點值具有有效位數和指數;以及
控制電路,被配置來控制所述處理電路,以執行所述四舍五入為整數浮點操作來響應對浮點四舍五入為整數浮點指令的執行;
所述處理電路包括:
移位電路,被配置來通過將基值移位移位量來生成四舍五入值,其中所述移位量依賴于所述浮點值的所述指數;
加和電路,被配置來將所述四舍五入值加至所述浮點值的所述有效位數以生成和值;
掩碼生成電路,被配置來生成用于清除所述和值的具有與所述有效位數的小數值位位置相對應的位位置的位的掩碼;以及
掩蔽電路,被配置來將所述掩碼應用于所述和值來生成所述整數浮點值。
2.如權利要求1所述的數據處理裝置,其中,所述移位電路被配置來將所述基值向右移位來生成所述四舍五入值。
3.如權利要求1和2中任意一項所述的數據處理裝置,其中,所述四舍五入值在與所述浮點值的所述有效位數的最高有效小數值位的位位置相對應的位位置處具有首非零位。
4.如權利要求1-3中任意一項所述的數據處理裝置,其中:
所述基值具有非零值的最高有效位;并且
所述移位電路被配置來將所述基值向右移位(E-BIAS+1)位位置的移位量,其中,E是所述浮點值的所述指數,并且,BIAS是所述浮點值的指數偏移。
5.如權利要求1-4中任意一項所述的數據處理裝置,其中,所述掩蔽電路包括AND門,該AND門被配置來將按位AND操作應用到所述和值和所述掩碼。
6.如權利要求5所述的數據處理裝置,其中,所述掩碼的位在與所述有效位數的小數值位位置相對應的位位置處具有位值0。
7.如權利要求6所述的數據處理裝置,其中,所述掩碼的位在與所述有效位數的整數值位位置相對應的位位置處具有位值1。
8.如權利要求1-7中任意一項所述的數據處理裝置,其中,所述掩碼生成電路被配置來基于所述四舍五入值生成所述掩碼。
9.如權利要求1-8中任意一項所述的數據處理裝置,其中,響應于對浮點加和指令的執行,所述控制電路被配置來控制所述處理電路,以使用所述移位電路和所述加和電路來執行加和操作。
10.如權利要求1-9中任意一項所述的數據處理裝置,其中,所述處理電路具有至少一種四舍五入模式,該模式用于在所述四舍五入為整數浮點操作期間,當所述浮點值是介于兩個整數浮點值之間的值時,選擇將所述浮點值四舍五入為所述兩個整數浮點值中的哪一個。
11.如權利要求10所述的數據處理裝置,其中,所述處理電路具有多種四舍五入模式,所述浮點四舍五入為整數浮點指令指定所述多種四舍五入模式中的哪種應該被用于所述四舍五入為整數浮點操作。
12.如權利要求10和11中任意一項所述的數據處理裝置,其中,所述處理電路具有遠離零四舍五入(RU)四舍五入模式,該模式用于將所述浮點值四舍五入為所述兩個整數浮點值中具有最大絕對量值的那一個。
13.如權利要求12所述的數據處理裝置,其中,在所述RU四舍五入模式中,所述基值的所有位具有非零位值。
14.如權利要求10-13中任意一項所述的數據處理裝置,其中,所示處理電路具有四舍五入為最接近、靠近偶數(RNE)四舍五入模式,該模式用于將所述浮點值四舍五入為所述兩個整數浮點值中最接近的,同時將位于所述兩個整數浮點值正中間的浮點值四舍五入為所述兩個整數浮點值中是偶數值的那個。
15.如權利要求14所述的數據處理裝置,其中,在所述RNE四舍五入模式中,所述基值的最高有效位具有非零位值,并且,所述基值的剩余位具有零位值。
16.如權利要求14和15中任意一項所述的數據處理裝置,其中,在所述RNE四舍五入模式中,如果所述浮點值位于所述兩個整數浮點值正中間,并且所述有效位數的最低有效整數值位具有0位值,那么,所述掩碼生成電路被配置來修正所述掩碼,并且所述掩蔽電路被配置來將所述修正的掩碼應用到所述和值來清除所述和值的具有與所述有效位數的所述最低有效整數值位相對應的位位置的那一位。
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