[實(shí)用新型]一種去諧波時(shí)鐘電路有效
| 申請?zhí)枺?/td> | 201220701836.0 | 申請日： | 2012-12-18 |
| 公開（公告）號： | CN203027223U | 公開（公告）日： | 2013-06-26 |
| 發(fā)明（設(shè)計(jì)）人： | 周傳剛;段永亮 | 申請（專利權(quán)）人： | 太原斯泰森電子科技有限公司 |
| 主分類號： | H03K5/01 | 分類號： | H03K5/01 |
| 代理公司： | 太原高欣科創(chuàng)專利代理事務(wù)所(普通合伙) 14109 | 代理人： | 冷錦超;鄧東東 |
| 地址： | 030006 *** | 國省代碼： | 山西;14 |
| 權(quán)利要求書： | 查看更多 | 說明書： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 一種 諧波 時(shí)鐘 電路 | ||
【權(quán)利要求書】：
1.一種去諧波時(shí)鐘電路，包括：時(shí)鐘信號源（1）、時(shí)鐘芯片（2）、差分線（3）和終端電阻R1、R2；所述時(shí)鐘信號源（1）的信號輸出端與時(shí)鐘芯片（2）的輸入端相連，所述時(shí)鐘芯片（2）的輸出端通過差分線（3）分別與終端電阻R1和終端電阻R2相連；其特征在于：所述終端電阻R1的一端串接退耦電容C1后接地，終端電阻R1的另一端串接退耦電容C2后接地；所述終端電阻R2的一端串接退耦電容C3后接地，終端電阻R2的另一端串接退耦電容C4后接地。
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