[實用新型]基于FPGA的熱像電視信號編碼器有效
| 申請號: | 201220447625.9 | 申請日: | 2012-09-05 |
| 公開(公告)號: | CN202872987U | 公開(公告)日: | 2013-04-10 |
| 發明(設計)人: | 李鵬;牛慧卓 | 申請(專利權)人: | 山東神戎電子股份有限公司 |
| 主分類號: | H04N9/68 | 分類號: | H04N9/68;H04N9/44 |
| 代理公司: | 濟南泉城專利商標事務所 37218 | 代理人: | 丁修亭 |
| 地址: | 250101 山東省濟南市高新開*** | 國省代碼: | 山東;37 |
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| 摘要: | |||
| 搜索關鍵詞: | 基于 fpga 電視信號 編碼器 | ||
1.一種基于FPGA的熱像電視信號編碼器,其特征在于,由一片FPGA芯片和D/A芯片組成,其中FPGA實現的IP模塊包括:
DCFIFO,用于接收熱像探測器的信號,進行不同時鐘域的數據同步;
色彩空間轉換模塊,連接所述DCFIFO,被接受到的經過DCFIFO同步的熱像探測器的信號轉換成亮度信號和兩路色差信號;
FIR低通濾波器,連接所述色彩空間轉換模塊,把所述兩路色差信號進行低通濾波;
正交調制模塊,連接所述低通濾波器,對經過濾的所述兩路色差信號進行正交調制,生成調制信號;
延遲器,連接所述色彩空間轉換模塊,延遲預定長時間,以使所述亮度信號與同源的所述調制信號同步;
疊加器,兩輸入端相應連接所述正交調整模塊及延遲器,把所述調制信號疊加到同源的亮度信號上;
時序控制多路選擇模塊,輸入腳連接所述DCFIFO、疊加器、正交調制模塊,進行CVBS信號輸出;以及
時鐘模塊,產生系統時鐘,并連接至所述DCFIFO、正交調制器和時序控制多路選擇模塊。
2.根據權利要求1所述的基于FPGA的熱像電視信號編碼器,其特征在于,在所述DCFIFO前級設有偽彩功能模塊。
3.根據權利要求1所述的基于FPGA的熱像電視信號編碼器,其特征在于,所述正交調制模塊包括第一乘法器和第二乘法器,以及第一乘法器和第二乘法器輸出連接的加法器,其中第一乘法器連接所述色彩空間轉換模塊以接收的兩路色差信號中的影像色彩信號,同時,該第一乘法器的另一個輸入端連接一個多路復用器,以復用相位信號、正弦信號和反相位的正弦信號;第二乘法器則連接所述色彩空間轉換模塊以接收與所述影像色彩信號同源的飽和度信號,同時該第二乘法器還連接余弦信號產生器。
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