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[實用新型]一種支持AMD橋片SR5650的雙路主板有效

專利信息
申請號: 201220248650.4 申請日: 2012-05-30
公開(公告)號: CN202795143U 公開(公告)日: 2013-03-13
發明(設計)人: 邵宗有;沙超群;鄭臣明;王英;梁發清 申請(專利權)人: 曙光信息產業股份有限公司
主分類號: G06F1/16 分類號: G06F1/16
代理公司: 北京安博達知識產權代理有限公司 11271 代理人: 徐國文
地址: 300384 天津市西青區華*** 國省代碼: 天津;12
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摘要:
搜索關鍵詞: 一種 支持 amd sr5650 主板
【說明書】:

技術領域

實用新型涉及一種主板,具體涉及一種支持AMD橋片SR5650的雙路主板。

背景技術

目前市場上所見到的都是基于X86架構的主板,也就是說CPU選用的是遵循X86架構的INTEL或者是AMD的,而橋片也都是與X86的CPU搭配的芯片,對于龍芯的CPU來說,他是基于MIPS架構的,目前市場上并沒有一款巧妙與其搭配而形成一塊主板。

龍芯3號系列CPU的出現打破了中國高性能服務器領域無芯的尷尬局面,把中國的IT行業帶上了一個新的高度。但接下來面臨一個嚴峻的問題就是CPU的產業化問題,如果解決不好產業化的問題,那龍芯CPU仍是一個不能實用只是概念意義的CPU,只能停留在實驗室里。由于龍芯3號系列CPU面世的時間短,各種配套的應用方案有待設計和創造。

實用新型內容

針對現有技術的不足,本實用新型提供一種支持AMD橋片SR5650的雙路主板,能夠將龍芯CPU很好的運用到實際中,將AMD?chipsets?SR5650北橋芯片和南橋芯片很好的和龍芯CPU配套使用,結構簡單,穩定性和可靠性都較高。

本實用新型提供的一種支持AMD橋片SR5650的雙路主板,其改進之處在于,所述雙路主板包括AMD?chipsets?SR5650北橋芯片、南橋芯片、內存插槽、VGA接口、PCIE接口、龍芯CPU0和CPU1;

所述AMD?chipsets?SR5650北橋芯片分別與所述南橋芯片和所述龍芯CPU(0)連接;所述南橋芯片通過所述VGA接口與VGA設備連接;所述龍芯CPU(0)和龍芯CPU(1)連接;所述龍芯CPU(0、1)均包括內存控制器;所述內存控制器與所述內存插槽連接;所述龍芯CPU(0、1)均配有CPU散熱器。每個CPU可以最大相連4個內存槽。

其中,所述龍芯CPU0使用DDR2/DDR3內存控制器直接與所述內存插槽連接。

其中,所述龍芯CPU1使用DDR2/DDR3內存控制器直接與所述內存插槽連接。

其中,所述AMD?chipsets?SR5650北橋芯片帶有26個PCIE的通道,所述PCIE通道中4個被用作A_Link總線與所述南橋芯片相連接,其余22條PCIE通道通過所述PCIE接口與PCIE外圍設備連接。

其中,所述南橋芯片通過所述PCI?bus接口與所述VGA設備連接。

其中,所述AMD?chipsets?SR5650北橋芯片通過所述HT總線與所述HT總線控制器連接。

其中,所述龍芯CPU0和龍芯CPU1之間是采用HT?bus進行互聯。

其中,所述龍芯CPU0或龍芯CPU1為4核心3A、8核心3B或8核心/16核心3C的CPU。

其中,所述外設包括聲卡、顯卡和外部存儲器。

與現有技術比,本實用新型的有益效果為:

本實用新型能夠將龍芯CPU很好的運用到實際中,將AMD?chipsets?SR5650北橋芯片和南橋芯片很好的和龍芯CPU配套使用,結構簡單,穩定性和可靠性都較高。

本實用新型為雙CPU結構,其可以擴展性能,且穩定性好。

附圖說明

圖1為本實用新型提供的基于SR5650的雙路主板結構圖。

具體實施方式

下面結合附圖對本實用新型的具體實施方式作進一步的詳細說明。

本實用新型提供的一種支持AMD橋片SR5650的雙路主板結構圖如圖1所示,所述雙路主板包括AMD?chipsets?SR5650北橋芯片、南橋芯片、內存插槽0、內存插槽1、VGA接口、PCIE接口、龍芯CPU0和CPU1;所述AMD?chipsets?SR5650北橋芯片分別與所述南橋芯片和所述龍芯CPU(0)連接;所述南橋芯片通過所述VGA接口與VGA設備連接;所述龍芯CPU(0)和龍芯CPU(1)連接;所述龍芯CPU(0、1)均包括內存控制器;所述內存控制器與所述內存插槽連接;所述龍芯CPU(0、1)均配有CPU散熱器。每個CPU可以最大相連4個內存槽,一個CPU有2個內存控制器,每個控制器連接2條內存槽,所以共計4個,本實施例的兩個龍芯CPU可配置8個內存槽。

所述龍芯CPU0使用DDR2或DDR3內存控制器直接與所述內存插槽0連接。所述龍芯CPU1使用DDR2或DDR3內存控制器直接與所述內存插槽1連接。其中龍芯CPU0和龍芯CPU1之間是采用HT?bus進行互聯。龍芯CPU0或龍芯CPU1為4核心3A、8核心3B或8核心/16核心3C的CPU。

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