[發(fā)明專利]柵極掃描器驅動電路及其移位寄存器有效
| 申請?zhí)枺?/td> | 201210570692.4 | 申請日: | 2012-12-25 |
| 公開(公告)號: | CN103150987A | 公開(公告)日: | 2013-06-12 |
| 發(fā)明(設計)人: | 劉立偉;蔡宗廷 | 申請(專利權)人: | 友達光電股份有限公司 |
| 主分類號: | G09G3/20 | 分類號: | G09G3/20;G09G3/32;G11C19/28 |
| 代理公司: | 北京律誠同業(yè)知識產權代理有限公司 11006 | 代理人: | 梁揮;祁建國 |
| 地址: | 中國臺灣新竹科*** | 國省代碼: | 中國臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 柵極 掃描器 驅動 電路 及其 移位寄存器 | ||
技術領域
本發(fā)明涉及一種移位寄存器,尤指涉及一種用于柵極掃描器驅動電路中的移位寄存器。
背景技術
圖1為現(xiàn)有技術顯示面板100的示意圖。顯示面板100包含柵極掃描器驅動電路102及像素陣列112。柵極掃描器驅動電路102包含多級移位寄存器。每一級移位寄存器通過各別的掃描線110,按順序輸出各別的柵極信號至像素陣列112。
圖2為圖1柵極掃描器驅動電路102的時序圖。圖2以圖1的第N-1級移位寄存器104、第N級移位寄存器106及第N+1級移位寄存器108為例,以方便說明。圖2的橫軸為時間t,縱軸為電壓值,從上至下為第二時鐘信號XCK、第一時鐘信號CK、第N-1級移位寄存器104輸出的柵極信號Gn-1、第N級移位寄存器106輸出的柵極信號Gn及第N+1級移位寄存器108輸出的柵極信號Gn+1。于T1時段,第二時鐘信號XCK由低電位上升至高電位,第N-1級移位寄存器104根據(jù)第二時鐘信號XCK的電位輸出高電位柵極信號Gn-1;于T2時段,第一時鐘信號CK由低電位上升至高電位,第N級移位寄存器106根據(jù)第一時鐘信號CK的電位輸出高電位柵極信號Gn;于T3時段,第二時鐘信號XCK再次由低電位上升至高電位,第N+1級移位寄存器108根據(jù)第二時鐘信號XCK的電位輸出高電位柵極信號Gn+1。也即,柵極掃描器驅動電路102中相鄰的移位寄存器中,接收第二時鐘信號XCK及第一時鐘信號CK的輸入節(jié)點的位置需交錯對調以輸出各別的柵極信號,且第N+1級移位寄存器輸出的柵極信號Gn+1在時序上緊接著第N級移位寄存器輸出的柵極信號Gn,即柵極信號Gn+1是柵極信號Gn位移一次的波形。
若要使柵極信號Gn與柵極信號Gn+1相隔半個第一時鐘信號CK周期的時間,也就是柵極信號Gn+1是柵極信號Gn移位兩次的波形,則必須將第N級移位寄存器106的電路重復布局兩次,以達到位移兩次的結果。若要使相鄰的每一級移位寄存器輸出的柵極信號都相隔半個第一時鐘信號CK周期的時間,則每一級移位寄存器都要布局兩組重復的電路,如此會增加柵極掃描器驅動電路102中的移位寄存器內部的元件數(shù)量及所需要的布局空間,不符合當今要縮小顯示面板邊框的趨勢。
發(fā)明內容
本發(fā)明的一實施例揭示一種柵極掃描器驅動電路。該柵極掃描器驅動電路包含第N級移位寄存器及第N+1級移位寄存器。該第N級移位寄存器包含上拉單元、驅動單元、第一下拉單元、第二下拉單元及第三下拉單元。該第N+1級移位寄存器包含上拉單元、驅動單元、第一下拉單元、第二下拉單元及第三下拉單元。
本發(fā)明的另一實施例揭示一種第N級移位寄存器。該第N級移位寄存器包含上拉單元、驅動單元、第一下拉單元、第二下拉單元及第三下拉單元。該上拉單元用以根據(jù)第一時鐘信號、第二時鐘信號及起始信號提供第一上拉信號。該驅動單元用以根據(jù)該第一上拉信號提供驅動信號,及根據(jù)該第一時鐘信號及該驅動信號提供柵極信號。該第一下拉單元用以根據(jù)該第一時鐘信號下拉該第一上拉信號。該第二下拉單元用以根據(jù)第二上拉信號,下拉該驅動信號。該第三下拉單元用以根據(jù)該第二時鐘信號,下拉該柵極信號。
本發(fā)明實施例揭示的每一級移位寄存器不需布局兩組重復的電路,即可輸出前一級移位寄存器的柵極信號移位兩次后的柵極信號,可減少移位寄存器內部的元件數(shù)量及所需要的布局空間。另外,本發(fā)明實施例提供的柵極掃描器驅動電路中的相鄰兩級的移位寄存器耦接第一時鐘信號CK及第二時鐘信號XCK的輸入節(jié)點的位置不需對調,可簡化時鐘信號的設計。
附圖說明
圖1為現(xiàn)有技術顯示面板的示意圖;
圖2為圖1柵極掃描器驅動電路的時序圖;
圖3為本發(fā)明一實施例說明柵極掃描器驅動電路的示意圖;
圖4為本發(fā)明一實施例說明圖3的移位寄存器的示意圖;
圖5為本發(fā)明一實施例說明圖4移位寄存器動作的時序圖;
圖6為本發(fā)明一實施例說明圖3柵極掃描器驅動電路的時序圖;
圖7為本發(fā)明另一實施例說明圖3柵極掃描器驅動電路的時序圖;
圖8為本發(fā)明另一實施例說明移位寄存器的示意圖;
圖9為本發(fā)明一實施例說明圖8的移位寄存器動作的時序圖。
附圖標記
100:顯示面板????????????????102:柵極掃描器驅動電路
112:像素陣列????????????????110:掃描線
104:第N-1級移位寄存器???????106、306:第N級移位寄存器
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