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[發明專利]雙CPU結構智能繞線式電機進相補償控制器及控制方法無效

專利信息
申請號: 201210564183.0 申請日: 2012-12-21
公開(公告)號: CN103023423A 公開(公告)日: 2013-04-03
發明(設計)人: 陳歆技 申請(專利權)人: 東南大學
主分類號: H02P25/02 分類號: H02P25/02
代理公司: 南京蘇高專利商標事務所(普通合伙) 32204 代理人: 柏尚春
地址: 211189 江蘇*** 國省代碼: 江蘇;32
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摘要:
搜索關鍵詞: cpu 結構 智能 繞線式 電機 補償 控制器 控制 方法
【權利要求書】:

1.一種雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:包括主控CPU(1)、CPLD邏輯控制電路(2)、協處理CPU(3)、輸入/輸出接口端(4)、模/數轉換電路(5)、SIM存儲卡接口(6)、存儲器電路(7)、第一晶振(8)、第一復位芯片(9)、第二復位芯片(10)、第二晶振(11)和外部設備(12);所述CPLD邏輯控制電路(2)、輸入/輸出接口端(4)、模/數轉換電路(5)、SIM存儲卡接口(6)、存儲器電路(7)、第一晶振(8)和第一復位芯片(9)均與主控CPU(1)連接;所述模/數轉換電路(5)連接輸入/輸出接口端(4);所述CPLD邏輯控制電路(2)連接輸入/輸出接口端(4)和協處理CPU(3);所述輸入/輸出接口端(4)、第二復位芯片(10)和第二晶振均(11)與協處理CPU(3)連接;所述外部設備(12)連接輸入/輸出接口端(4)。

2.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述外部設備(12)包括電源、液晶顯示板和鍵盤。

3.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述主控CPU(1)讀取預設參數進行初始化;所述模/數轉換電路(5)接收主控CPU(1)指令將系統運行的實時交流電信號轉換為數字量傳輸至主控CPU(1);所述主控CPU(1)采集系統運行電氣量并進行電參數和控制算法的計算,得到晶閘管觸發控制角脈沖信號并輸出;所述主控CPU(1)和協處理CPU(3)通過與CPLD邏輯控制電路(2)接口的配合實現實時數據共享和通信,液晶顯示板、鍵盤連接輸入/輸出接口端通過CPLD邏輯電路(2)與主控CPU(1)和協處理CPU(3)進行互動;所述協處理CPU(1)通過輸入/輸出接口端(4)接收主控CPU(1)輸出的晶閘管觸發控制角脈沖信號計算結果并輸出符合要求的觸發脈沖;所述CPLD邏輯控制電路(2)接收協處理CPU(3)觸發脈沖信號,進行規格化處理通過輸入/輸出接口端(4)輸出到晶閘管。

4.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述主控CPU(1)負責控制算法處理、模/數電路轉換控制、指令參數的調整和設置并與CPLD邏輯電路(2)接口配合,通過液晶顯示板和鍵盤完成人機互動,其中主控CPU(1)設置有標準串行通信口,內置通信協議。

5.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述主控CPU(1)利用SIM存儲卡接口(6)外接SIM存儲卡,可通過SIM存儲卡存放的各種系統配置參數和算法程序模塊進行更新。

6.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述新算法程序模塊可通過SIM存卡下載到主控CPU(1)完成算法程序的更新。

7.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述存儲器(7)存儲預先設置的系統配置參數和算法程序模塊。

8.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述第一晶振、第一復位芯片為主控CPU(1)提供穩定、精確的振蕩頻率和防止主控CPU(1)發出錯誤指令、執行錯誤操作。

9.根據如權利要求1所述的雙CPU結構的智能繞線式電機進相補償控制器,其特征在于:所述第二晶振、第二復位芯片為協處理CPU(3)提供穩定、精確的振蕩頻率和防止協處理CPU(3)發出錯誤指令、執行錯誤操作。

10.雙CPU結構智能繞線式電機進相補償控制方法,其特征在于,包括以下步驟:

(1)打開電源開關,主控CPU(1)讀取預設參數進行初始化,主控CPU(1)向模/數轉換電路(5)發送將系統運行的實時交流電信號轉換為數字量指令;

(2)模/數轉換電路(5)將系統運行的實時交流電信號轉換為數字量傳輸至主控CPU(1);

(3)主控CPU(1)采集系統運行電氣量并進行電參數和控制算法的計算,得到晶閘管觸發控制角脈沖信號并輸出;

(4)協處理CPU(3)通過輸入/輸出接口端(4)接收主控CPU(1)輸出的晶閘管觸發控制角脈沖信號計算結果并輸出符合要求的觸發脈沖;

(5)CPLD邏輯控制電路(2)接收協處理CPU(3)觸發脈沖信號,進行規格化處理通過輸入/輸出接口端(4)輸出到晶閘管。

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