[發明專利]一種陣列基板及其制備方法和顯示裝置有效
| 申請號: | 201210546425.3 | 申請日: | 2012-12-14 |
| 公開(公告)號: | CN102998859A | 公開(公告)日: | 2013-03-27 |
| 發明(設計)人: | 嚴允晟;崔賢植;徐智強;李會 | 申請(專利權)人: | 京東方科技集團股份有限公司 |
| 主分類號: | G02F1/1343 | 分類號: | G02F1/1343;G02F1/1362;H01L27/12;H01L21/77 |
| 代理公司: | 北京銀龍知識產權代理有限公司 11243 | 代理人: | 黃燦;安利霞 |
| 地址: | 100015 *** | 國省代碼: | 北京;11 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 陣列 及其 制備 方法 顯示裝置 | ||
技術領域
本發明涉及液晶顯示技術領域,特別是指一種陣列基板及其制備方法和顯示裝置。
背景技術
如圖1所示,為現有技術中陣列基板的平面圖,陣列基板包括:襯底基板上的柵線10,與所述柵線10垂直排列的數據線20,柵線10和數據線20限定出像素區域,像素區域中包括并排排列的像素電極40、公共電極30以及薄膜晶體管(TFT)50;該種結構的陣列基板的像素區域的長邊是數據線20,短邊是柵線10;數據線40與其上方的公共電極30之間存在交疊電容C2。
如圖2所示,為上述結構的陣列基板中,公共電極30與數據線20、柵線10以及像素電極40之間的電路關系示意圖。
目前大尺寸TV(電視)產品及3D產品是目前電視制造領域的發展趨勢。然而要想實現大尺寸產品及3D產品的順利開發,如產品驅動頻率從60Hz提高至120Hz甚至是240Hz。
然而上述結構圖1所示的陣列基板,由于數據線20與公共電極30之間的交疊電容的存在,像素充電時間短,在高頻率驅動時,會引起公共電極的電壓受影響,從而使產品的畫面產生Greenish(綠附)問題,即使使用SVC電路,也很難克服這樣的問題。
發明內容
本發明要解決的技術問題是提供一種陣列基板及其制備方法和顯示裝置,避免數據線與公共電極之間的交疊電容,從而可以在高頻率驅動下,大大降低Greenish現象。
為解決上述技術問題,本發明的實施例提供一種陣列基板,包括多條柵線、多條數據線、每兩條彼此相鄰的柵線和每兩條彼此相鄰的數據線限定出像素區域,其中所述像素區域設有公共電極,像素電極和薄膜晶體管;所述公共電極包括:獨立進行供電的第一公共電極和所述第二公共電極,所述第一公共電極在所述數據線所在層的投影覆蓋所述數據線,所述第二公共電極在所述像素電極所在層的投影落在所述像素電極上。
其中,所述第一公共電極通過外圍電路中的公共電極供電電路連接,并通過所述公共電極供電電路供電;
所述第二公共電極通過公共電極線供電。
其中,所述第二公共電極位于所述像素電極的上方且與所述數據線不交疊,且所述第二公共電極為狹縫結構,所述像素電極為板狀。
其中,所述第二公共電極位于所述像素電極的下方且與所述數據線不交疊,且所述第二公共電極為板狀,所述像素電極為狹縫結構。
其中,所述公共電極線與所述第二公共電極處于不同層時,所述第二公共電極通過過孔與所述公共電極線連接;
所述公共電極線與所述第二公共電極處于同一層時,所述第二公共電極與所述公共電極線直接連接。
其中,所述柵線與所述數據線垂直交疊,所述像素區域為長方形,所述柵線構成所述像素區域的短邊,所述數據線構成所述像素區域的長邊。
其中,所述柵線與所述數據線垂直交疊的位置具有薄膜晶體管,所述數據線通過所述薄膜晶體管與所述像素電極連接。
本發明的實施例還提供一種陣列基板的制備方法,包括形成包括數據線、像素電極圖形的步驟,還包括:
形成包括第一公共電極和第二公共電極的圖形,所述第一公共電極和所述第二公共電極獨立進行供電,所述第一公共電極在所述數據線所在層的投影覆蓋所述數據線,所述第二公共電極在所述像素電極所在層的投影落在所述像素電極上。
其中,在形成所述第一公共電極的圖形時,所述第一公共電極與外圍電路中的公共電極供電電路連接。
其中,上述方法還包括:
形成公共電極線的圖形的步驟;
在形成所述第二公共電極的圖形時,所述第二公共電極與所述公共電極線連接。
本發明的實施例還提供一種顯示裝置,包括如上所述陣列基板。
本發明的上述技術方案的有益效果如下:
上述方案中,通過形成獨立進行供電的第一公共電極和與所述第二公共電極,所述第一公共電極在所述數據線所在層的投影覆蓋所述數據線,所述第二公共電極在所述像素電極所在層的投影落在所述像素電極上;由于數據線被第一公共電極屏蔽,從而可以避免數據線與第二公共電極的交疊電容的產生,從而可以在高頻率驅動下,大大降低Greenish現象的發生。
附圖說明
圖1為現有技術中陣列基板的平面示意圖;
圖2為圖1所示的陣列基板的公共電極與數據線、柵線以及像素電極之間的電路關系示意圖;
圖3為本發明的陣列基板的平面示意圖;
圖4-圖7為本發明的陣列基板的制作過程示意圖;
圖8為本發明的陣列基板的剖面示意圖;
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