[發明專利]一種3狀態控制信號輸入IO電路有效

申請號：	201210440929.7	申請日：	2012-11-07
公開（公告）號：	CN102931971A	公開（公告）日：	2013-02-13
發明（設計）人：	譚曉強;王志鵬	申請（專利權）人：	長沙景嘉微電子股份有限公司
主分類號：	H03K19/0185	分類號：	H03K19/0185
代理公司：	暫無信息	代理人：	暫無信息
地址：	410205 湖南省長沙***	國省代碼：	湖南;43
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摘要：
搜索關鍵詞：	一種狀態控制信號輸入 io 電路
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【權利要求書】：

1.一種3狀態控制信號輸入IO電路，其特征在于：根據輸入信號的狀態——高電平、低電平或者懸空，利用分壓器件和比較器，可以產生3中對應的輸出狀態，輸入信號IN連接到比較器COMP1的正相輸入端和比較器COMP2的正相端，同時連接到二極管D1的P端和二極管D2的N端，同時連接到電阻R1和R2，電阻R1的另一端連接到VDD，電阻R2的另一端連接到VSS，二極管D1的N端連接到VDD，二極管D2的P端連接到VSS，比較器COMP1的負相輸入端連接到NMOS管M1的源極和電阻R4，電阻R4的另一端連接到VSS，比較器COMP2的負相輸入端連接到NMOS管M1的柵極和漏極以及電阻R3，電阻R3的另一端連接到VDD，比較器COMP1的正相輸出端為O2、負相輸出端為O1，比較器COMP2的正相輸出端為O4、正相輸出端為O3。

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