[發明專利]進位電路和芯片有效
| 申請號： | 201210381379.6 | 申請日： | 2012-10-10 |
| 公開（公告）號： | CN102882509A | 公開（公告）日： | 2013-01-16 |
| 發明（設計）人： | 黃如;張耀凱;蔡一茂;陳誠 | 申請（專利權）人： | 北京大學 |
| 主分類號： | H03K19/094 | 分類號： | H03K19/094 |
| 代理公司： | 北京弘權知識產權代理事務所(普通合伙) 11363 | 代理人： | 俞波;許偉群 |
| 地址： | 100871*** | 國省代碼： | 北京;11 |
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| 摘要： | |||
| 搜索關鍵詞： | 進位 電路 芯片 | ||
1.一種進位電路，其特征在于，包括：阻變憶阻器陣列和比較器；
所述阻變憶阻器陣列中同一列阻變憶阻器的正相輸入端相連接，以使所述同一列阻變憶阻器的正相輸入端作為所述進位電路的信號輸入端；
所述阻變憶阻器陣列中同一行阻變憶阻器的反相輸入端與一個所述比較器的輸入端相連接，以使所述比較器的輸出端作為所述進位電路的信號輸出端；
所述比較器的輸入端接收到的電壓大于閾值電壓時，所述比較器的輸出端輸出高電平，所述比較器的輸入端接收到的電壓小于閾值電壓時，所述比較器的輸出端輸出低電平。
2.如權利要求1所述的進位電路，其特征在于，三個所述信號輸入端作為一組，以使同一組的兩個所述信號輸入端用于接收兩個數字輸入信號的同一位，與兩個所述信號輸入端屬于同一組的另一個信號輸入端用于接收兩個數字輸入信號中所述同一位的上一位的進位信號。
3.如權利要求2所述的進位電路，其特征在于，所述進位信號為所述信號輸出端所產生的進位信號。
4.如權利要求1或2或3所述的進位電路，其特征在于，所述阻變憶阻器的阻態包括：高阻值阻態和低阻值阻態；
所述阻變憶阻器陣列中同一行的阻變憶阻器中有三個處于低阻值阻態的阻變憶阻器；以及，所述阻變憶阻器陣列中同一列的阻變憶阻器中有一個處于低阻值阻態的阻變憶阻器。
5.如權利要求1所述的進位電路，其特征在于，所述阻變憶阻器包括：單極型阻變憶阻器或雙極型阻變憶阻器；或
所述阻變憶阻器包括：阻變存儲器RRAM或相變存儲器PRAM或鐵電存儲器FRAM或磁存儲器MRAM。
6.一種芯片，其特征在于，包括：頂電極金屬條、底電極金屬條和進位電路；
所述進位電路包括：阻變憶阻器陣列和比較器；
所述阻變憶阻器陣列中同一列阻變憶阻器的正相輸入端通過所述頂電極金屬條相連接，以使所述同一列阻變憶阻器的正相輸入端作為所述進位電路的信號輸入端；
所述阻變憶阻器陣列中同一行阻變憶阻器的反相輸入端通過所述底電極金屬條與一個所述比較器的輸入端相連接，以使所述比較器的輸出端作為所述進位電路的信號輸出端；
所述比較器的輸入端接收到的電壓大于閾值電壓時，所述比較器的輸出端輸出高電平，所述比較器的輸入端接收到的電壓小于閾值電壓時，所述比較器的輸出端輸出低電平。
7.如權利要求6所述的芯片，其特征在于，三個所述信號輸入端作為一組，以使同一組的兩個所述信號輸入端用于接收兩個數字輸入信號的同一位，與兩個所述信號輸入端屬于同一組的另一個信號輸入端用于接收兩個數字輸入信號中所述同一位的上一位的進位信號。
8.如權利要求7所述的芯片，其特征在于，所述進位信號為所述信號輸出端所產生的進位信號。
9.如權利要求6或7或8所述的芯片，其特征在于，所述阻變憶阻器的阻態包括：高阻值阻態和低阻值阻態；
所述阻變憶阻器陣列中同一行的阻變憶阻器中有三個處于低阻值阻態的阻變憶阻器；以及，所述阻變憶阻器陣列中同一列的阻變憶阻器中有一個處于低阻值阻態的阻變憶阻器。
10.如權利要求6所述的芯片，其特征在于，所述阻變憶阻器包括：單極型阻變憶阻器或雙極型阻變憶阻器；或
所述阻變憶阻器包括：阻變存儲器RRAM或相變存儲器PRAM或鐵電存儲器FRAM或磁存儲器MRAM。
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