[發(fā)明專利]一種并行指令集的實(shí)現(xiàn)方法無效
| 申請?zhí)枺?/td> | 201210364512.7 | 申請日: | 2012-09-26 |
| 公開(公告)號: | CN102945148A | 公開(公告)日: | 2013-02-27 |
| 發(fā)明(設(shè)計(jì))人: | 楊靚;閆鑫;陳上;曹輝 | 申請(專利權(quán))人: | 中國航天科技集團(tuán)公司第九研究院第七七一研究所 |
| 主分類號: | G06F9/38 | 分類號: | G06F9/38 |
| 代理公司: | 西北工業(yè)大學(xué)專利中心 61204 | 代理人: | 顧潮琪 |
| 地址: | 710000*** | 國省代碼: | 陜西;61 |
| 權(quán)利要求書: | 查看更多 | 說明書: | 查看更多 |
| 摘要: | |||
| 搜索關(guān)鍵詞: | 一種 并行 指令 實(shí)現(xiàn) 方法 | ||
技術(shù)領(lǐng)域
本發(fā)明屬于計(jì)算機(jī)技術(shù)領(lǐng)域,涉及到微處理器指令集中的一種并行指令實(shí)現(xiàn)方法。
背景技術(shù)
高性能處理器通常需要具有一個(gè)可以滿足以下要求的指令集:緊湊代碼(以便存儲(chǔ)處理器程序所需的存儲(chǔ)器數(shù)量足夠小),以及豐富的操作和操作數(shù)。實(shí)際上,一個(gè)程序內(nèi)有90%或更多的指令很少被執(zhí)行以至其只占用10%或者更少的執(zhí)行時(shí)間,剩余的10%的指令自然占用90%的執(zhí)行時(shí)間,而且經(jīng)常出現(xiàn)這樣的情況,即一個(gè)程序中很少執(zhí)行的部分不能夠有效使用處理器去同時(shí)提交兩個(gè)或者更多指令,如果使用VLIW指令集對這樣的程序部分進(jìn)行編碼,由于一個(gè)指令的結(jié)果被下一個(gè)指令用到,當(dāng)連續(xù)指令不能出現(xiàn)在相同的VLIW包中時(shí),大部分指令將被編譯器插入程序中以填充VLIW包的“無操作”(NOP)指令,因而對于不能有效利用并行提交指令的能力或這種能力的性能提高未產(chǎn)生較大的影響的程序部分,期望對程序進(jìn)行編碼以實(shí)現(xiàn)最大的代碼密度。
然而由于緊湊代碼導(dǎo)致對各個(gè)最經(jīng)常的操作進(jìn)行最小編碼(從指令集中消除不經(jīng)常使用的操作)并且豐富的操作和操作數(shù)需要正交32位精簡指令集,這樣的多發(fā)射指令集在TMS320C3000系列DSP芯片和TMS320C6000系列DSP芯片中得以應(yīng)用,但是這兩個(gè)要求往往彼此沖突并且難以在單獨(dú)的統(tǒng)一指令集中實(shí)現(xiàn),無法提高處理器的處理效率。
發(fā)明內(nèi)容
為了克服現(xiàn)有技術(shù)的不足,本發(fā)明提供一種單發(fā)射并行操作的指令集,可實(shí)現(xiàn)乘法,加法和裝載指令的并行執(zhí)行,滿足高性能處理器對指令集的要求,即緊湊代碼和多操作。
本發(fā)明解決其技術(shù)問題所采用的技術(shù)方案包括以下步驟:
步驟一,列出需要并行執(zhí)行的單操作指令,找出這些指令的源寄存器地址位號、目的寄存器地址位號、偏移量、偏移方向和操作類型相同的相關(guān)指令信息;
步驟二,將需要并行執(zhí)行的單操作指令的操作類型進(jìn)行統(tǒng)一編碼后放置于所要產(chǎn)生的并行指令中的任一位段,該位段稱為并行操作類型域,所述的編碼確保需要并行執(zhí)行的單操作指令的操作類型信息沒有重合;
步驟三,將需要并行執(zhí)行的單操作指令的源寄存器地址位號、目的寄存器地址位號、偏移量和偏移方向分別放置于所要產(chǎn)生的并行指令的其他位段處,該位段稱為并行指令操作數(shù)域,確保需要并行執(zhí)行的單操作指令的源寄存器地址位號、目的寄存器地址位號、偏移量、偏移方向沒有重合;
步驟四,將并行操作類型域與并行指令操作數(shù)域合并產(chǎn)生的一條新的指令,即為單發(fā)射多指令的并行指令集。
本發(fā)明的有益效果是:通過對指令結(jié)構(gòu)有針對性的并行性設(shè)計(jì),提高了專用微處理器的執(zhí)行效率和微處理器內(nèi)部模塊的利用率。本發(fā)明提供了一種針對不同結(jié)構(gòu)的微處理器及微處理器中的譯碼單元的指令集中并行指令字段劃分的方法,有著廣泛的應(yīng)用前景。
附圖說明
圖1為本發(fā)明的方法流程圖;
圖2為專用算法處理器結(jié)構(gòu)圖;
圖3寄存器傳輸并行指令結(jié)構(gòu)圖;
圖4存儲(chǔ)器訪問并行指令結(jié)構(gòu)圖;
圖5乘加運(yùn)算并行指令結(jié)構(gòu)圖。
具體實(shí)施方式
本發(fā)明包括以下步驟:
步驟一,列出需要并行執(zhí)行的單操作指令,分別找出這些指令的源寄存器地址位號、目的寄存器地址位號、偏移量、偏移方向、操作類型等功能相同或者相近的相關(guān)指令信息。
步驟二,將需要并行執(zhí)行的單操作指令的操作類型信息進(jìn)行統(tǒng)一編碼后放置于所要產(chǎn)生的并行指令中的某一位段處,但該編碼方法所生成的編碼不能使需要并行執(zhí)行的單操作指令的操作類型信息有部分重合或者完全重合的情況,不需要并行執(zhí)行的單操作指令的操作類型信息在該位段可以有不重合或者部分重合或者完全重合的情況,并通過不同編碼使其區(qū)分。約定該位段稱為并行操作類型域。
步驟三,將需要并行執(zhí)行的兩條或者多條單操作指令的源寄存器地址位號、目的寄存器地址位號、偏移量、偏移方向等相關(guān)信息分別放置于所要產(chǎn)生的并行指令的其他位段處,但該放置方法不能使需要并行執(zhí)行的單操作指令的源寄存器地址位號、目的寄存器地址位號、偏移量、偏移方向等相關(guān)對應(yīng)信息有部分重合或者完全重合的情況,不需要并行執(zhí)行的單操作指令的操作類型信息在該位段可以有不重合或者部分重合或者完全重合的情況,并通過不同編碼區(qū)分。約定該位段稱為并行指令操作數(shù)域。
步驟四,將并行操作類型域與并行指令操作數(shù)域以某種方式合并而產(chǎn)生的一條新的指令即為一種單發(fā)射多指令的并行指令集的發(fā)明。
該專利技術(shù)資料僅供研究查看技術(shù)是否侵權(quán)等信息,商用須獲得專利權(quán)人授權(quán)。該專利全部權(quán)利屬于中國航天科技集團(tuán)公司第九研究院第七七一研究所,未經(jīng)中國航天科技集團(tuán)公司第九研究院第七七一研究所許可,擅自商用是侵權(quán)行為。如果您想購買此專利、獲得商業(yè)授權(quán)和技術(shù)合作,請聯(lián)系【客服】
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