[發明專利]時間常數的校正電路及校正方法有效
| 申請號： | 201210245483.2 | 申請日： | 2012-07-16 |
| 公開（公告）號： | CN103546153B | 公開（公告）日： | 2018-10-12 |
| 發明（設計）人： | 郝穎麗;王飛 | 申請（專利權）人： | 中興通訊股份有限公司;深圳市中興微電子技術有限公司 |
| 主分類號： | H03M1/10 | 分類號： | H03M1/10 |
| 代理公司： | 北京派特恩知識產權代理有限公司 11270 | 代理人： | 張穎玲;蔣雅潔 |
| 地址： | 518057 廣東省深圳市南山*** | 國省代碼： | 廣東;44 |
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| 摘要： | |||
| 搜索關鍵詞： | 時間常數 校正 電路 方法 | ||
1.一種時間常數的校正電路，用以校正調制器的第一電路的時間常數，所述調制器用于將模擬信號轉換成數字序列，其特征在于，該校正電路包括：
第二電路，與所述第一電路具有實質上相同的結構，用于產生所述第一電路輸出信號的參考信號；
比較電路，用于比較所述參考信號和所述第一電路的輸出信號，產生所述輸出信號與所述參考信號的比較信號；
逼近電路，用于依據所述比較信號利用二進制搜索算法，通過逐次逼近比較，產生校正信號，將所述校正信號輸入所述第一電路，以校正所述第一電路的時間常數。
2.根據權利要求1所述的校正電路，其特征在于，還包括：
第一采樣保持電路，藕接于所述第二電路的輸出端與所述比較電路之間，用于將所述參考信號轉換成參考序列；
第二采樣保持電路，藕接于所述第一電路的輸出端與所述比較電路之間，用于將所述輸出信號轉換成輸出序列。
3.根據權利要求2所述的校正電路，其特征在于，所述第一采樣保持電路與所述第二采樣保持電路為S/H采樣電路。
4.根據權利要求1所述的校正電路，其特征在于，所述第一電路為RC結構的積分器，所述第二電路為RC結構的積分器。
5.根據權利要求4所述的校正電路，其特征在于，所述逼近電路依據其產生的校正信號調整所述第一電路的電容C和/或所述第一電路的電阻R的大小，以校正所述RC結構的積分器的時間常數。
6.根據權利要求1所述的校正電路，其特征在于，所述逼近電路為逐次逼近寄存器SAR。
7.根據權利要求1所述的校正電路，其特征在于，所述比較電路為電壓比較器。
8.一種時間常數的校正方法，用以校正調制器的第一電路的時間常數，所述調制器用于將模擬信號轉換成數字序列，其特征在于，該方法包括：
輸入一輸入信號至第一電路和第二電路，其中，所述第二電路與所述第一電路具有實質上相同的結構，用于產生所述第一電路輸出信號的參考信號；
比較所述參考信號和所述第一電路的輸出信號，產生所述輸出信號與所述參考信號的比較信號；
通過逼近電路依據所述比較信號利用二進制搜索算法，通過逐次逼近比較，產生校正信號，將所述校正信號輸入所述第一電路，以校正所述第一電路的時間常數。
9.根據權利要求8所述的方法，其特征在于，比較所述參考信號和所述第一電路的輸出信號之前，還包括：
將所述參考信號通過第一采樣保持電路轉換為參考序列；以及
將所述第一電路的輸出信號通過第二采樣保持電路轉換成輸出序列。
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