[發(fā)明專利]基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置有效
| 申請?zhí)枺?/td> | 201110459673.X | 申請日: | 2011-12-31 |
| 公開(公告)號: | CN102591767A | 公開(公告)日: | 2012-07-18 |
| 發(fā)明(設計)人: | 馬翀 | 申請(專利權)人: | 曙光信息產業(yè)股份有限公司 |
| 主分類號: | G06F11/32 | 分類號: | G06F11/32 |
| 代理公司: | 北京德恒律師事務所 11306 | 代理人: | 陸鑫;房嶺梅 |
| 地址: | 300384 天津市西青區(qū)華*** | 國省代碼: | 天津;12 |
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| 摘要: | |||
| 搜索關鍵詞: | 基本 輸入輸出 系統(tǒng) bios 程序 進程 指示 裝置 | ||
技術領域
本發(fā)明總體上涉及計算機領域,更具體地,涉及基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置。
背景技術
主板調試口(PORT80)是一種用于主板系統(tǒng)BIOS(基本輸入輸出系統(tǒng))軟件開發(fā)的輔助功能,由于系統(tǒng)BIOS的復雜性和時序相關性,使用PORT80指示程序的運行進度是一種行之有效的方式。PORT80的實現(xiàn)方法有很多種,但是目前主流的實現(xiàn)方式不是需要特定的解碼芯片就是要單獨購買調試卡(一般是PCI卡)。
目前PORT80的主流實現(xiàn)方式是將一個專用的CPLD連接于主板的南橋上,通過解析LPC協(xié)議中對80端口的操作,然后將結果顯示與8段數(shù)碼管中。然而,該方案需要專門的CPLD芯片和8段數(shù)碼管,增加了主板的成本和主板設計的難度,同時也要在CPLD中燒寫專門的協(xié)議解析軟件。
此外,目前還可以使用PCI調試卡顯示軟件運行進度。但是這樣的解決方案需要主板支持PCI卡,并且系統(tǒng)BIOS需要作調整,需要專門的PCI調試卡,增加了調試成本,并且由于刀片類主板一般沒有PCI插槽,所以不能應用在這類主板上。
發(fā)明內容
為此,本發(fā)明提供了一種基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置,包括:譯碼器,用于將表示BIOS程序數(shù)據(jù)的信號編譯為8位二進制數(shù);第一多功能輸入輸出端口GPIO,與譯碼器電連接,用于模擬時鐘信號,并將時鐘信號發(fā)送給譯碼器;第二GPIO,與譯碼器電連接,用于將BIOS程序數(shù)據(jù)轉換為信號,并將信號發(fā)送給譯碼器;以及指示裝置,與譯碼器電連接,用于將8位二進制數(shù)顯示出來。
指示裝置是8位LED燈。
經歷時鐘信號的高電位和低電位各一次,則表示完成了一個數(shù)據(jù)位的傳輸。
BIOS是同一可擴展固件接口UEFI結構下的BIOS。
此外,還提供了一種基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置,包括:譯碼器,用于將表示BIOS程序數(shù)據(jù)的信號編譯為二進制數(shù);第一多功能輸入輸出端口GPIO,與譯碼器電連接,用于模擬時鐘信號,并將時鐘信號發(fā)送給譯碼器;第二GPIO,與譯碼器電連接,用于將BIOS程序數(shù)據(jù)轉換為信號,并將信號發(fā)送給譯碼器;以及指示裝置,與譯碼器電連接,用于將二進制數(shù)顯示出來。
指示裝置是8位LED燈。
經歷時鐘信號的高電位和低電位各一次,則表示完成了一個數(shù)據(jù)位的傳輸,指示裝置需重復8次數(shù)據(jù)位的指示。
BIOS是同一可擴展固件接口UEFI結構下的BIOS。
附圖說明
當結合附圖進行閱讀時,根據(jù)下面詳細的描述可以更好地理解本發(fā)明。應該強調的是,根據(jù)工業(yè)中的標準實踐,各種部件沒有被按比例繪制。實際上,為了清楚的討論,各種部件的尺寸可以被任意增加或減少
圖1示出了根據(jù)本發(fā)明的示例性實施例的基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置的框圖。
具體實施方式
為了實施本發(fā)明的不同部件,以下描述提供了許多不同的實施例或示例。以下描述元件和布置的特定示例以簡化本發(fā)明。當然這些僅僅是示例并不打算限定。再者,以下描述中第一部件形成在第二部件上可包括其中第一和第二部件以直接接觸形成的實施例,并且也可包括其中額外的部件形成插入到第一和第二部件中的實施例,使得第一和第二部件不直接接觸。為了簡明和清楚,可以任意地以不同的尺寸繪制各種部件。
本發(fā)明無需的設計初衷旨在不使用任何附加的解碼芯片,通過軟件的方法實現(xiàn)PORT80的調試功能。并且該發(fā)明在傳統(tǒng)BIOS和UEFI架構BIOS下都可以應用,為主板設計和主板軟件開發(fā)節(jié)省了開發(fā)成本。
本發(fā)明在硬件上需要兩個未被使用的GPIO(多功能輸入輸出端口)作為時鐘線和信號線,將兩根線連接和串轉并的譯碼器相連接,最后將8個數(shù)碼管和該串轉并的譯碼器相連接。
軟件方面通過控制GPIO來模擬時鐘,在時鐘的高電平時發(fā)送信號,再拉低時鐘信號,此時可以算作一個數(shù)據(jù)位的傳輸。由于PORT80共有8比特,所以每次發(fā)送80碼要重復8次上述的過程。
本發(fā)明適用于計算機領域,提供了一種實現(xiàn)主板調試口(PORT80)的實現(xiàn)方法。下面將結合附圖詳細描述本發(fā)明的示例性實施例。
圖1示出了根據(jù)本發(fā)明的示例性實施例的基本輸入輸出系統(tǒng)BIOS程序進程的指示裝置的框圖。
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