[發(fā)明專(zhuān)利]觸發(fā)器電路有效
| 申請(qǐng)?zhí)枺?/td> | 201110392782.4 | 申請(qǐng)日： | 2011-12-01 |
| 公開(kāi)（公告）號(hào)： | CN102487270A | 公開(kāi)（公告）日： | 2012-06-06 |
| 發(fā)明（設(shè)計(jì)）人： | 金珉修 | 申請(qǐng)（專(zhuān)利權(quán)）人： | 三星電子株式會(huì)社 |
| 主分類(lèi)號(hào)： | H03K3/012 | 分類(lèi)號(hào)： | H03K3/012;H03K3/027 |
| 代理公司： | 中原信達(dá)知識(shí)產(chǎn)權(quán)代理有限責(zé)任公司 11219 | 代理人： | 李佳;穆德駿 |
| 地址： | 韓國(guó)京畿道水*** | 國(guó)省代碼： | 韓國(guó);KR |
| 權(quán)利要求書(shū)： | 查看更多 | 說(shuō)明書(shū)： | 查看更多 |
| 摘要： | |||
| 搜索關(guān)鍵詞： | 觸發(fā)器 電路 | ||
1.一種觸發(fā)器電路，包括：
評(píng)估部件，所述評(píng)估部件連接到第一節(jié)點(diǎn)和第二節(jié)點(diǎn)，以根據(jù)所述第一節(jié)點(diǎn)的電壓電平使所述第二節(jié)點(diǎn)放電；
條件延遲部件，所述條件延遲部件連接到所述第二節(jié)點(diǎn)，以使第三節(jié)點(diǎn)放電為具有與所述第二節(jié)點(diǎn)的電壓電平不同的電壓電平；以及
保持器邏輯部件，所述保持器邏輯部件連接到所述第二節(jié)點(diǎn)和第三節(jié)點(diǎn)，以維持所述第二節(jié)點(diǎn)和第三節(jié)點(diǎn)中沒(méi)有正在被放電的一個(gè)的電壓電平。
2.根據(jù)權(quán)利要求1所述的觸發(fā)器電路，其中：
所述評(píng)估部件包括第一晶體管，所述第一晶體管用于根據(jù)所述第一節(jié)點(diǎn)的電壓電平在所述第二節(jié)點(diǎn)與接地電壓之間形成電流通路；
所述條件延遲部件包括第二晶體管，所述第二晶體管用于根據(jù)所述第二節(jié)點(diǎn)的電壓電平在所述第三節(jié)點(diǎn)與所述接地電壓之間形成電流通路；并且
其中，如果當(dāng)所述第一晶體管被接通時(shí)所述第二節(jié)點(diǎn)被放電，則所述第二晶體管被斷開(kāi)并且所述第三節(jié)點(diǎn)的放電通路被中斷。
3.根據(jù)權(quán)利要求2所述的觸發(fā)器電路，其中：
所述保持器邏輯部件包括第三晶體管，所述第三晶體管用于根據(jù)所述第二節(jié)點(diǎn)的電壓電平在電源電壓與所述第三節(jié)點(diǎn)之間形成電流通路；并且
其中，如果所述第二節(jié)點(diǎn)被放電，則所述第三晶體管被接通以被所述電源電壓充電。
4.根據(jù)權(quán)利要求3所述的觸發(fā)器電路，其中：
所述保持器邏輯部件進(jìn)一步包括第四晶體管，所述第四晶體管用于根據(jù)所述第二節(jié)點(diǎn)的電壓電平在所述第二節(jié)點(diǎn)與接地電壓之間形成電流通路；并且
當(dāng)所述第二節(jié)點(diǎn)被放電時(shí)，所述第四晶體管被接通，以維持所述第二節(jié)點(diǎn)的放電狀態(tài)。
5.根據(jù)權(quán)利要求2所述的觸發(fā)器電路，其中，如果所述第二節(jié)點(diǎn)被放電，則維持所述第一節(jié)點(diǎn)的電壓電平直到完成所述第二節(jié)點(diǎn)的放電操作為止。
6.根據(jù)權(quán)利要求1所述的觸發(fā)器電路，其中，所述評(píng)估部件包括第一晶體管和第二晶體管，所述第一晶體管和第二晶體管彼此串聯(lián)連接，以分別響應(yīng)于時(shí)鐘信號(hào)和所述第一節(jié)點(diǎn)的電壓電平而在所述第二節(jié)點(diǎn)上形成放電通路。
7.根據(jù)權(quán)利要求6所述的觸發(fā)器電路，其中，所述評(píng)估部件進(jìn)一步包括第三晶體管，所述第三晶體管連接到所述第二晶體管，以根據(jù)所述第三節(jié)點(diǎn)的電壓電平在所述第二節(jié)點(diǎn)上形成放電通路。
8.根據(jù)權(quán)利要求7所述的觸發(fā)器電路，其中，所述評(píng)估部件進(jìn)一步包括第四晶體管，所述第四晶體管連接在電源電壓與所述第一晶體管之間，以根據(jù)時(shí)鐘信號(hào)在所述第二節(jié)點(diǎn)上形成充電通路。
9.根據(jù)權(quán)利要求1所述的觸發(fā)器電路，其中，所述條件延遲部件包括第一晶體管和第二晶體管，所述第一晶體管和第二晶體管彼此串聯(lián)連接，以分別根據(jù)所述第二節(jié)點(diǎn)的電壓和所述第一節(jié)點(diǎn)的電壓在所述第三節(jié)點(diǎn)上形成放電通路。
10.根據(jù)權(quán)利要求9所述的觸發(fā)器電路，其中，所述條件延遲部件進(jìn)一步包括第三晶體管，所述第三晶體管連接到所述第二晶體管，以響應(yīng)于時(shí)鐘信號(hào)在所述第三節(jié)點(diǎn)上形成放電通路。
11.根據(jù)權(quán)利要求10所述的觸發(fā)器電路，其中，所述條件延遲部件進(jìn)一步包括第四晶體管，所述第四晶體管連接在電源電壓與所述第一晶體管之間，以形成用于以所述電源電壓對(duì)所述第三節(jié)點(diǎn)充電的通路。
12.根據(jù)權(quán)利要求1所述的觸發(fā)器電路，其中，所述保持器邏輯部件包括：
第一晶體管，所述第一晶體管連接到所述第二節(jié)點(diǎn)，以根據(jù)所述第二節(jié)點(diǎn)的電壓電平在所述第二節(jié)點(diǎn)與接地電壓之間形成電流通路；和
第二晶體管，所述第二晶體管連接到所述第二節(jié)點(diǎn)，以根據(jù)所述第三節(jié)點(diǎn)的電壓電平在所述第二節(jié)點(diǎn)與電源電壓之間形成電流通路；
第三晶體管，所述第三晶體管連接到所述第三節(jié)點(diǎn)，以根據(jù)所述第三節(jié)點(diǎn)的電壓電平在所述第三節(jié)點(diǎn)與接地電壓之間形成電流通路；以及
第四晶體管，所述第四晶體管連接到所述第三節(jié)點(diǎn)并且根據(jù)所述第二節(jié)點(diǎn)的電壓電平在所述第三節(jié)點(diǎn)與電源電壓之間形成電流通路。
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