[發(fā)明專利]一種時鐘相位對齊調整電路有效
| 申請?zhí)枺?/td> | 201110330283.2 | 申請日: | 2011-10-26 |
| 公開(公告)號: | CN102361456A | 公開(公告)日: | 2012-02-22 |
| 發(fā)明(設計)人: | 孫海濤 | 申請(專利權)人: | 華亞微電子(上海)有限公司 |
| 主分類號: | H03L7/18 | 分類號: | H03L7/18;H03L7/08 |
| 代理公司: | 上海智信專利代理有限公司 31002 | 代理人: | 鄧琪 |
| 地址: | 201203 上海市浦東新*** | 國省代碼: | 上海;31 |
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| 摘要: | |||
| 搜索關鍵詞: | 一種 時鐘 相位 對齊 調整 電路 | ||
1.一種時鐘相位對齊調整電路,可與帶有輸入分頻器和反饋分頻器的鎖 相環(huán)配合實現時鐘信號的相位對齊,其特征在于,所述電路包括:
與門,其一個輸入端接收外圍的輸入時鐘信號,其輸出端輸出相位調整 后的時鐘信號;
第一延遲器,其輸入端接收外圍的復位信號,其輸出端依次通過第一D 觸發(fā)器和第二延遲器連接至所述與門的另一個輸入端,以向該與門輸出使能 信號;以及
反相器,其輸入端接收所述輸入時鐘信號,其輸出端與所述第一D觸發(fā) 器連接。
2.根據權利要求1所述的時鐘相位對齊調整電路,其特征在于,所述電 路還包括與所述第一D觸發(fā)器連接的第二D觸發(fā)器,所述反相器的輸出端與 該第二D觸發(fā)器連接。
3.根據權利要求2所述的時鐘相位對齊調整電路,其特征在于,所述輸 入時鐘信號為所述鎖相環(huán)輸出的時鐘信號,且該鎖相環(huán)接收由所述第二D觸 發(fā)器控制的釋放信號,該釋放信號初始為低電平。
4.根據權利要求3所述的時鐘相位對齊調整電路,其特征在于,所述輸 入分頻器和反饋分頻器分別接收所述釋放信號。
5.根據權利要求1-4中任意一項所述的時鐘相位對齊調整電路,其特征 在于,所述第一延遲器的輸出端與所述第一D觸發(fā)器的D端連接,且該第一 D觸發(fā)器的Q端與所述第二延遲器的輸入端連接。
6.根據權利要求3或4所述的時鐘相位對齊調整電路,其特征在于,所 述第二D觸發(fā)器的D端與所述第一D觸發(fā)器的Q端連接,第二D觸發(fā)器的 Q端輸出所述釋放信號。
7.根據權利要求2或3所述的時鐘相位對齊調整電路,其特征在于,所 述反相器的輸出端分別與所述第一D觸發(fā)器、第二D觸發(fā)器的CK端連接。
8.根據權利要求1所述的時鐘相位對齊調整電路,其特征在于,所述輸 入時鐘信號的頻率低于1GHz。
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