[發明專利]一種格雷碼解碼的并行設計電路無效
| 申請號： | 201110153076.4 | 申請日： | 2011-06-08 |
| 公開（公告）號： | CN102820891A | 公開（公告）日： | 2012-12-12 |
| 發明（設計）人： | 左耀華 | 申請（專利權）人： | 上海華虹集成電路有限責任公司 |
| 主分類號： | H03M13/15 | 分類號： | H03M13/15 |
| 代理公司： | 上海東創專利代理事務所(普通合伙) 31245 | 代理人： | 曹立維 |
| 地址： | 201203 上海*** | 國省代碼： | 上海;31 |
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| 摘要： | |||
| 搜索關鍵詞： | 一種 格雷碼 解碼 并行 設計 電路 | ||
【權利要求書】：
1.一種格雷碼解碼的并行設計電路，其特征在于所述并行設計電路由異或運算單元搭建的組合電路構成。
2.根據權利要求1所述的一種格雷碼解碼的并行設計電路，其特征在于所述異或運算單元為八個。
3.根據權利要求1所述的一種格雷碼解碼的并行設計電路，其特征在于所述電路輸入數據和輸出數據的位寬均為八比特。
4.根據權利要求1所述的一種格雷碼解碼的并行設計電路，其特征在于所述八個異或運算單元采樣外部輸入的八位數據，同時進行異或運算產生運算結果。
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