[發明專利]開關裝置與應用該開關裝置的移位緩存器電路有效
| 申請號: | 201110055092.X | 申請日: | 2011-02-28 |
| 公開(公告)號: | CN102184697A | 公開(公告)日: | 2011-09-14 |
| 發明(設計)人: | 徐國華;陳勇志;張竣桓 | 申請(專利權)人: | 友達光電股份有限公司 |
| 主分類號: | G09G3/20 | 分類號: | G09G3/20 |
| 代理公司: | 上海專利商標事務所有限公司 31100 | 代理人: | 郭蔚 |
| 地址: | 中國臺灣新竹科*** | 國省代碼: | 中國臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 開關 裝置 應用 移位 緩存 電路 | ||
【技術領域】
本發明系有關于一種開關裝置與應用該開關裝置的移位緩存器電路,尤指一種開關裝置與應用該開關裝置的具低功率消耗與高驅動能力的移位緩存器電路。
【背景技術】
液晶顯示裝置(Liquid?Crystal?Display;LCD)是目前廣泛使用之一種平面顯示器,其具有外型輕薄、省電以及低輻射等優點。液晶顯示裝置的工作原理系利用改變液晶層兩端的電壓差來改變液晶層內的液晶分子的排列狀態,用以改變液晶層的透光性,再配合背光模塊所提供的光源以顯示影像。一般而言,液晶顯示裝置包含多個畫素單元、源極驅動器以及移位緩存器電路。源極驅動器用來提供多個數據信號至多個畫素單元。移位緩存器電路包含多級移位緩存器以產生多個柵極信號饋入多個畫素單元,據以控制多個數據信號的寫入運作。因此,移位緩存器電路即為控制數據信號寫入操作的關鍵性組件。
傳統液晶顯示裝置內設置有大量基于薄膜晶體管的開關裝置,故薄膜晶體管的逆向漏電流即為液晶顯示裝置運作的高功率消耗主因之一,從而導致高面板操作溫度,如此不但會降低顯示質量,也會縮短面板使用壽命。尤其若為降低液晶顯示裝置的制造成本而將移位緩存器電路整合于包含畫素數組的顯示面板上,亦即基于GOA(Gate-driver?On?Array)架構將移位緩存器電路的多級移位緩存器配合多個柵極線而依序設置于顯示面板的相當狹長的邊框區域,則低信號傳輸能力更會顯著降低面板顯示質量。
【發明內容】
依據本發明的實施例,其揭露一種移位緩存器電路,用以提供多個柵極信號至多個柵極線。此種移位緩存器電路包含多級移位緩存器,所述級移位緩存器的第N級移位緩存器包含上拉單元與輸入單元。電連接于第N柵極線的上拉單元用來根據系統頻率與驅動控制電壓以上拉第N柵極信號,其中第N柵極線系用以傳輸第N柵極信號。電連接于上拉單元的輸入單元用來根據控制信號與輸入信號以輸出驅動控制電壓。輸入單元包含第一晶體管與第二晶體管。第一晶體管具有一用來接收輸入信號的第一端、一用來接收控制信號的柵極端、及一第二端。第二晶體管具有一電連接于第一晶體管的第二端的第一端、一電連接于第一晶體管的第一端的柵極端、及一用來輸出驅動控制電壓的第二端。
依據本發明的實施例,另揭露一種移位緩存器電路,用以提供多個柵極信號至多個柵極線。此種移位緩存器電路包含多級移位緩存器,所述級移位緩存器的第N級移位緩存器包含上拉單元、輸入單元、及下拉單元。電連接于第N柵極線的上拉單元用來根據系統頻率與驅動控制電壓以上拉第N柵極信號,其中第N柵極線系用以傳輸第N柵極信號。電連接于上拉單元的輸入單元用來根據第一輸入信號以輸出驅動控制電壓。電連接于輸入單元的下拉單元用來根據控制信號與第二輸入信號以下拉驅動控制電壓。下拉單元包含第一晶體管、第二晶體管與第三晶體管。第一晶體管具有一電連接于輸入單元的第一端、一用來接收控制信號的柵極端、及一第二端。第二晶體管具有一電連接于第一晶體管的第二端的第一端、一用來接收第二輸入信號的柵極端、及一用來接收電源電壓的第二端。第三晶體管具有一電連接于第一晶體管的第一端的第一端、一電連接于第二晶體管的柵極端的柵極端、及一電連接于第一晶體管的第二端的第二端。
本發明另揭露一種開關裝置,用以控制第一節點與第二節點間的連接/斷開狀態。此種開關裝置包含第一晶體管、第二晶體管、及第三晶體管。第一晶體管包含一電連接于第一節點的第一端、一用來接收第一控制信號的柵極端、及一第二端。第二晶體管包含一電連接于第一晶體管的第二端的第一端、一用來接收第二控制信號的柵極端、及一電連接于第二節點的第二端。第三晶體管包含一電連接于第一晶體管的第一端的第一端、一電連接于第二晶體管的柵極端的柵極端、及一電連接于第一晶體管的第二端的第二端。
【附圖說明】
圖1為本發明第一實施例的移位緩存器電路的示意圖。
圖2為圖1所示的移位緩存器電路執行柵極信號前向掃描運作的相關信號波形示意圖,其中橫軸為時間軸。
圖3為本發明第二實施例的移位緩存器電路的示意圖。
圖4為本發明第三實施例的移位緩存器電路的示意圖。
圖5為本發明第四實施例的移位緩存器電路的示意圖。
圖6為本發明第五實施例的移位緩存器電路的示意圖。
【主要組件符號說明】
100、200、300、400、??移位緩存器電路
500
111、211、311、411、??第(N-2)級移位緩存器
511
112、212、312、412、??第(N-1)級移位緩存器
512
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