[實用新型]基于低成本多路并行高速率的A/D采樣電路板有效

申請號：	201020667501.2	申請日：	2010-12-20
公開（公告）號：	CN202019349U	公開（公告）日：	2011-10-26
發明（設計）人：	王偉權	申請（專利權）人：	四川九洲電器集團有限責任公司
主分類號：	H03M1/54	分類號：	H03M1/54
代理公司：	成都九鼎天元知識產權代理有限公司 51214	代理人：	徐宏;吳彥峰
地址：	621000 四***	國省代碼：	四川;51
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摘要：
搜索關鍵詞：	基于低成本并行速率采樣電路板
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【權利要求書】：

1.一種基于低成本多路并行高速率的A/D采樣電路板，其特征是：該電路板包括模擬信號輸入電路、時鐘產生和分配模塊、ADC模塊、FPGA模塊和DSP模塊；所述模擬信號處理模塊主要實現對模擬信號的輸入，以驅動ADC模塊；時鐘產生和分配模塊為ADC模塊提供同一時鐘基準；FPGA模塊和DSP模塊用于將經過高速采樣處理后形成的數字信號進行采樣校正和驗證效果。

2.根據權利要求1所述的基于低成本多路并行高速率的A/D采樣電路板，其特征是：所述FPGA模塊接收ADC模塊輸出的LVDS電平的時鐘和數據是存放在內部RAM中的；所述FPGA內部的FIFO只用工作在125MHz下。

3.根據權利要求1所述的基于低成本多路并行高速率的A/D采樣電路板，其特征是：所述DSP模塊，選用芯片TMS320VC5509A，用于采樣效果的驗證和初期的誤差校正工作。?

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