[發明專利]分時降頻濾波器與分時降頻濾波方法有效
| 申請號: | 201010141457.6 | 申請日: | 2010-03-26 |
| 公開(公告)號: | CN102201606A | 公開(公告)日: | 2011-09-28 |
| 發明(設計)人: | 黃共鑣 | 申請(專利權)人: | 聯詠科技股份有限公司 |
| 主分類號: | H01P1/20 | 分類號: | H01P1/20 |
| 代理公司: | 北京同立鈞成知識產權代理有限公司 11205 | 代理人: | 劉芳 |
| 地址: | 中國臺灣新竹科學工*** | 國省代碼: | 中國臺灣;71 |
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| 摘要: | |||
| 搜索關鍵詞: | 分時 濾波器 濾波 方法 | ||
技術領域
本發明是有關于一種分時降頻濾波器與分時降頻濾波方法,其中降頻濾波單元的濾波與降頻的處理可以分時進行。
背景技術
在信號傳送中,有一些信號是利用高密度的取樣點而轉換成數字方式以進行傳送。然而在接收處理的一端必須先將信號濾波與降頻的處理后才會進行取出所傳送的數據的處理。一般而言,降頻的程度需要達到四階,即是做16倍的降頻。
圖1為傳統濾波與降頻的架構示意圖。參閱圖1,從頻域(frequencydomain)來看,輸入信號是以fs的頻率輸入,其通過四個降頻濾波單元(decimation?filter?unit)100做四階的降頻,其輸出信號的頻率是fs/16。降頻濾波單元100例如是由半波段濾波器(half?band?filter,HBF)與丟棄單元(decimator)所組成。丟棄單元以朝下箭頭代表。換句或說,每一個降頻濾波單元100都會做fs/2的降頻取樣而四個降頻濾波單元100總共達到fs/16的降頻取樣。對于輸出而言,每一階的降頻濾波單元100會提供給下一階的降頻濾波單元100的輸入,另外也會同時輸出到分時多工器(time-division?multiplexer,MUX)102,由控制信號104,分時選擇輸出的信息。
就實際的數據,例如在衛星通訊中,其一個數據是由實部信息(real?part)與虛部數據(imaginary?part)所組成,分別稱為I數據與Q數據。如果依照圖1的傳統架構,則要達到I數據與Q數據的四倍降頻就需要16個降頻濾波單元100財能達成。這種設計至少會有高成本的考量。如何更有效進行濾波與降頻的設計是研發的方向其一。
發明內容
本發明提供一種分時降頻濾波器與分時降頻濾波方法,可以有效利用傳統方式中閑置的時間,以管線(pipeline)機制達到減少濾波與降頻單元的使用量。
本發明提出一種分時降頻濾波器,一種分時降頻濾波器,包括一個二倍降頻濾波單元,在一系統時脈下操作,接收一輸入數據串。此輸入數據串中的每一個數據包括一第一部分數據與一第二部分數據,其中于系統時脈的每一個奇數時脈周期將該第一部分數據做濾波與二倍降頻后輸出。在每一個偶數時脈周期將該第二部分數據做濾波與二倍降頻后輸出。
本發明提出一種分時降頻濾波器,一種分時降頻濾波器,包括一個二倍降頻濾波單元,在一系統時脈下操作,接收一輸入數據串,以2N個時脈周期為一操作區間單元,N大于或是等于2。此二倍降頻濾波單元接收該輸入數據串且分時接收該二倍降頻濾波單元的多個回饋數據,以分配到所述2N個時脈周期中,分時做濾波與降頻輸出。
本發明提出一種分時降頻濾波器,包括二個降頻濾波單元。第一降頻濾波單元在一系統時脈下操作,接收一第一階輸入數據串。第一階輸入數據串中的每一個數據包括第一部分數據與第二部分信息。在奇數時脈周期,將第一部分數據做濾波與降頻后輸出。在偶數時脈周期,將第二部分數據做濾波與降頻后輸出。第二降頻濾波單元,在系統時脈下操作以2N個時脈周期為一操作區間單元,N大于或是等于2。第二降頻濾波單元接收該第一降頻濾波單元的輸出且分時接收該第二個降頻濾波單元的多個回饋數據,以分配到所述2N個時脈周期中,分時做濾波與降頻輸出。
本發明提出一種分時降頻濾波方法,包括利用一第一個二倍降頻濾波單元,在一系統時脈下操作,接收一第一階輸入數據串,其中該第一階輸入數據串中的每一個數據包括一第一部分數據與一第二部分數據,其中在該系統時脈的每一個奇數時脈周期將該第一部分數據做濾波與二倍降頻后輸出,在每一個偶數時脈周期將該第二部分數據做濾波與二倍降頻后輸出。利用一第二個二倍降頻濾波單元,在系統時脈下操作以2N個時脈周期為一操作區間單元,N大于或是等于2,其中該第二個二倍降頻濾波單元接收該第一個二倍降頻濾波單元的輸出且分時接收該第二個二倍降頻濾波單元的多個回饋數據,以分配到所述2N個時脈周期中,分時做濾波與降頻輸出。
本發明提出一種分時降頻濾波器,包括一個二倍降頻濾波單元,在一系統時脈下操作以24個時脈周期為一操作區間單元,其中該二倍降頻濾波單元接收輸入數據串且分時接收該二倍降頻濾波單元的多個回饋數據,以分配到所述24個時脈周期中,分時做濾波與降頻輸出。
為讓本發明上述特征和優點能更明顯易懂,下文特舉實施例,并配合所附圖作詳細說明如下。
附圖說明
圖1為傳統濾波與降頻的架構示意圖;
圖2為本發明一實施例一種分時降頻濾波器的電路方塊示意圖;
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