[發明專利]基于Java處理器的數字機頂盒無效
| 申請號: | 201010127430.1 | 申請日: | 2010-03-16 |
| 公開(公告)號: | CN101790030A | 公開(公告)日: | 2010-07-28 |
| 發明(設計)人: | 譚洪舟;陳摯睿;文旭樺;林春優 | 申請(專利權)人: | 中山大學 |
| 主分類號: | H04N5/00 | 分類號: | H04N5/00 |
| 代理公司: | 廣州凱東知識產權代理有限公司 44259 | 代理人: | 宋冬濤 |
| 地址: | 510630 廣東*** | 國省代碼: | 廣東;44 |
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| 摘要: | |||
| 搜索關鍵詞: | 基于 java 處理器 數字 機頂盒 | ||
技術領域
本發明涉及一種基于Java專用處理器技術的數字家庭娛樂設備的新架構,具體來說,涉及一種基于Java專用處理器技術的數字電視機頂盒。
背景技術
隨著數字家庭時代的到來,人們對于生活質量的要求日漸提高,在許多方面要求家用電器智能化,能夠很好的滿足用戶需求,達到更好的滿意度。
現有市場上的數字電視機頂盒,從結構上看,一般由調諧解調器、主芯片、內存、外設接口電路、有條件接收接口CA(Conditional?Access)和視音頻輸出等幾大部分構成;從邏輯功能上看,一般分為調諧解調模塊、視音頻解碼模塊、視音頻編碼模塊、視音頻輸出模塊和控制電路模塊。控制電路由主CPU、程序存儲器、數據存儲器、總線驅動器和各種外設接口電路組成,它是機頂盒的控制中心,控制電路主要的作用是控制和協調各部分電路的工作,按照設計的程序完成機器的各種功能,以及通過操作面板接口和IR遙控器于用戶進行人機對話。
但是現有數字電視機頂盒,在處理一些自帶或者網絡上的Java游戲或Java應用程序時,都有出現一定的延遲或者停滯,導致畫面的不流暢,影響了數字電視機頂盒的互動性和娛樂性。
發明內容
針對以上的不足,本發明提供了一種更夠大大提交機頂盒的互動性和娛樂性的基于Java處理器技術的數字電視機頂盒。
本發明的基于Java處理器的數字機頂盒包括機頂盒主板,以及一個用于直接高效運行Java游戲和Java應用程序的Java處理模塊,所述Java處理模塊與機頂盒主板進行通信。
所述Java游戲和Java應用程序包括本地或者網絡的Java游戲和Java應用程序。
所述Java處理模塊為一內嵌入機頂盒主板的機頂盒擴展板,所述機頂盒擴展板包括Java處理器、內存和以太網口,機頂盒擴展板首先通過以太網口接收機頂盒主板的控制指令信息和數據,然后通過Java處理器運行Java游戲和Java程序,再通過以太網口將處理完的指令和結果數據返回給機頂盒主板。
所述Java處理器為Java?SoC處理器,它包括:直接運行由標準Java編譯器生成的Java字節碼程序的Java核VP6000;使用AMBAAHB總線連接處理器核和memory控制器,采用APB總線為系統的低速外部設備提供低功耗的簡易互連的AMBA總線;用來存儲啟動程序、實時操作系統和文件系統的存儲器;為擴展Java處理器的應用范圍而提供的DMA控制器、以太網接口、SPI和I2C接口。
所述Java處理模塊為Java專用處理器,所述Java專用處理器作為協處理器直接與機頂盒主板進行通信。
所述機頂盒主板包括:1)調諧解調器:用于將傳輸過來的調制數字信號解調還原成傳輸流;2)主芯片:首先根據傳輸流所傳遞的標志信息對接收到的傳輸流進行解復用,然后根據CA智能卡所傳遞的解擾信息對節目流進行解擾,解擾后的TS流送到視音頻解碼器中分別對其進行解碼,還原成AV信號進行輸出,同時,也分離出復用在傳輸流中的各類系統數據表,送給機頂盒處理器分別輸出;3)內存:用來存貯機頂盒的系統軟件、驅動軟件、應用程序、用戶信息和應用數據,并通過在線的方式對其上所載的軟件進行更新;4)外設接口電路:包括外部存儲設備和回傳通信接口,還包括RS232接口、紅外遙控器接口、無線鍵盤接口和Wi-Fi接口;5)智能卡接口:通過讀卡器讀取CA智能卡中的數據,用于數字電視節目的解擾;6)視音頻輸出:完成視頻濾波和音頻放大。
本發明的有益效果:本發明通過Java處理模塊能夠直接實現快速、流暢的運行電視機頂盒本地或者網絡上的Java游戲和Java應用程序,極大提高電視機頂盒的互動性和娛樂性,使得電視機頂盒的設計更加智能化和人性化。
附圖說明
圖1為本發明機頂盒的實施一的結構示意圖;
圖2為本發明實施一的機頂盒擴展板的結構示意圖;
圖3為本發明實施一Java?SoC處理器的結構示意圖;
圖4為本發明實施二的結構示意圖。
具體實施方式
下面結合附圖對本發明進行進一步闡述。
本發明基于Java處理器的數字機頂盒,它在原有機頂盒其他模塊相對不變的基礎上,在控制電路上加入Java專用處理器技術,具體可分為嵌入主板方式和協處理器方式兩種實施方案。
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